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NAND formとは 意味・読み方・使い方
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意味・対訳 NAND形式
「NAND form」の部分一致の例文検索結果
該当件数 : 8件
A two input NAND section 20i which is operated by a power supply voltage VCC2 for external circuit driving and an inverter section 30i form a holding circuit.例文帳に追加
外部回路駆動用の電源電圧VCC2で動作する2入力のNAND部20iとインバータ部30iは、保持回路を形成している。 - 特許庁
The clock doubler circuit has a form where three NAND gates whose skew is preferably small are coupled.例文帳に追加
そのクロック・ダブラ回路は、スキューが小さいことが好ましい3つのNANDゲートが結合された形式になっている。 - 特許庁
A control unit 10 formats a NAND type flash memory 12 in a form suited to the DVD 30 when imaged moving image data is stored in the DVD 30, and formats the NAND type flash memory 12 in a form suited to the SD card 40 when imaged still image data is stored in the SD card 40.例文帳に追加
制御部10は、撮像した動画データをDVD30に記憶する場合、NAND型フラッシュメモリ12をDVD30に適合した形式でフォーマットし、撮像した静止画データをSDカード40に記憶する場合、NAND型フラッシュメモリ12をSDカード40に適合した形式でフォーマットする。 - 特許庁
A plurality of memory cells comprising the silicon thin-film 12, floating gate electrode 15, and control gate electrode are connected in series to form a NAND cell.例文帳に追加
シリコン薄膜12、浮遊ゲート電極15、制御ゲート電極17を有するメモリセルが、複数個直列に接続されてNANDセルを形成する。 - 特許庁
To provide a NAND type flash memory which can form distribution of thresholds to also a negative side, while suppressing increase of current and increase of a precharge period.例文帳に追加
電流増加やプリチャージ時間の増加を抑えつつ、負側にも、しきい値の分布を形成することが可能なNAND型フラッシュメモリを提供する。 - 特許庁
To provide a method of manufacturing NAND flash memory device by which, in a process wherein a bonding region of a selective transistor is exposed to form a contact plug, a gate and the contact plug are prevented from short-circuiting.例文帳に追加
NAND型フラッシュメモリの形成において、選択トランジスタの接合領域を露出させ、コンタクトプラグを形成する過程でゲートとコンタクトプラグが短絡することを防止する製造方法を提供する。 - 特許庁
To improve margin of CMP processing to form the STI in a NAND-type flash memory, in which the gate is formed first.例文帳に追加
本発明は、ゲート先作りのNAND型フラッシュメモリにおいて、STIを形成するためのCMP処理のマージンが低下するのを改善できるようにすることを最も主要な特徴とする。 - 特許庁
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「NAND form」の部分一致の例文検索結果
該当件数 : 8件
In an NAND type flash memory 1, respective control electrodes of a first selection transistor 22 of a plurality of memory cell units 20 adjoining in the extending direction of a data line 50 are united to form a first selection signal line 71, and respective control electrodes of a second selection transistor 23 are united to form a second selection signal line 72.例文帳に追加
NAND型フラッシュメモリ1において、データ線50の延在方向に隣接する複数個のメモリセルユニット20の第1の選択トランジスタ22の各々の制御電極を一体化し第1の選択信号線71を構成し、第2の選択トランジスタ23の各々の制御電極を一体化し第2の選択信号線72を構成する。 - 特許庁
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