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加算演算子の英語
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「加算演算子」の部分一致の例文検索結果
該当件数 : 48件
そして、処理部は、積演算子を乗算演算子とし、和演算子を加算演算子とし、識別子間の演算を実行する代数演算部を有する。例文帳に追加
The processing part has an algebra arithmetic part which executes operation between identifiers using the product operator as a multiplication operator and the sum operator as an addition operator. - 特許庁
べき乗 (power) 演算子を除き、演算子には二つのレベル、すなわち乗算的 (multiplicatie) 演算子と加算的 (additie) 演算子しかありません:例文帳に追加
Apart from the power operator, there are only two levels, one for multiplicative operators and one for additiveoperators: - Python
素子は演算論理装置、加算器、レジスタ又はトランジスタであって良い。例文帳に追加
The element can be an arithmetic logical device, adder, register, or transistor. - 特許庁
複数の関数値についての重み付け加算演算を、単純な電子回路で行う。例文帳に追加
To perform a summing operation with weights about a plurality of function values by a simple electronic circuit. - 特許庁
加算演算器４４は、単位素子ＵＣが生成したアナログ信号Ｖを加算し、アナログ出力信号Ｖ_ＯＵＴを生成する。例文帳に追加
An addition computing element 44 adds an analog signal V generated by the unit element UC, and generates an analog output signal V_OUT. - 特許庁
そして、減算器２３０が、加算器２５０の出力と、加算器２５０の出力の量子化値との差分を演算することにより、量子化誤差を求め、フィードバック演算部２４０が、量子化誤差をフィルタリングし、加算器２５０に出力する。例文帳に追加
A subtracter 230 then calculates the difference between the output of the adder 250 and the quantized value of the output of the adder 250 to determine the quantization error, and a feedback computing section 240 filters the quantization error and outputs the result of the filtering to the adder 250. - 特許庁
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「加算演算子」の部分一致の例文検索結果
該当件数 : 48件
使用される対数合計演算子および加算比較選択構造体、それは対数合計演算のヤコビアン定義の近似に基づいている。例文帳に追加
THe logarithmic sum operator used and a sum-comparison selective structure are based on an approximation of Jacobian definition of the logarithmic sum operation. - 特許庁
演算部３１は、画素値INと、フィルタ３５の出力とを加算し、量子化部３２は、演算部３１の出力を量子化し、ΔΣ変調データIDとして出力する。例文帳に追加
An operation part 31 adds a pixel value IN to an output of a filter 35 and a quantization part 32 quantizes an output of the operation part 31 and outputs the quantized result as ΔΣ modulation data ID. - 特許庁
直流電圧振動成分演算手段１５は、直流電圧振動成分ＶDCrを演算し、これを加算器１６のマイナス側入力端子に出力する。例文帳に追加
The means 15 calculates a DC voltage vibration component VDC_4, and outputs the component to a negative input terminal of an adder 16. - 特許庁
なお、加算乗除の各演算子に対して、ＴＦ，ＨＦ，ＫＦ，ＤＦというフラグが設定されており、各フラグは、対応する演算子が計算問題に利用されると０から１に値が変更される。例文帳に追加
Subtraction, multiplication and division operators, flags TF, HF, KF and DF are set respectively, and the value of each flag is changed from 0 to 1 when the corresponding operator is used in the calculation questions. - 特許庁
抵抗Ｒ１とＲ２で、ｓｉｎθとｃｏｓθの信号を加算して、演算回路９の非反転入力端子に供給する。例文帳に追加
The signals of sinθ and cosθ are added together by resistors R1, R2 and supplied to a non-inversion input terminal of an arithmetic circuit 9. - 特許庁
抵抗Ｒ３とＲ４で、−ｓｉｎθと−ｃｏｓθの信号を加算し、演算回路９の反転入力端子に供給する。例文帳に追加
The signals of -sinθ and -cosθ are added together by resistors R3 and R4 and supplied to an inverting input terminal of the arithmetic circuit 9. - 特許庁
演算子が「＋」の場合、Ｓ２３では、演算後に取り得るデータサイズ（＝α）として、互いに加算されるデータのデータサイズ（Ｓ２１にて読み込んだデータサイズ）の内、最大のもののバイト数をαとする。例文帳に追加
When an operator is '+', a data size (α bytes) to be obtained after an arithmetic operation is obtained as the maximum data size among the data size (the data size read in an S21) of data to be mutually added in an S23. - 特許庁
復号化中に変換係数を出力画素情報に非量子化する２次元逆変換において、１計数当たり、すべて１６ビット演算の４つの加算および１つのシフト演算のみで実行する。例文帳に追加
In the two-dimensional inverse transformation of de-quantized transform coefficients into output pixel information during decoding, only four additions plus one shift operation are needed, per coefficient, all in sixteen-bit arithmetic. - 特許庁
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