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Weblio 辞書 > 英和辞典・和英辞典 > 英和対訳 > Wafer Level Chip Scale Packageの意味・解説 

Wafer Level Chip Scale Packageとは 意味・読み方・使い方

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意味・対訳 WLCSPとは、CSP(Chip Size Package)と呼ばれる超小型集積回路の一種で、半導体素子を形成するウェハ(シリコンウェハ)を切り出す前に端子の形成や配線などを行い、それからウェハを切り出すという方法によって形成されたCSPのことである。


Weblio英和対訳辞書での「Wafer Level Chip Scale Package」の意味

Wafer Level Chip Scale Package

Weblio英和対訳辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

「Wafer Level Chip Scale Package」の部分一致の例文検索結果

該当件数 : 17



例文

MANUFACTURING METHOD OF WAFER LEVEL CHIP SCALE PACKAGE例文帳に追加

ウェハーレベルチップスケールパッケージの製造方法 - 特許庁

A wafer level chip scale package includes a semiconductor chip 410 having multiple edge pads.例文帳に追加

複数のエッジパッドが備えられた半導体チップ410を含む。 - 特許庁

WAFER LEVEL CHIP SCALE PACKAGE AND METHOD OF FABRICATING THE SAME例文帳に追加

ウェハレベルチップスケールパッケージおよびそれを製造する方法 - 特許庁

WAFER LEVEL CHIP-SCALE PACKAGE AND METHOD OF MANUFACTURING THE SAME例文帳に追加

ウェハーレベルチップスケールパッケージ及びその製造方法 - 特許庁

Thus, the silicon microphone is configured in a WLCSP (Wafer Level Chip Scale Package) type package form.例文帳に追加

これにより、シリコンマイクロホンは、WLCSP型のパッケージ形態に構成されている。 - 特許庁

METHOD FOR MANUFACTURING WAFER-LEVEL CHIP SCALE PACKAGE USING REDISTRIBUTION LINE SUBSTRATE例文帳に追加

再配線基板を用いたウェーハレベルチップスケールパッケージの製造方法 - 特許庁

例文

WAFER LEVEL CHIP SCALE PACKAGE OF IMAGE SENSOR, AND METHOD OF MANUFACTURING SAME例文帳に追加

イメージセンサのウエハレベルチップスケールパッケージ及びその製造方法 - 特許庁

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「Wafer Level Chip Scale Package」の部分一致の例文検索結果

該当件数 : 17



例文

WAFER LEVEL CHIP SCALE PACKAGE OF IMAGE SENSOR, AND METHOD OF MANUFACTURING THE SAME例文帳に追加

イメージセンサのウエハレベルチップスケールパッケージ及びその製造方法 - 特許庁

As shown in Figure (b), a bare chip 53 is directly packaged on a digital amplifier substrate 55 using a WL-Chip Scale Package (Wafer Level Chip Size Package), and a peripheral circuit component 54 of the bare chip 53 is packaged, and the contact terminal 57 is attached at a speaker connecting terminal.例文帳に追加

図(b)に示すように、ベアチップ53がディジタルアンプ回路基板55の上にWL−CSP(Wafer Level Chip Size Package)によって直接実装され、ベアチップ53の周辺回路部品54が実装され、接触端子57がスピーカ接続端子に取り付けられる。 - 特許庁

To provide a structure which prevents occurrence of cracks in metal patterns when a wafer level chip scale package undergoes a thermal cycling test.例文帳に追加

ウェハレベルチップスケールパッケージの熱サイクリングテストの際、金属パターンへのクラック発生を防止する構造を提供する。 - 特許庁

To provide a solution for solving a yield problem in the manufacturing of a wafer level CSP(Chip Scale Package).例文帳に追加

ウエハレベルCSP(Chip Scale Package)製造における歩留まり問題解決方法を提供する。 - 特許庁

To provide a method for manufacturing a chip scale package with improved reliability at a wafer level.例文帳に追加

信頼性を向上させることができるチップスケールパッケージをウェーハレベルで製造する方法を提供する。 - 特許庁

To provide a method for manufacturing a wafer-level chip scale package that prevents the number of chips per wafer from reducing, by making use of a wafer, having a scribe region the width of which is the same as that of a general wafer.例文帳に追加

一般的なウェーハと同じ幅のスクライブ領域を有するウェーハを利用することによって、ウェーハ当たりチップの個数が減少しないようにするウェーハレベルチップスケールパッケージの製造方法を提供する。 - 特許庁

To provide a semiconductor device capable of fully extracting the features of a wafer-level chip-scale package, enabling lowering of cost, and its manufacturing method, and to provide a semiconductor wafer with a continuously connected semiconductor chip treated in a packaging.例文帳に追加

低コスト化が可能なウェーハレベル・チップスケール・パッケージの特徴を十分に引き出すことのできる半導体装置及びその製造方法、並びにパッケージング処理された半導体チップが連設されている半導体ウェーハを提供すること。 - 特許庁

例文

In this insulation performance testing method of a wafer-level CSP (Chip Scale Package) using a TEG pattern, a spiral TEG pattern is used.例文帳に追加

本発明の第1の態様は、TEGパターンを用いたウエハレベルCSPの絶縁性テスト方法において、渦巻き状のTEGパターンを用いたことを特徴とする。 - 特許庁

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