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chip designerとは 意味・読み方・使い方
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意味・対訳 チップ設計者
「chip designer」の部分一致の例文検索結果
該当件数 : 8件
They include a project manager, software designer, programmer, chip designer, board designer, hardware technicians, and hardware managers.発音を聞く 例文帳に追加
チームメンバーは、プロジェクトマネージャ、ソフトデザイナー、プログラマ、チップ設計者、基板設計者、ハード技術者、ハードマネージャから構成される。 - Electronic Frontier Foundation『DESのクラック:暗号研究と盗聴政策、チップ設計の秘密』
Therefore, the designer can examines suitable positions for arrangement of hierarchical modules and hardware macros on a chip.例文帳に追加
このため、階層モジュール、ハードマクロがチップに配置される適切な位置を検討することができる。 - 特許庁
The chip design data are designed by use of box IP that can be disclosed to the chip designer in hardware IP.例文帳に追加
チップ設計データは、ハードウェアIPにおけるチップ設計者に開示可能なデータであるボックスIPを用いて設計される。 - 特許庁
To prevent a result of data verification by a chip designer from being different from that by a manufacturer.例文帳に追加
チップ設計者によるデータ検証の結果と製造業者によるデータ検証の結果との間に相違が生じるのを防ぐことを目的とする。 - 特許庁
Further, in this device, a designer can adjust a chip selection output time tco, and hence the chip selection output time tco can be shortened and set to be equal to an address access time tAA.例文帳に追加
さらに本発明では、設計者がチップ選択出力時間tcoを調節できるので、チップ選択出力時間tcoをアドレスアクセル時間t_AAと同一に短縮させて設定できる。 - 特許庁
A designer can continues a design work while visually confirming a connection state or the like of a bonding wire between a chip and package substrate and between chips on the subscreen 14b.例文帳に追加
サブ画面14b上の表示から、設計者は、チップとパッケージ基板との間およびチップとチップとの間でのボンディングワイヤの接続状態などを目視により確認しながら、設計作業を継続できるようになる。 - 特許庁
To reduce the load on a designer by efficiently designing a peripheral pattern configuration (the width of a peripheral region), suitable to the kind of a semiconductor chip and to lower the cost by finding the effective number of chips on a wafer and a width with which dicing conditions are most advantageous.例文帳に追加
半導体チップの品種に適した周辺パターン構成(周辺領域の幅)の設計を効率良く行うことで、設計者負担を軽減すると共に、ウェハ上のチップ有効数およびダイシング条件が最も有利な幅を求めてコストダウン化を図る。 - 特許庁
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「chip designer」の部分一致の例文検索結果
該当件数 : 8件
When an IC designer prepares a circuit diagram, respective circuit elements included in this circuit diagram are extracted, each element is converted to a reference integration enable number per unit packaging area of a basic element, a total packaged element number is calculated and the chip size is predicted from the data of layout and reference integration enable number (integration density) stored in a data base 40.例文帳に追加
IC設計者が回路図を作成すると、この回路図に含まれる各回路素子を抽出し、変換テーブル30を用いて、各素子を基本素子の単位実装面積当りの基準集積可能数に換算し、総実装素子数を算出して、データベース40に格納されているレイアウトと基準集積可能数(集積密度)とのデータからチップサイズを予測する。 - 特許庁
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チップ設計者
英和専門語辞典
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Chip Foose
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Chip Kidd
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Dan Sugalski
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chipVault
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Emotiv Systems
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Chen Wen-Chi
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Arthur Max
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9
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