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delta clockとは 意味・読み方・使い方
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意味・対訳 デルタクロック
「delta clock」の部分一致の例文検索結果
該当件数 : 20件
If the adjustment in delta is negative, then the clock is slowed down in a similar fashion.発音を聞く 例文帳に追加
deltaの調整量が負の場合、同様の方法でクロックを遅くする。 - JM
The amount of time by which the clock is to be adjusted is specified in the structure pointed to by delta .発音を聞く 例文帳に追加
調整すべきクロックの時間量はdeltaが指す構造体で指定される。 - JM
A sigma/delta modulator 5 applies sigma/delta modulation to data obtained by adding fractional data M2 and modulation data X with the output signal of the variable frequency divider 2 as a clock.例文帳に追加
シグマデルタ変調器5は、可変分周器2の出力信号をクロックとして、分数部データM2と変調データXとを加算したデータをシグマデルタ変調する。 - 特許庁
A full adder 218 accumulates a signal Delta (substantially Fin/Fover) for every over-sampling clock CKover, and generates a signal SH every time a result of accumulation exceeds "1".例文帳に追加
全加算器218は、オーバーサンプリングクロックCKover毎に、信号Delta(ほぼFin/Fover)を累積し累積結果が「1」を超える毎に信号SHを発生する。 - 特許庁
Consequently, the sigma delta type D/A converter is usable even for uses which were impossible because of the problem of clock jitters.例文帳に追加
これにより、従来クロックジッタが問題となって使用できなかった用途においてもシグマデルタ方式D/A変換器を使用することが可能となる。 - 特許庁
Such a cumulative effect of the change for hRTC values can be acquired as a clock delta variable.例文帳に追加
hRTC値に対するこうした変更の累積的効果は、クロック・デルタ変数として捕捉することができる。 - 特許庁
The frequency of a sampling clock ADC_CLK of a delta sigma AD converter 16 is set to be higher than the frequency of an amplifier clock AMP_CLK of a charge amplifier 14 so as to shorten the data update rate of N-bit digital data AD_OUT output from the delta sigma AD converter 16.例文帳に追加
デルタシグマ型AD変換器16から出力されるNビットのデジタルデータAD_OUTのデータ更新レートを短縮するために、デルタシグマ型AD変換器16のサンプリング・クロックADC_CLKの周波数は、電荷増幅器14のアンプ・クロックAMP_CLKの周波数より高く設定される。 - 特許庁
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「delta clock」の部分一致の例文検索結果
該当件数 : 20件
A primary delta-sigma modulation circuit 1 samples an input voltage VIN under a clock signal ϕ1, performs charge transfer to an electrostatic capacitor Cs under a clock signal ϕ2, and performs voltage integrating operation.例文帳に追加
1次デルタシグマ変調回路1は、クロック信号φ1の時に入力電圧VINをサンプリングし、クロック信号φ2の時に静電容量素子Csに電荷転送を行い、電圧の積分動作を行う。 - 特許庁
To provide the sigma delta type D/A converter of high quality which is suppressed in the adverse effect of a phase shift between a sample clock and a noise shaper clock.例文帳に追加
サンプルクロックとノイズシェーパクロックとの位相のずれによる悪影響を抑えた高品位のシグマデルタ方式D/A変換器を提供する。 - 特許庁
The data converter 10 is provided with a sigma-delta modulator 16, a D/A converter 17, a clock generator 19 connected to the D/A converter 17, and a clock control circuit 18 connected to the clock generator 19.例文帳に追加
データ変換器10は、シグマ−デルタ変調器16と、デジタル−アナログ変換器17と、デジタル−アナログ変換器17に接続されるクロック発生器19と、クロック発生器19に接続されるクロック制御回路18とを備える。 - 特許庁
A bit column to be outputted by every bit from a sigma/delta converter 1 synchronously with an operating clock is held to be delayed several cycles of an operating clock by a shift register 3, and bit data held by the shift register 3 are added to bit data from the sigma/delta converter 1 by an adding part 4, and an output signal SUM is outputted.例文帳に追加
動作クロックに同期してシグマデルタ変換部1から1ビットずつ出力されるビット列をシフトレジスタ3で動作クロックの数周期分遅延して保持し、加算部4がシフトレジスタ3の保持するビットデータとシグマデルタ変換部1からのビットデータを加算して出力信号SUMを出力する。 - 特許庁
To provide a digital receiving and focusing device in an ultrasonic system capable of preventing performance of a sigma-delta analogue-digital converter from degrading even if a sampling clock cycle changes.例文帳に追加
超音波システムのデジタル受信集束装置において、サンプリングクロックの周期が変わってもシグマ−デルタアナログ−デジタル変換器の性能低下を防ぐことができる受信集束装置を提供する。 - 特許庁
To provide a technique for enabling improvement of accuracy with reduced influence of jitter caused by an external clock in an analog-to-digital converter using a continuous delta sigma (ΔΣ) modulator.例文帳に追加
連続型デルタシグマ(△Σ)変調器を利用したアナログデジタル変換器において、外部クロックによるジッタの影響を少なくして精度の向上を図ることができる技術を提供する。 - 特許庁
To provide a delta sigma modulator that easily generates a plurality of clocks required for control of a switch circuit while automatically holding a phase relationship among a plurality of the clocks when a clock frequency is changed.例文帳に追加
デルタシグマ変調器において、スイッチ回路の制御に必要な複数のクロックを容易に作成すると共に、クロックの周波数を変更した場合に、複数のクロックの位相関係を自動的に保持する。 - 特許庁
Depending on an embodiment, while the partition manager is not executed, the change for hRTC is traced and a service processor can be structured so that the clock delta is generated.例文帳に追加
実施形態によっては、当該パーティション・マネージャが実行されていない間、hRTCに対する変更を追跡し、クロック・デルタを生成するように、サービス・プロセッサを構成することができる。 - 特許庁
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