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fixed logicとは 意味・読み方・使い方
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「fixed logic」の部分一致の例文検索結果
該当件数 : 80件
This circuit includes a 1st logic circuit 21, a fixed delay circuit 22, a fixed delay circuit 23, a fixed delay circuit 24, and a 2nd logic circuit 25.例文帳に追加
この発明は、第1の論理回路21、固定遅延回路22、固定遅延回路23、固定遅延回路24、および第2の論理回路25を含む。 - 特許庁
RADIX 8 FIXED-POINT FFT LOGIC CIRCUIT CHARACTERIZED TO HOLD ROUTE i(√i) ARITHMETIC OPERATION例文帳に追加
ルートi(√i)演算の保持を特徴とする基数8固定小数点FFT論理回路 - 特許庁
It is preferable that the output level value to be fixed is a logic level 'L' or 'H'.例文帳に追加
固定される出力レベル値は論理レベルの「L」または「H」が好ましい。 - 特許庁
In the 4-1 modulation, the position of logic '1' on the synchronous pattern of 3 channel bits is fixed.例文帳に追加
4−1変調においては、3チャネルビットの同期パターンの論理「1」の位置が固定である。 - 特許庁
A logic fixing means 5 is connected to each compared result E0-n, activated by the non-redundancy setting signal jdg of the high logic level, and each compared result E0-n is fixed to the prescribed logic level.例文帳に追加
各比較結果E0〜nには論理固定手段5が接続されており、ハイ論理レベルの非冗長設定信号Jdgにより活性化され各比較結果E0〜nを所定論理レベルに固定する。 - 特許庁
Since the power supply to a logic element is fixed, the center potential of the output to the succeeding stage does not vary, but is fixed.例文帳に追加
論理素子の電源が一定であるため、次段への出力のセンター電位は変化せず一定である。 - 特許庁
In a shift operation, a logic circuit 10 and a logic circuit 11 are inserted, in such a way that levels of output signals Q from a flip-flop 4 and a flip-flop 5 to be given to a combinational circuit 8 and a combined circuit 9, whose operation is not required are fixed to logic '0' or '1'.例文帳に追加
シフト動作時において、動作する必要のない組み合わせ回路8、9へ与えられるフリップフロップ4、5からの出力信号Qのレベルを論理「0」又は「1」に固定するように論理回路10、11を挿入する。 - 特許庁
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「fixed logic」の部分一致の例文検索結果
該当件数 : 80件
Since a logic supply voltage Vdd relative to the reference potential V3 lowers the same as the reference potential V3, the logic supply voltage Vdd is fixed from a viewpoint of the reference potential V3.例文帳に追加
基準電位V3に対するロジック電源電圧Vddは、基準電位V3と同じだけ低下していくので、基準電位V3から見たロジック電源電圧Vddは固定される。 - 特許庁
A CPU 10 accesses an internal ROM 50 via the fixed bus control part 34, and reads variable bus control logic information, to be mapped in a programmable variable bus control logic part 35.例文帳に追加
CPU10は、固定バス制御部34を介して内部ROM50にアクセスし、可変バス制御論理情報を読み出して、プログラム可能な可変バス制御論理部35にマッピングする。 - 特許庁
The image sensor chip 2 comprises a sensor unit 21 and a logic circuit unit 22 on one side thereof, and the barrel 12 is provided over and fixed to the logic circuit unit 22.例文帳に追加
また、このイメージセンサチップ2は、その一面にセンサ部21と論理回路部22を備え、鏡筒12は、論理回路部22上に載置され固定されている。 - 特許庁
The clock selection circuit holds the prescribed first logic level for a fixed time from a time at which a supply power source is supplied first and, after that, receives a selection signal CL1 being a second logic level.例文帳に追加
クロック選択回路210は、供給電源が最初に供給された時から一定の時間区間所定の第1ロジックレベルを保持しその後第2ロジックレベルとなる選択信号CL1を受信する。 - 特許庁
To use the complementary logic for control makes it possible for a logic function to generally control current flow of respective current sources while maintaining almost fixed bias voltage on the current source FET.例文帳に追加
制御のために相補型ロジックを使用することは、ほぼ一定のバイアス電圧を電流源FET上に維持する間、一般にロジック機能が個々の電流源の電流の流れを制御するのを可能とする。 - 特許庁
Each signal path includes a common part formed by a body-tied logic gate which provides a fixed part of a general delay and a selected part formed by a floating body logic gate which provides a selected part of the general delay.例文帳に追加
各信号路は、総合遅延の固定部分を与えるボディタイド論理ゲートによって形成された共通部分と総合遅延の選択部分を与えるフローティングボディ論理ゲートによって形成された選択部分を含んでいる。 - 特許庁
The first resistor R1 takes in a data from a logic circuit (L1) at the fixed timing of a clock signal.例文帳に追加
第1レジスタR1は、論理回路(L1)からのデータをクロック信号の所定のタイミングで取り込む。 - 特許庁
To attain a level shift circuit in which a DC voltage level of a logic signal is fixed and conversion is performed at high speed.例文帳に追加
ロジック信号の直流電圧レベルが一定で、高速に変換が行えるレベルシフト回路を実現することを目的にする。 - 特許庁
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