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operand cacheとは 意味・読み方・使い方
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意味・対訳 オペランドキャッシュ
「operand cache」の部分一致の例文検索結果
該当件数 : 12件
OPERAND CACHE FOR VECTOR PROCESSOR例文帳に追加
ベクトル処理装置のオペランドキャッシュ - 特許庁
OPERAND CACHE MEMORY ACCESS SYSTEM AND ITS ACCESS METHOD例文帳に追加
オペランドキャッシュメモリアクセス装置及びそのアクセス方法 - 特許庁
A cache controller 300 stores the address of the operand data into an operand cache 400 with respect to an instruction that locally accesses the operand data and looks ahead the load address of operand data to be next accessed with respect to a load instruction that nonlocally accesses the operand data.例文帳に追加
キャッシュ制御装置300は、局所的にオペランドデータにアクセスする命令については前記オペランドデータのアドレスをオペランドキャッシュ400に格納し、オペランドデータを非局所的にアクセスするロード命令については次回アクセスされるオペランドデータのロードアドレスを先読みする。 - 特許庁
In the case that the dividend and the divisor respectively corresponding to the Y operand and the Z operand are not stored in the cache memory 3, the cache control circuit 2 stores an arithmetic result by the division arithmetic circuit 1 as the quotient in the cache memory 3 corresponding to the dividend and the divisor.例文帳に追加
キャッシュ制御回路2は、Yオペランド及びZオペランドにそれぞれ対応する被除数、除数がキャッシュメモリ3に記憶されていない場合には、除算演算回路1による演算結果を商として、当該被除数、除数と対応付けてキャッシュメモリ3に記憶させる。 - 特許庁
In the software prefetch instruction, an indication bit is provided which can indicate a cache layer transferring operand data or/and the transfer amount of the operand data.例文帳に追加
ソフトウェアプリフェッチ命令の中に、オペランドデータを転送するキャッシュ階層、オペランドデータの転送量、または、その両方を指示することのできる指示ビットが設けられる。 - 特許庁
To solve a problem in which TAT(turnaround time) from execution of address calculation to acquisition of necessary operand data by accessing on an operand cache memory is too long.例文帳に追加
アドレス計算の実行からオペランドキャッシュメモリにアクセスして必要とするオペランドデ−タを得るまでのTATが長いという問題を解決する。 - 特許庁
An address space comparing part 8 detects whether an operand in instruction data in an instruction cache 2 exists in the address space range.例文帳に追加
アドレス空間比較部8は、命令キャッシュ2内の命令データ中のオペランドがアドレス空間範囲に有るかを検出する。 - 特許庁
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「operand cache」の部分一致の例文検索結果
該当件数 : 12件
An area bit to be set as ON when the operand hits is provided in the tag part of the instruction cache.例文帳に追加
命令キャッシュのタグ部にはオペランドがヒットするとON設定されるエリアビットが設けられる。 - 特許庁
In the case that the instruction inputted from the outside indicates the floating point division instruction, a cache control circuit 2 discriminates whether or not the dividend and the divisor respectively corresponding to the Y operand and the Z operand are stored in a cache memory 3, and in the case that they are stored, reads and outputs a quotient stored in the cache memory 3 corresponding to them.例文帳に追加
キャッシュ制御回路2は、外部から入力された命令コードが浮動小数点除算命令を示す場合に、Yオペランド及びZオペランドにそれぞれ対応する被除数、除数がキャッシュメモリ3に記憶されているかどうかを判別し、記憶されている場合には、これらと対応付けてキャッシュメモリ3に記憶されている商を読み出して出力する。 - 特許庁
A memory transfer routine detection circuit 12 inspects the instruction code and operand code of an instruction sequence stored in an instruction buffer 11, then, detects the combination of instructions expressing data transfer processing in a data cache 29.例文帳に追加
メモリ転送ルーチン検出回路12は、命令バッファ11に格納された命令列の命令コード及びオペランドコードを検査することにより、データキャッシュ29内でのデータ転送処理を表す命令の組合せを検出する。 - 特許庁
To provide a method for eliminating the stall of a pipe line by controlling a thread in a step earlier than a conventional manner by operating operand cache mistake/hit prediction prior to the decision of the read destination memory address of the read instruction of a pipe line in a multi-thread processor.例文帳に追加
マルチスレッドプロセッサにおけるパイプラインのリード命令の読み込み先メモリアドレスの決定前にオペランドキャッシュミス/ヒット予想を行う事で従来よりも早い段階でスレッドの制御を行い、パイプラインのストールを解消する為の方法を提供する。 - 特許庁
The instruction analyzing means 1 executes instruction analysis for decomposing the read instruction code into an operation code indicating the kind of the instruction and an operand indicating the register to be operated or memory address of the instruction, and checks whether or not data having the same address as the instruction address are stored in a pseudo data cache storing means 4.例文帳に追加
命令解析手段1は、読み込んだ命令コードを、命令の種類を示すオペコード, 命令の操作対象レジスタやメモリアドレスを示すオペランドに分解する命令解析を実行し、擬似データキャッシュ格納手段4に命令アドレスと同じアドレスを持つデータが格納されていないかチェックする。 - 特許庁
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オペランドキャッシュ
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