| 例文 |
complement representationの部分一致の例文一覧と使い方
該当件数 : 4件
The data deleting circuit transfers two pieces of difference data as 8-bit data at a time when two successive pieces of lateral difference data can be represented with four or less bits in complement representation of "2".例文帳に追加
データ削減回路は、連続する2個の横差分データがそれぞれ「2」の補数表示で4ビット以下で表現できる場合、2個の差分データを8ビット分にして同時に転送する。 - 特許庁
For the purpose of shift and mask operations,a binary representation is assumed, and negative numbers are represented in a variant of 2's complement which gives the illusion of an infinite string of sign bits extending to the left.例文帳に追加
長整数はシフト演算やマスク演算のためにバイナリ表現をもつものと仮定されます。 負の数は符号ビットが左に無限に延びているような錯覚を与える 2 の補数表現の変型で表されます。 - Python
Addition processing of 1st data e1 and 2nd data e2 which are subjected to bias representation obtained by adding a bias value 127 (=27-1) to 8-bit data represented by 2 complement format is performed, and 8-bit addition result data e3 undergoing bias representation is outputted.例文帳に追加
2の補数形式で表現された数値にバイアス値(01111111B)を加えることでバイアス表現された第1及び第2データe1,e2の加算を行う加算装置10は、第2データe2の最上位ビットe2[7] を反転させる反転回路12と、反転回路12の出力{~e2[7],e2[6:0]}と第1データe1とを加算するキャリー入力が1に固定された8ビット加算器14とを備える。 - 特許庁
A selection circuit 14 receives the decision signal JD and selectively outputs either data of a first representation format obtained by adding a decision bit to the dimensional data DX or data of a second representation format obtained by adding the decision bit to complement data/DX generated as inverted data of the dimensional data DX on the basis of the number of changed bits.例文帳に追加
選択回路14は、この判定信号JDを入力し、ビットの変化数に基づいて、次元データDXに判定ビットを付加した第1表現形式のデータ及び次元データDXの反転データとして生成された補数データ/DXに判定ビットを付加した第2表現形式のデータのうち何れか一方を選択出力する。 - 特許庁
| 例文 |
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