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シスインの英語
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英訳・英語 system input stream
「シスイン」を含む例文一覧
該当件数 : 12件
ヒステリシスインバータ回路例文帳に追加
HYSTERESIS INVERTER CIRCUIT - 特許庁
これにより、本発明のヒステリシスインバータ回路に異なる２つの閾値を持たせ、より回路規模が小さく、入力電圧の変動に影響されない高精度なヒステリシスインバータ回路を実現する。例文帳に追加
Thus, two different thresholds are provided to the hysteresis inverter circuit, and the hysteresis inverter circuit, having the smaller circuit scale and with high accuracy which will not be influenced by the fluctuations in the input voltage, is realized. - 特許庁
カスパーゼ活性のアポトーシスインヒビター（ＩＡＰ）タンパク質調節を変える薬剤についてのスクリーニングアッセイ例文帳に追加
SCREENING ASSAY FOR MEDICAMENT REGULATING CASPASE ACTIVITY BASED ON APOPTOSIS INHIBITOR PROTEIN (IAP) - 特許庁
アポトーシスインヒビター（IAP）タンパク質による、細胞死プロテアーゼであるカスパーゼファミリーのメンバーの調節の提供。例文帳に追加
To provide a method for regulating members of caspase family which are cell death proteases based on apoptosis inhibitor (IAP) protein. - 特許庁
路規模が小さく、入力電圧の変動に影響されない高精度のヒステリシスインバータ回路を提供することを目的とするものである。例文帳に追加
To provide a hysteresis inverter circuit with high accuracy, the path scale of which is small and which is not influenced by the fluctuations of the input voltage. - 特許庁
タンパク質ＳＮＡＰ−２５のアミノ末端からの３〜３０の隣接アミノ酸の配列を有し、ニューロンエキソサイトーシスインヒビターとして有用な新しいペプチドを使用。例文帳に追加
This cosmetic composition uses a new peptide useful as a neuronal exocytosis inhibitor having a 3-30 neighboring amino acid sequence from the amino end of protein SNAP-25. - 特許庁
細胞内でのアポトーシスインヒビターの発現により、これが細胞を死滅させないので、細胞またはその増加したフラクションをより長い期間培養物中で維持することが可能である例文帳に追加
Expression of the apoptosis-inhibitor within the cells, because it does not kill the cells, allows the cells or an increased fraction thereof to be maintained in culture for longer periods. - 特許庁
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「シスイン」を含む例文一覧
該当件数 : 12件
(ｂ)上記の外付けコンデンサ(COSC)31を入力端子32から外し、上記のヒステリシスインバータ(INV1)33の入力に外部クロック(CK)36を印加することで外部クロック(CK)36に同期した信号(VOSC)35を得る。例文帳に追加
(b) By removing the external capacitor (COSC) 31 from an input terminal 32 and applying an external clock (CK) 36 to the input of the hysteresis inverter (INV1) 33, the signal (VOSC) 35 synchronous with the external clock (CK) 36 is obtained. - 特許庁
(ａ)ヒステリシスインバータ(INV1)33、抵抗(R1)34および外付けコンデンサ(COSC)31で内部クロックを生成する発振器を構成し、その出力信号(VOSC)35の発振周波数は外付けコンデンサ(COSC)31の値で任意に調整する。例文帳に追加
In a clock synchronization circuit, (a) an oscillator generating an internal clock includes a hysteresis inverter (INV1) 33, a resistor (R1) 34, and an external capacitor (COSC) 31 and the oscillation frequency of an output signal (VOSC) 35 from the oscillator is arbitrarily adjusted by using a value of the external capacitor (COSC) 31. - 特許庁
ヒステリシスインバータ回路Ｑ31が充電器接地電位Ｖ−の電位を監視して、２次電池に充電電流を流す負荷の短絡状態を検知した際に短絡検出信号２４ａを生成して、２次電池に瞬間的に電流が流れないようにする。例文帳に追加
A hysteresis inverter circuit Q31 monitors the potential of the charger ground potential V- and generates a short-circuit detecting signal 24a, when it detects short-circuit conditions of a load that flows a charging current through the secondary battery, so as to prevent current from flowing instantaneously through the secondary battery. - 特許庁
ヒステリシスインバータ回路Ｑ31が充電器接地電位Ｖ−の電位を監視して、２次電池に充電電流を流す負荷の短絡状態を検知した際に短絡検出信号２４ａを生成して、２次電池に瞬間的に電流が流れないようにする。例文帳に追加
A hysteresis inverter circuit Q31 makes the potential of the charger ground potential V- generate a short circuit detection signal 24a, when detecting the short circuit condition of a load allowing a charge current to flow in the secondary battery, so as to prevent the current from instantaneously flowing in the secondary battery. - 特許庁
このテスト用制御回路２０は、定電流２５，２７を追加接続するためのＰチャネルトランジスタ２３，２４と、このＰチャネルトランジスタ２３，２４を、Ｃｏｕｔ端子のハイレベル設定値と、Ｖｓｓ端子より低いレベルのＶ−端子の設定値とに基づきオン制御するための、ヒステリシスインバータ３３とインバータ３４およびＮＡＮＤ素子３５から構成する。例文帳に追加
The test control circuit 20 comprises P channel transistors 23 and 24 for connecting constant currents 25 and 27 additionally, and a hysteresis inverter 33, an inverter 34 and a NAND element 35 performing on control of the P channel transistors 23 and 24 based on a high level set value at Cout terminal and a set value at V-terminal of lower level than the a Vss terminal. - 特許庁
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