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ソース接地回路の英語
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英訳・英語 Common source
「ソース接地回路」の部分一致の例文検索結果
該当件数 : 101件
ゲート接地回路101の出力をソースフォロア回路102の入力にカスケード接続し、ソースフォロア回路102のソース端子には、レベルシフト回路103とソースフォロア負荷抵抗104を接続する。例文帳に追加
Output of a gate ground circuit 101 is cascaded to input of a source follower circuit 102, and a level shift circuit 103 and a source follower load resistor 104 are connected to a source terminal of the source follower circuit 102. - 特許庁
低雑音増幅回路11はNMOSソース接地アンプ1A及びPMOSソース接地アンプ2Aの直列接続により構成される。例文帳に追加
The low-noise amplifying circuit 11 is constituted by connecting an NMOS source-grounded amplifier 1A and a PMOS source-grounded amplifier 2A in series. - 特許庁
論理回路およびメモリ回路の接地ソース電極線を動作時には、接地電位に保ち、選択されない待機時には接地ソース電極線を接地電位より高い電圧に保つ。例文帳に追加
A ground source electrode wire of a logic circuit and a memory circuit is kept at a ground potential at the time of an operation, and the ground source electrode wire is kept at a voltage higher than the ground potential at the time of standby during which it is not selected. - 特許庁
ソース接地型周波数混合回路(ミキサ回路)の線形性を改善する接地端子の割当て方法を提供する。例文帳に追加
To realize a method for assigning ground terminals for improving the linearity of a source ground type frequency mixing circuit(mixer circuit). - 特許庁
電源線6及び接地線4に接続された被制御回路1のソース線5と、前記接地線4との間に、前記ソース線5の電位を制御するソース制御回路2と、前記ソース線5と前記接地線4とを導通、非導通状態へ制御する、前記ソース制御回路2と並列に接続された遮断スイッチ回路3とを有する。例文帳に追加
The structure includes: a source control circuit 2 for controlling a potential of a source line 5, which exists between the source line 5 of a controlled circuit 1 connected between a power line 6 and a ground line 4 and the ground line 4; and a cutoff switch circuit 3 for switching between connection and disconnection of the source line 5 and the ground line 4, which is connected in parallel with the source control circuit 2. - 特許庁
各カラムアンプ部(104)は、ソース接地型アンプ回路を単一段で構成したものである。例文帳に追加
Each column amplifier part (104) is constituted of a source ground type amplifier circuit in single stage. - 特許庁
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「ソース接地回路」の部分一致の例文検索結果
該当件数 : 101件
接地電位パッド2とMOSトランジスタのソースとの間に保護回路を接続する。例文帳に追加
A protective circuit is connected between an earth potential pad 2 and a source of a MOS transistor. - 特許庁
差動単相変換回路1は、ソースフォロア増幅器10とソース接地増幅器20から構成される。例文帳に追加
The conversion circuit 1 for converting a differential signal into a single-phase signal is composed of a source-follower amplifier 10 and a source-grounded amplifier 20. - 特許庁
ソース接地トランジスタM_1、ゲート接地トランジスタM_2、および負荷抵抗R_Lからカスコード接続回路11を構成し、ソース接地トランジスタM_1のドレイン端子とゲート接地トランジスタM_2のソース端子と間に第1のインダクタL_1を設ける。例文帳に追加
A cascode-connected circuit 11 is composed of a source-grounded transistor M_1, a gate-grounded transistor M_2 and a load resistance R_L, and a first inductor L_1 is disposed between a drain terminal of the source-grounded transistor M_1 and a source terminal of the gate-grounded transistor M_2. - 特許庁
さらに、各ソース線に接地電位よりも高く電源電位よりも低いソースバイアス電位を供給する複数のソースバイアス制御回路121が各ソース線に対応して設けられる。例文帳に追加
Moreover, a plurality of source bias control circuits 171 which supply source bias potentials higher than a ground potential and lower than a power source potential to the respective source wires are provided corresponding to the respective source wires. - 特許庁
トランジスタQ7が動作するときには、当該トランジスタQ7による増幅回路がソース接地回路として動作する。例文帳に追加
When a transistor Q7 operates, an amplifier circuit using the transistor Q7 operates as a source-grounded circuit. - 特許庁
分離回路部202により増幅信号経路203と帰還信号経路204が分離され、増幅回路部210は、抵抗負荷のソース接地型のFETと、レベル調整用ダイオード並びにソースフォロワ回路から構成される。例文帳に追加
A separation circuit unit 202 separates an amplified signal path 203 from a feedback signal path 204, and an amplifier circuit unit 210 comprises: a common source FET with a resistance load; level adjustment diodes; and a source follower circuit. - 特許庁
論理回路およびメモリ回路におけるMOSトランジスタのソース電極線を動作時には接地電位に保ち、選択されない待機時には接地ソース電極線を接地電位より高い電圧に保つことによりデータを破壊することなくMOSトランジスタのゲートトンネルリーク電流を低減する。例文帳に追加
Source electrode lines of MOS transistors in logic and memory circuits are kept at a ground potential in an active mode, and ground source electrode lines are kept at a voltage higher than the ground potential in an unselected standby mode, thereby reducing a gate tunnel leakage current of the MOS transistor without destroying data. - 特許庁
入力端子1をソース接地の電界効果トランジスタ6のゲートとゲート接地の電界効果トランジスタ4のソースに共通接続してアクティブバラン回路を構成するとき、ゲート接地のトランジスタ4の次段にゲート接地のトランジスタ5を直列接続する。例文帳に追加
In constituting an active balun circuit by commonly connecting an input terminal 1 to the gate of a source-grounded field effect transistor 6 and the source of a gate-grounded field effect transistor 4, a gate-grounded transistor 5 is connected in series to the next stage of the gate-grounded transistor 4. - 特許庁
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