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ロックレイの英語
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英訳・英語 Lockley
「ロックレイ」を含む例文一覧
該当件数 : 22件
クロック配線、クロックレイアウトシステム及びクロックレイアウト方法例文帳に追加
CLOCK WIRING, CLOCK LAYOUT SYSTEM AND CLOCK LAYOUT METHOD - 特許庁
画像ブロックレイアウト方法、並びに画像ブロックレイアウトシステム例文帳に追加
IMAGE BLOCK LAYOUT METHOD AND IMAGE BLOCK LAYOUT SYSTEM - 特許庁
画像部品ブロックレイアウト装置、画像部品ブロックレイアウト方法、および記録媒体ならびにプログラム例文帳に追加
DEVICE/METHOD FOR LAYOUT OF IMAGE PART BLOCK, RECORDING MEDIUM AND PROGRAM - 特許庁
画像部品ブロックレイアウト装置における索引作成装置、画像部品ブロックレイアウト方法における索引作成方法、および記録媒体例文帳に追加
INDEX GENERATING DEVICE OF IMAGE COMPONENT BLOCK LAYOUT DEVICE, INDEX GENERATING METHOD OF IMAGE COMPONENT BLOCK LAYOUT METHOD, AND RECORDING MEDIUM - 特許庁
ビットプレーンマクロブロックレイヤ復号部103は、記憶部102に記憶された中間データに対して、マクロブロックレイヤで差分復元を行ってビットプレーンデコード結果bを得、このビットプレーンデコード結果bをマクロブロックレイヤ復号部530に出力する。例文帳に追加
A bit plane macro block layer decoder 103 performs, to intermediate data stored in the storage unit 102, differential decoding in a macro block layer to obtain a bit plane decoded result b and then outputs the bit plane decoded result b to a macro block layer decoder 530. - 特許庁
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「ロックレイ」を含む例文一覧
該当件数 : 22件
これによって、11a,11bよりのクロックレイテンシが小さくなり、高速化が可能になる。例文帳に追加
Consequently, clock latency from the clock pulse generators 11a, 11b is reduced and acceleration can be attained. - 特許庁
さらに、シンクロナスメモリ300は、書き込み処理の間にクロックレイテンシを必要としない。例文帳に追加
Further, the memory device 300 does not require any clock latency during a write operation. - 特許庁
ローカルエリアの数が多い場合にも、エレクトロマイグレーションの制約を守りつつ、高集積密度かつ低消費電力でゼロスキューを実現できるクロックレイアウトシステム、及びクロックレイアウト方法を提供する。例文帳に追加
To provide a clock layout system and method capable of achieving zero skew with a high packaging density and low power consumption while complying with restrictions on electromigration even if the number of local areas is large. - 特許庁
バッファ挿入による混雑度を評価したレイアウトが設計でき、F/Fが均等に配置されるクロックレイアウトシステム及びクロックレイアウト方法を提供する。例文帳に追加
To provide a clock layout system and method capable of designing layout while evaluating the level of congestion due to buffer insertion, so that flip-flops are evenly placed. - 特許庁
そして、入出力セル100の配置が決まった後、配置領域103間をビルディングブロックレイアウト方式にてレイアウトする。例文帳に追加
After determining the layout of the input/output cell 100, the layout between layout regions 103 is performed by a building block layout method. - 特許庁
クロックレイテンシを最小にする条件下において、クロックスキュー及びバッファ数を比較的少なくする。例文帳に追加
To make a clock skew and the number of buffers relatively small under a condition for minimization of clock latency. - 特許庁
集積電子回路の出力信号をテストする際の、不確定的に(non-deterministic)発生するクロックレイテンシ(latency)の影響を除去すること。例文帳に追加
To remove an effect of clock latency non-deterministically generated when an output signal of an integrated electronic circuit is tested. - 特許庁
オペレータの編集効率を低下させることなく、また索引作成について冊子に対する該博な知識を必要とすることもなく、さらに、複数の内容が関連した索引をも作成することが可能な、画像部品ブロックレイアウト装置における索引作成装置、画像部品ブロックレイアウト方法における索引作成方法、および記録媒体を提供することを目的とする。例文帳に追加
To provide an index generating device of an image component block layout device, an index generating method of an image component block layout method, and a recording medium which can generate indexes of relative contents without decreasing the editing efficiency of an operator nor requiring a wide knowledge of booklets as to the index generation. - 特許庁
意味 | 例文 (22件) |
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