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Weblio 辞書 > 英和辞典・和英辞典 > 電気・電子用語 > SERIAL PERIPHERAL INTERFACEの意味・解説 

SERIAL PERIPHERAL INTERFACEとは 意味・読み方・使い方

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意味・対訳 シリアル・ペリフェラル・インタフェース、シリアル・ペリフェラル・インタフェース(英: serial peripheral interface、SPI)は、コンピュータ内部で使われるデバイス同士を接続するバスである。


電気・電子用語集での「SERIAL PERIPHERAL INTERFACE」の意味

Serial Peripheral Interface


「SERIAL PERIPHERAL INTERFACE」の部分一致の例文検索結果

該当件数 : 17



例文

FREQUENCY SYNTHESIS CONTROL CIRCUIT WITH SERIAL PERIPHERAL INTERFACE AND ITS OPERATING METHOD例文帳に追加

シリアル周辺インタフェ—ス付き周波数合成制御回路とその動作方法 - 特許庁

The serial peripheral interface circuit performs serial communication between a media access controller and a baseband processor.例文帳に追加

本発明の直列周辺装置インタフェース回路は、メディアアクセスコントローラとベースバンドプロセッサ間の直列通信を実行する。 - 特許庁

Thus, in a wireless LAN environment, high-speed serial communication can be performed by using the serial peripheral interface.例文帳に追加

その結果、無線LAN環境での直列周辺装置インタフェースを利用して高速の直列通信を実行することができる。 - 特許庁

The hub circuit 80 supplies the serial data from the serial interface circuits 10 to 70 to serial interface circuits connected to peripheral circuits at transfer destinations of the parallel data among the serial interface circuits 10 to 70.例文帳に追加

ハブ回路80は、シリアルインタフェース回路10〜70からのシリアルデータを、シリアルインタフェース回路10〜70のうちで前記パラレルデータの転送先の周辺回路に接続されたシリアルインタフェース回路に対して供給する。 - 特許庁

To provide an electronic device that can support either a I2C (Inter-IC) serial interface or an SPI(Serial Peripheral Interface) without the use of an additional interface selection pin and to provide a method for data communication.例文帳に追加

I2C、SPIの2つのインタフェースの何れでも使用でき、かつ余分の選択ピンを必要としないデータ通信の方法及びその電子装置を提供すること。 - 特許庁

An interface circuit 103 is a clock synchronous serial interface circuit provided in a peripheral device 102 of a system for transmitting a serial clock from a CPU 101 to the peripheral device 102 and transmitting and receiving serial data containing address information of the peripheral device 102 and data information by the serial clock.例文帳に追加

インターフェイス回路103は、CPU101から周辺デバイス102へシリアルクロックを送出するとともに、シリアルクロックによって周辺デバイス102のアドレス情報とデータ情報とを含むシリアルデータを送受信するシステムの周辺デバイス102に設けられるクロック同期式シリアルインターフェイス回路である。 - 特許庁

例文

The serial interface circuits 10 to 70 have parallel/ serial converting circuits which convert parallel data from peripheral circuits 19 to 79 into serial data and supply them to the serial transfer lines 10S to 70S and serial/parallel converting circuits which convert serial data from the hub circuit 80 into parallel data and supply them to the peripheral circuits 19 to 79.例文帳に追加

シリアルインタフェース回路10〜70は、周辺回路19〜79からのパラレルデータをシリアルデータに変換してシリアル転送路10S〜70Sに供給するパラレル/シリアル変換回路と、ハブ回路80からのシリアルデータをパラレルデータに変換して周辺回路19〜79に供給するシリアル/パラレル変換回路とを有する。 - 特許庁

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Weblio英和対訳辞書での「SERIAL PERIPHERAL INTERFACE」の意味

Serial Peripheral Interface

シリアル・ペリフェラル・インタフェース

Serial Peripheral Interface

シリアル・ペリフェラル・インタフェース
シリアル・ペリフェラル・インタフェース(: serial peripheral interface、SPI)は、コンピュータ内部で使われるデバイス同士接続するバスである
Weblio英和対訳辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

「SERIAL PERIPHERAL INTERFACE」の部分一致の例文検索結果

該当件数 : 17



例文

The serial peripheral interface circuit is of a hybrid type including a software control method and a hardware automatic control method.例文帳に追加

直列周辺装置インタフェース回路はソフトウェア制御方式とハードウェア自動制御方式を含むハイブリット型で構成される。 - 特許庁

To provide a hybrid serial peripheral interface circuit suitable for high speed wireless communication, and its method for data processing.例文帳に追加

高速の無線通信に適するハイブリット型直列周辺装置インタフェース回路及びそのデータ処理方法を提供する。 - 特許庁

The peripheral device interface 311 outputs the address signal specifying the address of the corresponding register of peripheral device, when the predetermined region of the region corresponding to peripheral device is accessed through the high-speed serial interface 304 from an external host controller.例文帳に追加

周辺デバイスインタフェース311は、外部のホストコントローラから高速シリアルインタフェース304を介して周辺デバイス対応領域の所定の領域がアクセスされると、対応する周辺デバイスのレジスタのアドレスを指定するアドレス信号を出力する。 - 特許庁

To interface data reception from an IEEE 1394 serial bus with a peripheral unit in a host system, without the need for a separate microcontroller.例文帳に追加

IEEE1394シリアル・バスからのデータ受信において、別個のマイクロコントローラを必要とせずにホスト・システム内の周辺装置にインタフェースすること。 - 特許庁

A frequency synthesis control function is incorporated in a frequency synthesizer with a serial peripheral interface 38 to activate the frequency synthesizer just before and in the midst of reception of the message reception window.例文帳に追加

周波数合成制御機能が、シリアル周辺インタフェース38とともに周波数合成器に組み込まれて、メッセージ受信窓の直前および最中に周波数合成器をアクティブにする。 - 特許庁

The network data bridge 202 includes a broadband network interface 210 connectable to an Internet protocol network, a radio command interface 204 connectable to a radio command protocol network, and a data bridge component 202 which extracts a serial command received via the broadband network interface 210 from an Internet protocol, and broadcasts the serial command via a narrowband radio interface so as to be received by the mobile robot 104 and the peripheral.例文帳に追加

ネットワークデータブリッジ202は、インターネットプロトコルネットワークに接続可能な広帯域ネットワークインターフェイス210と、無線コマンドプロトコルネットワークに接続可能な無線コマンドインターフェイス204と、該インターネットプロトコルから該広帯域ネットワークインターフェイス210を介して受信されるシリアルコマンドを抽出し、移動式ロボット104および周辺装置に受信されるように、狭帯域無線インターフェイスを介して該シリアルコマンドをブロードキャストするデータブリッジ構成要素202と、を備える。 - 特許庁

To provide a method for automatically recognizing serial memory size capable of dealing with even serial memories based on SPI (serial peripheral interface) where no response bit is imparted to output data, by imparting a fixed bit string for preliminary writing to perform a preliminary writing process, performing first and second reading processes, and determining memory size based on the order of the first and second data read.例文帳に追加

本発明はシリアルメモリサイズ自動認識方法において、事前書き込み用定型ビット列を与えて事前書き込み処理を行い、第1、第2の読み出し処理を行い、前記第1、第2の読み出したデータの組順に基づきメモリサイズを判定するようにしたので、出力データに応答ビットが付与されないSPI準拠のシリアルメモリにも対応可能なシリアルメモリサイズ自動認識方法を提供するのに著効を奏す。 - 特許庁

例文

In the storage system 1, a server 2 and an external input and output port 10 of a semiconductor storage unit 4 are connected with a system bus 2c such as a peripheral bus, memory bus, internal bus, etc., which connects CPU 2a, memory 2b, etc., extending outside as a high speed serial interface 3 which does not convert protocol.例文帳に追加

このストレージシステム1は、サーバ2と半導体ストレージ装置4の外部入出力ポート10とを、サーバ2内のCPU2a,メモリ2b等を接続する周辺バス,メモリバス,内部バス等のシステムバス2cを外部に延長してプロトコル変換を行わない高速のシリアルインタフェース3として接続したものである。 - 特許庁

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