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address interleavingとは 意味・読み方・使い方
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「address interleaving」の部分一致の例文検索結果
該当件数 : 20件
INTERLEAVING ADDRESS GENERATOR AND INTERLEAVING ADDRESS GENERATION METHOD例文帳に追加
インターリーブアドレス発生器及びインターリーブアドレス発生方法 - 特許庁
ADDRESS GENERATION CIRCUIT AND INTERLEAVING CIRCUIT例文帳に追加
アドレス生成回路およびインタリーブ回路 - 特許庁
EFFICIENT MEMORY ADDRESS DESIGNATION SYSTEM FOR CONVOLUTIONAL INTERLEAVING例文帳に追加
たたみこみインタ—リ—ビング用の効率的メモリアドレス指定方式 - 特許庁
ADDRESS DATA GENERATION CIRCUIT AND METHOD FOR MULTISTAGE INTERLEAVING例文帳に追加
マルチステージインタリーブのアドレスデータ生成回路及びアドレスデータ生成方法 - 特許庁
An interleaving part 102 comprises a dual-port memory 210 and an address generator 220 which generates a write address 221 and a read address 222 to the dual-port memory 210.例文帳に追加
インターリーブ部102は、デュアルポートメモリ210と、デュアルポートメモリ210に対する書込みアドレス221及び読出しアドレス222を発生するアドレス発生器220とを備える。 - 特許庁
A memory controller 10 includes an interleaving access means 7a and a non-interleaving access means 7b, and includes further a storage management means 13 for converting an address in a page unit, and the storage management means 13 conducts the switching between the interleaving access and the non-interleaving access.例文帳に追加
インターリーブアクセス手段7aと非インターリーブアクセス手段7bを備えたメモリコントローラ10であって、ページ単位でアドレスを変換する記憶管理手段13をさらに有し、前記記憶管理手段13は、ページ毎にインターリーブアクセスと、非インターリーブアクセスを切り替える、ことを特徴とする。 - 特許庁
To provide an address generation circuit and an interleaving circuit that are simplified circuits while using only a minimum required memory area.例文帳に追加
必要最小限のメモリ領域のみを使用しながらも回路を単純にできるアドレス生成回路およびインタリーブ回路を提供する。 - 特許庁
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「address interleaving」の部分一致の例文検索結果
該当件数 : 20件
To provide a data storage system and method for mapping a bus address to a memory unit address in order to generate a data value related to continuous bus addresses and check sum value storage by using an interleaving system.例文帳に追加
連続的なバスアドレスに関連するデータ値およびチェックサム値記憶がインタリーブ方式で発生するように、バスアドレスをメモリユニットアドレスにマップするデータ記憶システムおよび方法を提供する。 - 特許庁
To generate a read/write address to a memory so that a continuous interleaving processing on data of a plurality of blocks is realized with one memory.例文帳に追加
複数ブロックのデータに対する連続したインターリーブ処理を1つのメモリで実施可能な様にメモリへのリード/ライト用のアドレスを発生させる。 - 特許庁
To provide an interleaving apparatus and method for generating an address while using one algorithm with respect to various sizes of an interleaver in a communication system.例文帳に追加
通信システムで多様なインターリーバのサイズに対してアドレスを一つのアルゴリズムを用いて生成するインターリビング装置及び方法を提供する。 - 特許庁
To provide an interleaving device and a method that prepare an address as compared with the size of various interleavers with the use of one algorithm in a communication system.例文帳に追加
通信システムで多様なインターリーバのサイズに対してアドレスを一つのアルゴリズムを用いて生成するインターリビング装置及び方法を提供する。 - 特許庁
Respective stages including a final stage, an intermediate stage, and a 1st stage each equipped with a holding circuit which holds an interleaving pattern as a minimum unit and arithmetic circuits for multiple stages find interleaving patterns sequentially in steps to find the address data of an interleaving pattern corresponding to desirable data to be addressed finally.例文帳に追加
最終ステージ,中間ステージ及び第1ステージを含む複数の各ステージがそれぞれ最小単位のインタリーブパターンを保持する保持回路を備え,段階的に順次インタリーブパターンを求めて最終的にアドレッシングしたいデータに対応したインタリーブパターンのアドレスデータを求める複数ステージの演算回路を備える。 - 特許庁
In order to arrange the transmission data in the final transmission order after interleaving and store them in the storage part, an interleaver 1-5 for generating the write address of the storage part 1-6 is made to activate the operation of generating the address, and the transmission data are stored in the address.例文帳に追加
また、インタリーブ後の最終的な送信順に送信データを並べて記憶部に格納するよう、記憶部1−6の書き込みアドレスを生成するインタリーバ1−5に対して、該アドレスの生成の動作を活性化させ、該アドレスに送信データを格納する。 - 特許庁
The interleaving section further makes each element of the output interleaver matrix correspond to an output address used for outputting the data, and replaces the order of the output of the transmission data by outputting the transmission data according to the output address.例文帳に追加
さらに、インターリーブ部は、出力インターリーバ行列の各要素を、データの出力に用いられる出力アドレスに対応付け、この出力アドレスに従って送信データを出力することにより、その順序の入れ替えを行う。 - 特許庁
To reduce the circuit scale and to downsize a device by reducing the memory capacity in an address data generation circuit for multistage interleaving.例文帳に追加
本発明はマルチステージインタリーブのアドレス生成回路及びアドレス生成方法に関し,メモリ容量を削減することにより回路規模を縮小し,装置を小型化することを目的とする。 - 特許庁
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