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意味・対訳 クロック同期
「clock synchronizer」の部分一致の例文検索結果
該当件数 : 18件
clock synchronizer発音を聞く 例文帳に追加
クロック同期装置 - Weblio英語基本例文集
CLOCK SYNCHRONIZER例文帳に追加
クロック同期装置 - 特許庁
PHASE DETECTOR, PHASE COMPARATOR AND CLOCK SYNCHRONIZER例文帳に追加
位相検出装置、位相比較装置およびクロック同期装置 - 特許庁
To obtain a clock synchronizer not only synchronizing the frequencies of an auto-reference clock signal and an external clock signal but also nullifying the phase difference without adjusting the phase.例文帳に追加
自己基準クロック信号を外部クロック信号に対し、周波数同期させるだけでなく、位相調整なしで位相差をゼロにするクロック同期装置を得る。 - 特許庁
When a DCS clock which is a clock synchronization reference is supplied to a clock synchronizer 10 through a cable, a clock extract section 12 generates an extracted clock by extracting the leading or trailing pulse edge of the DCS clock.例文帳に追加
クロック同期装置10に対してクロックの同期基準となるDCSクロックがケーブルを介して供給されると、クロック抽出部12でDCSクロックの立ち上がり又は立ち下がり部分のパルスエッジを抽出した抽出クロックを生成する。 - 特許庁
To provide an audio synchronizer for a digital television broadcast without using a VCXO (Voltage Controlled Crystal Oscillator) and a high frequency clock.例文帳に追加
VCXO及び高周波数のクロックを使わずにデジタルテレビ放送の音声同期装置を提供すること。 - 特許庁
The synchronizer includes a second set of flip-flops (204B, 204D) for receiving data from the first system based on the second clock.例文帳に追加
同期装置は、第2のクロックに基づいて第1のシステムからデータを受信するフリップフロップの第2の集合(204B, 204D)を含む。 - 特許庁
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「clock synchronizer」の部分一致の例文検索結果
該当件数 : 18件
When the asynchronous reset signal output from the synchronizer 10 is input to a clock enable terminal, and the clock input signal "clk" is input to the clock input terminal, a gating cell 20 outputs a clock signal "clock" to the object logic circuit 100.例文帳に追加
ゲーティングセル20は、クロックイネーブル端子に、シンクロナイザ10から出力された非同期リセット信号が入力され、クロック入力端子に、クロック入力信号clkが入力されると、対象論理回路100にクロック信号clockを出力する。 - 特許庁
To provide a time synchronizer maintaining accuracy of an internal clock by selecting a time information server for synchronizing depending on a time difference between the internal clock and the time information server.例文帳に追加
内部時計と時刻情報サーバの時刻差に応じて同期を取る時刻情報サーバを選択することによって内部時計の正確度が維持される時刻同期装置を提供する。 - 特許庁
To reduce the arithmetic processing time for correcting the clock frequency deviation between a transmitter and receiver and the phase deviation due to the frequency error remaining in a synchronizer.例文帳に追加
送受信機間でのクロック周波数ずれと、同期部で残留した周波数誤差に起因する位相ずれと、に対する補正演算処理時間を短縮する。 - 特許庁
This device is provided with a synchronizer 10 for synchronizing a low speed clock with a high speed clock area, a transition detector 20 for detecting the transition of the state of a signal outputted from the synchronizer, and a signal generator 30 for preparing an extended pulse signal according to the transition signal detected by the transition detector.例文帳に追加
低速クロックを高速クロック領域に同期させるための同期器(10)と、該同期器から出力される信号の状態の遷移を検出するための遷移検出器(20)と、遷移検出器で検出した遷移信号に応じて伸張パルス信号を作る信号発生器(30)とを使用する。 - 特許庁
The receiver unit includes a frequency synchronizer 300 for synchronizing the transmission and the reception of the optical pulse, based on both a clock signal to be transmitted to the sender unit and a clock signal returned by loopback at the sender unit.例文帳に追加
受信者ユニットは、送信者ユニットへ送出するクロック信号と送信者ユニットで折り返して戻ってきたクロック信号の両方に基づいて光パルスの送受信の同期をとる周波数同期部を有する。 - 特許庁
When switching between them is carried out, an interlocked synchronizer that is included in the multiplexer 100 is used, also a selection signal 108 from a control register 130 is responded to, and an output clock signal 102 is transferred from a first clock source to a second clock source cleanly like 'no glitch'.例文帳に追加
これらの間を切り替える際、マルチプレクサ100が含むインタロックド・シクロナイザを使用してかつ制御レジスタ130からの選択信号108に応答して、出力クロック信号102を第1のクロック源から第2のクロック源へクリーンに「無グリッチ」であるように遷移させる。 - 特許庁
The slave synchronizer 20 multiplexes a frame pattern signal on a received network synchronization clock signal and performs code rule conversion before transmitting a signal to the line data receiver 3 in the electronic exchange 2.例文帳に追加
従属同期装置20は、受信した網同期用クロック信号にフレームパターン信号を多重化し、符号則変換して電子交換機2内の回線データ受信装置3へ送信する。 - 特許庁
The synchronization circuit comprises a redundantly coding part for converting a multi-bit input data, which is synchronized with a first clock, to a redundant code in which the Hamming distance becomes 1; a redundant code synchronizer for synchronizing the redundant code with a second clock; and a decoder for decoding the redundant code synchronized with the second clock into the multi-bit data.例文帳に追加
同期化回路は、第1クロックに同期化された多ビットの入力データを、ハミング距離が1となる冗長符号に変換する冗長符号化部と、前記冗長符号を第2クロックで同期化する冗長符号同期化部と、前記第2クロックで同期化された冗長符号を、前記多ビットのデータに復号する復号化部とを備える。 - 特許庁
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