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音節clk.

研究社 新英和中辞典での「clk」の意味

clk.

音節clk.
略語clerk; clock.


「clk」を含む例文一覧

該当件数 : 1077



例文

The audio clock CLK_Arg is obtained by re-generating the master clock CLK_M.例文帳に追加

オーディオクロックCLK_Argは、マスタークロックCLK_Mを再生成して得られるものとなる。 - 特許庁

A low speed basic clock CLK (CLK=10 MHz) is used in the single shot mode and a high speed basic clock CLK (CLK=20 MHz) is used in the consecutive shot mode.例文帳に追加

単写モードにおいては低速の基本クロックCLKCLK=10MHz)が使用され、また連写モードでは高速の基本クロックCLKCLK=20MHz)が使用される。 - 特許庁

An inverter INV receives a drive pulse signal CLK to output a signal CLKB.例文帳に追加

インバータINVは駆動パルス信号CLKを入力し、信号CLKBを出力する。 - 特許庁

The frequency of the clock B-CLK is multiplied to eight times as high as 13.5 MHz.例文帳に追加

ビットクロックB-CLKの周波数は、13.5MHzの8倍に逓倍されている。 - 特許庁

A variable frequency division circuit 102 inputs a clock signal Clk_b having the opposite phase to the clock signal Clk_a, and outputs a signal Do2 that is a frequency division of the clock signal Clk_b by a factor of P or P+1.例文帳に追加

可変分周回路102は、クロック信号Clk_aと逆相になるクロック信号Clk_bを入力し、クロック信号Clk_bに対するPまたはP+1の分周した信号Do2を出力する。 - 特許庁

The normal CLK is read in accordance with the rise of the normal CLK, and the inverted data are read in accordance with the rise of inverted CLK.例文帳に追加

そして、通常CLKの立ち上がりに合わせて通常CLKを読み出し、反転CLKの立ち上がりに合わせて反転データを読み出す。 - 特許庁

例文

A CLK generating section 17 generates a CLK on the basis of the signal received from the amplifier and thereafter transmits the CLK signal to the identification recovery section.例文帳に追加

CLK生成部17では増幅部から送出された信号を基にCLKを生成した後、識別再生部にCLK信号を送出する。 - 特許庁

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コンピューター用語辞典での「clk」の意味

遺伝子名称シソーラスでの「clk」の意味

Clk

fly遺伝子名Clk
同義語(エイリアス)Protein clock-6; dperiod; Per; PER; Period circadian protein; dper; PERIOD; EG:155E2.4; period clock protein; dPER; period; clock-6; per; clk-6: clock-6; CG2647; CLK-6; Clock
SWISS-PROTのIDSWISS-PROT:P07663
EntrezGeneのIDEntrezGene:31251
その他のDBのIDFlyBase:FBgn0003068
fly遺伝子名Clk
同義語(エイリアス)dCLOCK; CLOCK; dCLK/JRK; dClck; Jrk; dclock; jrk; PAS1; clk; Clock; clock; dPAS1; dClk; Jerk; dCLK; Circadian locomoter output cycles protein kaput; dClock; CG7391
SWISS-PROTのIDSWISS-PROT:O61735
EntrezGeneのIDEntrezGene:38872
その他のDBのIDFlyBase:FBgn0023076
human遺伝子名CLK
同義語(エイリアス)Dual specificity protein kinase CLK1; STY; CLK1; CLK/STY; CDC-like kinase 1
SWISS-PROTのIDSWISS-PROT:P49759
EntrezGeneのIDEntrezGene:1195
その他のDBのIDHGNC:2068
mouse遺伝子名Clk
同義語(エイリアス)Clk1; Dual specificity protein kinase CLK1; STY; Sty; CDC-like kinase 1; Protein kinase STY
SWISS-PROTのIDSWISS-PROT:P22518
EntrezGeneのIDEntrezGene:12747
その他のDBのIDMGI:107403

本文中に表示されているデータベースの説明

SWISS-PROT
スイスバイオインフォマティクス研究所欧州バイオインフォマティクス研究所によって開発運営されているタンパク質アミノ酸配列データベース
EntrezGene
NCBIによって運営されている遺伝子データベース染色体上の位置配列発現構造機能、ホモロジーデータなどが含まれている
FlyBase
米英大学のショウジョウバエ研究者などにより運営されるショウジョウバエ生態遺伝子情報に関するデータベース
HGNC
HUGO遺伝子命名法委員会により運営されるヒト遺伝子に関するデータベース
MGI
様々なプロジェクトによる研究マウス遺伝的生物学的なデータを提供するデータベース

Wiktionary英語版での「clk」の意味

CLK

出典:『Wiktionary』 (2013/11/11 16:59 UTC 版)

派生語

「clk」を含む例文一覧

該当件数 : 1077



例文

A DLL circuit 100 generates internal clocks CLK_-PF, CLK_-NF delayed by proper quantity, further, and generates internal clocks CLK_-FF, CLK_-SF which can drive the data output circuit after CAS latency from the inter clocks CLK_-PF, CLK_-NF based on an internal signal NZPCNT.例文帳に追加

DLL回路100は、外部クロックを適当量遅延した内部クロックCLK_PF,CLK_NFを生成し、さらに、内部信号NZPCNTに基づいて、データ出力回路をCASレイテンシ後に駆動できる内部クロックCLK_FF,CLK_SFを内部クロックCLK_PF,CLK_NFから生成する。 - 特許庁

Further, the encryption apparatus inhibits encryption of the other data, that is, data ADF, DID, DBN, DC, CLK, ECC, CS.例文帳に追加

また、暗号化装置は、それ以外のデータ、即ち、ADF,DID,DBN,DC,CLK,ECC,CSの暗号化を禁止する。 - 特許庁

Inverters INV1-INV4 receive the drive pulse signal CLK to output signals ND1-ND4, respectively.例文帳に追加

インバータINV1〜INV4は、駆動パルス信号CLKを入力し、それぞれ信号ND1、ND2、ND4およびND4を出力する。 - 特許庁

A reference clock CLK (first clock CLK) is delayed by 1/4 cycle to form a second clock CLK2.例文帳に追加

基準CLK(第1クロックCLK)を1/4周期遅延させ第2クロックCLK2を生成する。 - 特許庁

To securely fetch a serial data sin which is asynchronous with a clock clk, so as to convert into a parallel data dat[0]-dat[N-1].例文帳に追加

クロックclkとは非同期のシリアルデータsinを確実に取り込んでパラレルデータdat[0]〜dat[N-1]に変換する。 - 特許庁

Further, the data transmitting apparatus 1 embeds information of a clock signal clk in the serial data to be output.例文帳に追加

さらに、データ送信装置1は、出力するシリアルデータにクロック信号clkの情報を埋め込む。 - 特許庁

Since the CLK is an output of the synchronizing circuit 26, a phase error between the CLK and the iCLK can be kept within the permissible error.例文帳に追加

CLKは同期回路26の出力なので、iCLKとの位相誤差を許容誤差内にできる。 - 特許庁

例文

In this data generating apparatus, a memory 54 supplies parallel data according to a frequency division clock D_CLK.例文帳に追加

メモリ54は、分周クロックD_CLKに従って並列データを供給する。 - 特許庁

>>例文の一覧を見る



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