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master clocksとは 意味・読み方・使い方
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「master clocks」の部分一致の例文検索結果
該当件数 : 27件
In addition, the Rokoku Hakase (clock master) managed the water clocks and announced the time.発音を聞く 例文帳に追加
また、漏刻博士は時計（漏刻）を管理して時報を行う。 - Wikipedia日英京都関連文書対訳コーパス
To provide a remote supervision and control system provided with a means for modifying internal clocks of a plurality of slave station devices which are connected by a communication line network in which a data residence time sequentially changes, have the internal clocks and are scattered with reference to a master station master clock and synchronizing the internal clocks of the slave station devices.例文帳に追加
データ滞留時間が逐次変化する通信回線網により接続され内部時計を持ち散在する複数の子局装置の内部時計を親局マスタ時計を参照して修正し、子局装置の内部時計を同期させる手段を備えた遠隔監視制御システムを提供する。 - 特許庁
Respective output clocks DQSOUT of Slave DLLs (200-1 to 200-n) are fed back and inputted to a Master DLL (100), and phase comparisons (PD) with an output clock signal CLK0 of the Master DLL (100) are made on a time-division basis to detect phase errors.例文帳に追加
Slave DLL(200-1〜200-n)の各出力クロック信号DQSOUTはフィードバックされて、Master DLL(100)に入力され、時分割でMaster DLL(100)の出力クロック信号CLK0と位相比較(PD)されて位相誤差が検出される。 - 特許庁
A master LSI 10 and a slave LSI 120 generate operation clocks synchronized with the same synchronization clock, the operation clocks are counted by operation counters 15, 25, to generate respectively the first word clock and the second word clock.例文帳に追加
マスタＬＳＩ１０とスレーブＬＳＩ２０は、同じ同期クロックに同期した動作クロックを生成し、その動作クロックを動作カウンタ１５，２５でカウントして第１ワードクロックと第２ワードクロックをそれぞれ生成する。 - 特許庁
To provide a semiconductor device capable of controlling supply of clocks to a processor by a clock unit in a bus master period.例文帳に追加
バスマスタ期間において、プロセッサへのクロックの供給をクロック単位で制御可能な半導体装置を提供する。 - 特許庁
A parallel A/D converter in a sample-hold section of a converter circuit generates two complementary clocks Q and/Q from are master clock, and then uses the original master clock after that and the two clocks are gated at random to reduce delay mismatching of the circuit.例文帳に追加
変換器回路のサンプルホールド部分において、並列Ａ／Ｄ変換器が１つのマスタ・クロックから２つの相補的なクロックＱ及びＱ（バー）を発生し、その後でもとのマスタ・クロックを用いて、これらの２つのクロックをランダムにゲートすることで、回路の遅延不整合を減らす。 - 特許庁
The method and system further includes, in response to a trigger signal; determining an individual offset between the master clock of the master terminal and each of the clocks of the slave terminals; and offsetting each of the clocks of the slave terminals by an amount proportional to each determined offset to synchronize each of the slave terminals to the master clock of the master terminal.例文帳に追加
方法およびシステムは、トリガー信号に応答して、マスター端末のマスター・クロックとスレーブ端末のそれぞれのクロックの間の各オフセットを確定し、スレーブ端末のそれぞれのクロックをマスター端末のマスター・クロックに同期化するように、確定された各オフセットに比例する量だけ、スレーブ端末のそれぞれのクロックをオフセットさせることをさらに含む。 - 特許庁
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「master clocks」の部分一致の例文検索結果
該当件数 : 27件
To appropriately deal with out-of-synchronism in which clocks are not synchronized between a master node and a slave node, in a clock synchronization system for synchronizing the clock of the slave node with the clock of the master node.例文帳に追加
スレーブノードのクロックをマスタノードのクロックに同期させるクロック同期システムにおいて、マスタ／スレーブ間のクロックが同期していない場合の同期のズレに適切に対処する。 - 特許庁
An inter-master-slave switch 3 selects whether to output the high-impedance (Hi-Z) signal or to output the data signal output from the master flip-flop section 1 in response to the second control clocks N1 and N2.例文帳に追加
マスタ−スレーブ間スイッチ３は、第２制御クロックＮ１、Ｎ２に応じて、ハイインピーダンス信号（Ｈｉ−Ｚ）を出力するか、マスタフリップフロップ部１から出力されたデータ信号を出力するかの選択をする。 - 特許庁
For the horizontal transfer pulses ϕH generated by dividing the frequency of a master clock MCLK by (m), (n) system clocks SCLK1 to SCLKn generated by dividing the frequency of the master clock by (n) ((n) is an even natural number) are outputted delaying the phase by one cycle of the master clock.例文帳に追加
マスタークロックＭＣＬＫをｍ分周した水平転送パルスφＨに対して、マスタークロックをｎ（ｎは自然数かつ偶数）分周したｎ個のシステムクロックＳＣＬＫ１〜ＳＣＬＫｎを、各位相をマスタークロックの１周期ずつ遅延させて出力する。 - 特許庁
The selector 42 selects a system clock of a signal to be used as a master signal among the plurality of supplied system clocks and supplies the system clock to a synchronizing signal generator 45 through a comparator 43 and a VCO 44.例文帳に追加
セレクタ４２は、供給された複数のシステムクロックのうち、マスタとされている信号のシステムクロックを選択し、そのシステムクロックを、比較器４３とＶＣＯ４４を介して同期信号発生部４５に供給する。 - 特許庁
The scan flip flop has an inspection input terminal TI and an output terminal Q connected longitudinally together, and the inspection data are transferred synchronous with two-phase clocks of master and slave.例文帳に追加
スキャンフリップフロップは検査入力端子ＴＩと出力端子Ｑとが互いに縦続接続されており、検査データはマスターとスレーブの２相クロックに同期して転送される。 - 特許庁
The comparator 130 compares input two master clocks (MCKa and MCKb), and when there is a difference (phase difference), outputs a signal to the effect to the SOC 110.例文帳に追加
コンパレーター１３０は、入力された２つのマスタークロック（ＭＣＫａおよびＭＣＫｂ）を比較し、差分（位相差）がある場合に、その旨を示す信号をＳＯＣ１１０に出力する。 - 特許庁
A master flip-flop section 2 selects whether to output the data signal from the input buffer section 1 or to retain the data signal being output in response to second control clocks N1 and N2.例文帳に追加
マスタフリップフロップ部２は、第２制御クロックＮ１、Ｎ２に応じて入力バッファ部１からのデータ信号を出力するか、出力中のデータ信号を保持するかを選択する。 - 特許庁
A slave flip-flop section 4 selects whether to retain the data signal being output or to output the data signal from the inter-master-slave switch 3 in response to the second control clocks N1 and N2.例文帳に追加
スレーブフリップフロップ部４は、第２制御クロックＮ１、Ｎ２に応じて出力中のデータ信号を保持するか、マスタ−スレーブ間スイッチ３からのデータ信号を出力するかを選択する。 - 特許庁
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