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parasitic factorとは 意味・読み方・使い方
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意味・対訳 寄生要素
「parasitic factor」の部分一致の例文検索結果
該当件数 : 14件
To provide a semiconductor device in which an element with a reduced parasitic capacity is as a constituting factor, and which includes a circuit having a short build up time.例文帳に追加
寄生容量が低減された素子を構成要素とし、かつ、立ち上がり時間が短い回路を含む半導体装置を提供する。 - 特許庁
To provide an electromechanical transducer device satisfying both reduction in parasitic capacitance between electromechanical transducer elements and improvement in a fill factor.例文帳に追加
電気機械変換部間の寄生容量の低減とフィルファクターの向上を両立することができる電気機械変換装置を提供する。 - 特許庁
To provide a solid-state imaging apparatus capable of preventing an amplification factor of an amplifier from being reduced due to effects of parasitic capacitance.例文帳に追加
寄生容量の影響による増幅器の増幅率の低下を防止することができる固体撮像装置を提供することを課題とする。 - 特許庁
To solve the problem that an insulating film covering a region from a gate electrode to a source and a drain is a factor of increased parasitic capacitance.例文帳に追加
ゲート電極からソース及びドレインまでの領域を覆う絶縁膜が、寄生容量増大の要因になっている。 - 特許庁
To provide a power conversion transformer which is structurally easy to produce and has high conductor occupation factor inside a bobbin and small parasitic capacitance.例文帳に追加
構造的に製作が容易であって、ボビン内の導体占有率が高く、且つ寄生容量が小さい電力変換トランスを提供する。 - 特許庁
To provide a semiconductor device as well as its layout method where the performance (amplification factor) of a parasitic element is halved than before by optimizing the layout method for a guard ring.例文帳に追加
ラッチアップ防止用ガードリンングのレイアウトを最適化した半導体装置とそのレイアウト方法を提供する。 - 特許庁
To provide a cross-talk verification device and cross verification method for accurately searching a parasitic capacity being the factor of cross-talk, and for error-displaying a layout part where the parasitic capacity is generated at the time of operating the layout of a semiconductor integrated circuit.例文帳に追加
半導体集積回路のレイアウト時に、クロストークの原因となる寄生容量を的確に探し出し、その寄生容量が発生したレイアウト箇所をエラー表示することができるクロストーク検証装置およびクロストーク検証方法を提供する。 - 特許庁
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「parasitic factor」の部分一致の例文検索結果
該当件数 : 14件
In the circuit simulation of the electrostatic breakdown protective circuit including a MOSFET, a current amplification factor is altered in response to a gate voltage of the MOSFET in the description 1 of device characteristics of a parasitic bipolar transistor of the MOSFET.例文帳に追加
MOSFETを有する静電破壊保護回路の回路シミュレーションにおいて、MOSFETの寄生バイポーラトランジスタの素子特性記述1のうち、MOSFETのゲート電圧に応じて電流増幅率を変更する。 - 特許庁
To solve the problem that additional inline loss is generated in the input of a low noise amplifier an the noise factor of a reception route is deteriorated as a result when performing filtering to transmission signals so as to eliminate parasitic coupling inside the reception route.例文帳に追加
受信経路内での寄生結合を除去するために送信信号に対してフィルタリングを行うと、低ノイズ増幅器の入力において追加的なインライン損失が生じ、結果として受信経路のノイズ因子が悪化する。 - 特許庁
Thereby, the dc current amplification factor h_FE of a parasitic bipolar transistor is raised to lower a snap-back starting voltage Vt1 in an ESD protective element 101.例文帳に追加
これにより、ESD保護素子101において、寄生バイポーラトランジスタの直流電流増幅率h_FEを上昇させ、スナップバック開始電圧Vt1を低下させる。 - 特許庁
To provide an eddy current sensor and its sensor coil in which measurement precision of the sensor can be enhanced by reducing drift of sensor output signal due to parasitic capacitance varying within measuring circuit under the effects of any environmental factor other than temperature.例文帳に追加
温度以外の環境要因の影響を受け、測定回路内で変化する寄生容量を原因とするセンサ出力信号のドリフトを減少させ、渦電流センサの測定精度を向上させる。 - 特許庁
In this case, as the bias voltage is supplied via a direct current generating circuit 31 having a high impedance, a Q factor of an LCR consonant oscillation circuit comprised of the high impedance, and a capacity as a parasitic element of the bonding pad 13 and an inductance as a parasitic element of the bonding wire 12, can be reduced based upon the high impedance.例文帳に追加
この際、バイアス電圧が、高インピーダンスを有する直流電流発生回路31を介して供給されるので、この高インピーダンスと、ボンディング・パッド13の寄生要素である容量と、そのボンディング・ワイヤ12の寄生要素であるインダクタンスと、からなるLCR共振回路のQ値を、上記した高インピーダンスに基づいて小さくすることができる。 - 特許庁
To reduce parasitic resistance effectively without deteriorating the performance of a transistor, such as high-frequency characteristics (f_T, f_max), a current amplification factor h_FE, and the withstand voltage between a collector and an emitter, and increasing variations for a bipolar transistor in which an extraction electrode is formed by a polycrystalline film.例文帳に追加
引き出し電極が多結晶膜で形成されているバイポーラトランジスタについて、高周波特性(f_T ,f_max )、電流増幅率h_FEやコレクタ−エミッタ間耐圧等のトランジスタの性能低下やバラツキを増加させることなく、寄生抵抗を効果的に低減する。 - 特許庁
To provide a simply manufactured display device equipped with a display panel having a capacitive load such as an ELDP and a PDP and a semiconductor device activating the capacitive load and which surely operates and substantially collects all power charged in the capacitive load regardless of current amplification factor of a parasitic bi-polar transistor.例文帳に追加
ELDPやPDPのような容量性負荷を有する表示パネルと、上記容量性負荷を駆動する半導体装置を備えた表示装置であって、確実に動作し、容量性負荷に充電された電力を寄生バイポーラトランジスタの電流増幅率にかかわらず実質的に全て回収でき、簡単な製造プロセスで製造できるものを提供する。 - 特許庁
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