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serial arithmeticとは 意味・読み方・使い方
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「serial arithmetic」の部分一致の例文検索結果
該当件数 : 31件
SERIAL ARITHMETIC PIPELINE, ARITHMETIC UNIT, ARITHMETIC LOGIC CIRCUIT, AND ARITHMETIC METHOD BY SERIAL ARITHMETIC PIPELINE例文帳に追加
シリアル演算パイプライン、演算装置、算術論理演算回路およびシリアル演算パイプラインによる演算方法 - 特許庁
SERIAL INTERFACE DEVICE, ARITHMETIC PROCESSING DEVICE, AND IMAGE FORMING DEVICE例文帳に追加
シリアルインタフェイス装置、演算処理装置、画像形成装置 - 特許庁
CRC ARITHMETIC CIRCUIT, SERIAL INTERFACE DEVICE, AND IMAGE FORMING APPARATUS例文帳に追加
CRC演算回路、シリアルインタフェイス装置、画像形成装置 - 特許庁
An arithmetic result is inputted to a parallel/serial conversion circuit 14 and turned to serial tone data output, based on the timing clock.例文帳に追加
演算結果はパラレル/シリアル変換回路14に入力され、タイミングクロックをもとにシリアルのトーンデータ出力となる。 - 特許庁
The arithmetic processing is executed between the entries and the ALUs in bit serial fashion in parallel.例文帳に追加
エントリとALUとの間で、ビットシリアル態様で各エントリ並列に演算処理を実行する。 - 特許庁
Arithmetic processing is carried out between the entries and the ALUs in a bit serial mode in parallel to the respective entries.例文帳に追加
エントリとALUとの間で、ビットシリアル態様で各エントリ並列に演算処理を実行する。 - 特許庁
Therefore, it is possible for the bit serial type SIMD machine 1 to quickly perform an arithmetic operation.例文帳に追加
したがって、ビットシリアル型SIMDマシン1は、高速に演算を行なうことが可能となる。 - 特許庁
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「serial arithmetic」の部分一致の例文検索結果
該当件数 : 31件
Thus, there is no need to perform arithmetic processing for rearranging data one bit by one bit for converting the serial data into the parallel data.例文帳に追加
これにより、シリアルデータをパラレルデータに変換するためにデータを1ビットずつ並び換える演算処理をしなくてすむようにする。 - 特許庁
Part of the management information is recorded as arithmetic management information 103 computed by using the manufacturer name and the stamper serial number.例文帳に追加
管理情報の一部は、製造者名称とスタンパ製造番号を使用して演算された演算管理情報103として記録されている。 - 特許庁
The phase arithmetic circuit 24 is set to feed data that should be fed to each of such modules 12, using the serial data.例文帳に追加
複数のモジュール12のそれぞれに供給すべきデータを、シリアルデータで全てのモジュールに供給する位相演算回路24を設ける。 - 特許庁
The testing apparatus includes a TS input/output substrate 12, a serial input/output substrate 13 and an arithmetic unit (PC 14).例文帳に追加
本発明に係る試験装置は、TS入出力基板12と、シリアル入出力基板13と、演算部(PC14)とを備える試験装置である。 - 特許庁
A serial parallel conversion circuit 1 applies byte interleave demultiplexing to a received STS-3c concatenation signal, serial parallel conversion circuits 2-4 apply bit interleave demultiplexing to the demultiplexed concatenation signals, and BIP-N arithmetic circuits 5-7 conduct an arithmetic operation of a BIP-N code.例文帳に追加
シリアルパラレル変換回路1は入力されたSTS−3cのコンカチネーション信号をバイトインタリーブ分離し、シリアルパラレル変換回路2〜4ではその信号をビットインタリーブ分離し、BIP−N演算回路5〜7はBIP−N符号の演算を行う。 - 特許庁
The CRC arithmetic circuit is constituted having a logic circuit that calculates a CRC code from transmission data through parallel processing based upon a predetermined arithmetic expression derived by analyzing an arithmetic step of calculating the CRC code from the transmission data through serial processing.例文帳に追加
本発明に係るCRC演算回路は、伝送データからシリアル処理でCRC符号を算出する演算過程を解析して導き出される所定の演算式に基づいて、前記伝送データからパラレル処理で前記CRC符号を算出する論理回路を有して成る構成とされている。 - 特許庁
A memory cell mat (30) is divided into a plurality of entries, an arithmetic logic unit (ALU) is arranged corresponding to each entry (ERY) and between the entries and the corresponding arithmetic logic units, arithmetic/logic operation is executed in bit-serial and entry-parallel mode.例文帳に追加
メモリセルマット(30)を複数のエントリ(ERY)に分割し、各エントリ(ERY)に対応して、演算処理ユニット(ALU)を配置し、これらのエントリと対応の演算処理ユニットとの間で、ビットシリアルかつエントリパラレル態様で演算処理を実行する。 - 特許庁
A conversion unit 120 receives parallel communication data from the arithmetic unit 110 through an important signal line L160 instead of a general signal line L150, and converts the received parallel signal to a serial signal, and transmits it to the other processor 200 through the serial signal communication line L20.例文帳に追加
また、変換部120は、演算部110からパラレル通信データを一般信号線L150の代わりに重要信号線L160を介して受信し、その受信したパラレル信号をシリアル信号に変換してシリアル信号用通信線L20を介して他の処理装置200へ送信する。 - 特許庁
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