| 意味 | 例文 (49件) |
tn1とは 意味・読み方・使い方
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遺伝子名称シソーラスでの「tn1」の意味 |
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Tn1
| mouse | 遺伝子名 | Tn1 |
| 同義語(エイリアス) | Tnni3; Cardiac troponin I; Troponin I, cardiac muscle; troponin I, cardiac; cTnI | |
| SWISS-PROTのID | SWISS-PROT:P48787 | |
| EntrezGeneのID | EntrezGene:21954 | |
| その他のDBのID | MGI:98783 |
本文中に表示されているデータベースの説明
「tn1」を含む例文一覧
該当件数 : 49件
The terminals TN1 and TN2 are connected by a short bar SB3.例文帳に追加
シールド線用端子TN1とTN2とはショートバーSB3によって接続されている。 - 特許庁
Timbres of respective channels (ch1, ch2, ...) of the playing data are detected and timbre names Tn1 are displayed.例文帳に追加
演奏データの各チャンネル(ch1,ch2,…)の音色を検出して音色名Tn1を表示する。 - 特許庁
The second NMOS transistor TN2 has n times the element size of the first NMOS transistor TN1.例文帳に追加
第2NMOSトランジスタTN2は、第1NMOSトランジスタTN1のn倍の素子サイズを有する。 - 特許庁
The inverter circuit 1 comprises in advance redundant transistors TP1-TP3, TN1-TN3.例文帳に追加
該インバータ回路1においては、予め冗長トランジスタTP1〜TP3、TN1〜TN3を含む。 - 特許庁
A constant current circuit 41 includes a first NMOS transistor TN1 and a second NMOS transistor TN2 whose gates are connected.例文帳に追加
定電流回路41は、ゲートが接続された第1,第2NMOSトランジスタTN1,TN2を含む。 - 特許庁
In an inverter drive circuit, an output transistor TP1 and TN1 is disposed parallel to a detection transistor TP2 and TN2, respectively.例文帳に追加
出力トランジスタTP1及びTN1と並列に、検出トランジスタTP2及びTN2をそれぞれ設ける。 - 特許庁
The gate voltages of the first and the second NMOS transistor TN1 and TN2 are controlled so that drain currents coincide.例文帳に追加
第1,第2NMOSトランジスタTN1,TN2はドレイン電流が一致するようにゲート電圧が制御される。 - 特許庁
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「tn1」を含む例文一覧
該当件数 : 49件
Power is transmitted in both directions between a capacitor Cs and the terminals TN1-TN2 on DC side so that the low frequency components of the input current at the terminals TN1-TN on DC side may be suppressed by this control.例文帳に追加
この制御により、直流側端子TN1−TNにおける入力電流の低周波成分が抑制されるように、キャパシタCsと直流側端子TN1−TN2との間で双方向に電力が伝達される。 - 特許庁
The gates of the first and the second NMOS transistors TN1 and TN2 are connected to the gate of a sixth NMOS transistor TN6.例文帳に追加
第1,第2NMOSトランジスタTN1,TN2のゲートは、第6NMOSトランジスタTN6のゲートに接続されている。 - 特許庁
Further, a first transistor Tn1 for charge transfer is provided between the input terminal IN and the output terminal OUT, and a second transistor Tn2 is provided between the output terminal OUT and a gate of the first transistor Tn1.例文帳に追加
また、入力端子INと出力端子OUTとの間には電荷転送用の第1トランジスタTn1が設けられており、出力端子OUTと第1トランジスタTn1のゲートとの間には第2トランジスタTn2が設けられている。 - 特許庁
The fuses F01, F02, or the like and the n-channel field effect transistors TN0, TN1 are connected between a power source and ground.例文帳に追加
ヒューズF01,F02等およびn型電界効果トランジスタTN0,TN1は、電源と接地との間に直列接続される。 - 特許庁
The correction circuit 13 corrects the control voltage Vn in response to dispersion in a threshold voltage of the 1st MOS TR TN1.例文帳に追加
補正回路13は、第1MOS形トランジスタTN1のしきい値電圧のバラツキに応じて制御電圧Vn を補正する。 - 特許庁
The source of the first NMOS transistor TN1 is connected to a second power source line L2 for supplying low potential power source VSS.例文帳に追加
第1NMOSトランジスタTN1のソースは低電位電源VSSを供給するための第2電源線L2に接続されている。 - 特許庁
Accordingly, a direction from a source to a drain in a load transistor pair TP1, TP2 and a direction from a source to a drain in a drive transistor pair TN1, TN2 are the same.例文帳に追加
よって、ロードトランジスタ対TP1,TP2およびドライブトランジスタ対TN1,TN2対では、ソースからドレインへの向きは同じである。 - 特許庁
On a terminal board TB of the transmitter 1' (1-1'), terminals TN1 and TN2 for shielding wires are provided in addition to terminals T1 to T4 for signal lines.例文帳に追加
伝送器1’(1−1’)の端子盤TB上に、信号線用端子T1〜T4に加え、シールド線用端子TN1とTN2を設ける。 - 特許庁
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