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two phase clockとは 意味・読み方・使い方
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「two phase clock」の部分一致の例文検索結果
該当件数 : 114件
DEVICE FOR GENERATING TWO-PHASE CLOCK SIGNAL例文帳に追加
二相クロック信号生成装置 - 特許庁
TWO-PHASE CLOCK DRIVEN CHARGE PUMP CIRCUIT, FOUR-PHASE CLOCK DRIVEN CHARGE PUMP CIRCUIT, AND VOLTAGE BOOSTING CIRCUIT例文帳に追加
２相クロック駆動チャージポンプ回路、４相クロック駆動チャージポンプ回路、および昇圧回路 - 特許庁
A clock signal generator supplies a Y (larger than two)-phase clock signal.例文帳に追加
クロック信号発生器はＹ（２より大きい）相クロック信号を供給する。 - 特許庁
Two ACT04 are connected in parallel to one terminal of each first phase transfer clock and the two phase transfer clock and are driven.例文帳に追加
第１相転送クロック、および２相転送クロックの１端子に対してＡＣＴ０４を２個並列に接続して駆動する。 - 特許庁
Instead, a two-phase clock is used, and a bus driver drives data on the bus in the first phase of the clock, and the bus driver is turned off at the beginning of the second phase of the clock.例文帳に追加
その代わりに、２フェーズクロックが使用され、バスドライバは、クロックの第１のフェースの間、バス上でデータをドライブし、バスクロックの第２のフェーズの始まりにおいてターンオフされる。 - 特許庁
In the EMI suppression circuit, two-phase clock signals ϕ1, ϕ2 whose phases are mutually inverted are outputted from a clock generator 18.例文帳に追加
クロック発生器１８から互いに位相が反転した２相クロック信号Φ１、Φ２を出力する。 - 特許庁
With two times of scans being formed as a single set, in a first scan, the shift registers 12A and 12B are operated with the P-phase clock and N-phase clock, respectively, while in the second scan, the shift registers 12A and 12B are operated with the N-phase clock and P-phase clock, respectively.例文帳に追加
２回のスキャンを１セットとし、１回目のスキャンではシフトレジスタ１２Ａ、１２ＢはそれぞれＰ相クロック、Ｎ相クロックで動作し、２回目のスキャンではシフトレジスタ１２Ａ、１２ＢはそれぞれＮ相クロック、Ｐ相クロックで動作する。 - 特許庁
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「two phase clock」の部分一致の例文検索結果
該当件数 : 114件
SHIFT RESISTOR NOT USING TIMING-COMPETING BOUNDARY SCAN REGISTER BY MEANS OF TWO-PHASE CLOCK CONTROL例文帳に追加
２相クロック制御によるタイミング競合バウンダリスキャンレジスタを用いないシフトレジスタ - 特許庁
Consequently, when a phase shift is smaller than a clock period, two-system image data can be phase-adjusted so as to be the same phase.例文帳に追加
これにより、位相のずれがクロック周期よりも小さければ、２系統の画像データは同位相になるように位相調整ができる。 - 特許庁
A clock generation circuit 10 generates two clocks with a uniform phase, or a CPU clock CLK_CPU and a bus clock CLK_BUS.例文帳に追加
クロック生成回路１０は、互いに位相の揃った２つのクロック、即ちＣＰＵクロックＣＬＫ_ＣＰＵ並びにバスクロックＣＬＫ_ＢＵＳを生成する。 - 特許庁
A phase comparator means 13 compares phases of the two clock signals C1, C2.例文帳に追加
その後、２つのクロック信号Ｃ１、Ｃ２の位相を位相比較手段１３によって比較する。 - 特許庁
In the phase adjustment of the dot clock, two image data are first acquired by using the two dot clocks having different phases.例文帳に追加
ドットクロックの位相調整では、まず、位相が異なる２つのドットクロックを用いて２つの画像データを取得する。 - 特許庁
A process of adjusting a phase of the dot clock first obtains two image data by two dot clocks having different phases.例文帳に追加
ドットクロックの位相調整では、まず、位相が異なる２つのドットクロックを用いて２つの画像データを取得する。 - 特許庁
In adjusting a phase of a dot clock, first, two image data are acquired by using two dot clocks having different phases.例文帳に追加
ドットクロックの位相調整では、まず、位相が異なる２つのドットクロックを用いて２つの画像データを取得する。 - 特許庁
To prevent elements such as a two-dimensional LPF circuit from being excessively loaded, by performing flare correction with a clock frequency of a two-phase signal when inputting the two-phase signal.例文帳に追加
２相信号を入力とする場合、２相信号のクロック周波数のままでフレア補正を行い、２次元ＬＰＦ回路などの素子に過大な負荷をかけない。 - 特許庁
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