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MBmを含む例文一覧と使い方
該当件数 : 8件
In addition, there is also a case such that a two-dimensional array of micro beam multiplier (MBM) is added to the structure, to improve the quality of the magnified image.例文帳に追加
さらに、その構造には拡大像の品質を向上するために、小型光束増倍素子（MBM）の二次元配列を付加する場合もある。 - 特許庁
In this method, a miniblock mill(MBM) is arranged between the block mill(BM) and a sizing mill(SM) as a reducer taking charge of intermediate rolling.例文帳に追加
ブロックミル（ＢＭ）とサイジングミル（ＳＭ）との間に、中間の圧延を担当するリデューサーとしてミニブロックミル（ＭＢＭ）を配置する。 - 特許庁
In two memory blocks of memory blocks MB0-MBm, word lines are each driven to a selected state, and memory cell data is latched by a corresponding sense amplifier band.例文帳に追加
メモリブロックＭＢ０−ＭＢｍのうちの２つのメモリブロックにおいてそれぞれワード線を選択状態に駆動し、対応のセンスアンプ帯によりメモリセルデータをラッチする。 - 特許庁
Or, meat meal (MM) containing reduced content of Ca and meat and bone meal (MBM) containing large content of Ca are mixed or charged alternately to burn the waste.例文帳に追加
あるいはまた、Ｃａ分の含有量の少ない肉粉（ＭＭ）と、Ｃａ分の含有量の多い肉骨粉（ＭＢＭ）とを混合して、あるいはまた交互に投入して、廃棄物の燃焼を行なう。 - 特許庁
Memory sub-blocks (MB0-MBm) perform refresh by fetching a refresh activation instruction signal (AREF) from a main control circuit by a demultiplexer (34) at the time of a predetermined condition.例文帳に追加
メモリサブブロック（ＭＢ０−ＭＢｍ）において、メイン制御回路からのリフレッシュ活性化指示信号（ＡＲＥＦ）を、デマルチプレクサ（３４）により所定の条件のときに取込みリフレッシュを実行する。 - 特許庁
Main/sub-bit line structure is premised, clamp voltage is supplied to main bit lines (MB0 to MBm) from voltage supply elements (QPC0 to QPCm) in a period before and after read operation for a nonvolatile memory cell (MC).例文帳に追加
主・副ビット線構造を前提とし、不揮発性メモリセル（ＭＣ）に対する読み出し動作の前後の期間において電圧供給素子（ＱＰＣ０〜ＱＰＣｍ）から主ビット線（ＭＢ０〜ＭＢｍ）にクランプ電圧を供給する。 - 特許庁
The miniblock mill(MBM) is also arranged so that it can be retreated from the pass line and simultaneously the sizing mill is made into two-stage constitution (SM1, SM2) and so that the mill is used in the continuous operation in the prestage and poststage or used only in the prestage and made to execute dummy pass in the poststage.例文帳に追加
ミニブロックミル（ＭＢＭ）もパスラインから退避可能に設けるとともに、サイジングミルを２段構成（ＳＭ１，ＳＭ２）とし、前段と後段とを一貫して使用するか、または前段だけを使用して後段はダミーパスさせることができるように設ける。 - 特許庁
A reference current generating circuit includes an operational amplifier P2 to which reference voltage Vref is input, resistance R0 to Rk for adjusting reference current Isd2, a switch S0, P-channel electric field effect transistors MB1 to MBM for adjusting reference current Iref2, and switches S1 to SM.例文帳に追加
参照電圧Ｖｒｅｆが入力されるオペアンプＰ２と、基準電流Ｉｓｄ２を調整する抵抗Ｒ０〜ＲｋおよびスイッチＳ０を設けるとともに、参照電流Ｉｒｅｆ２を調整するＰチャンネル電界効果トランジスタＭＢ１〜ＭＢＭおよびスイッチＳ１〜ＳＭを設ける。 - 特許庁
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