そして、アドレスバスの接続状態をチェックする場合に、デバイス５に対して、複数のアドレスを順次に指定して該アドレス毎に異なるデータを書き込んだ後、最初に指定したアドレスのデータを読み出し、実際に読み出されたデータが、最初に指定したアドレスへのデータ書き込み時に指示したデータと異なるか否かを調べる。例文帳に追加

When checking the connection condition for an address bus, a plurality of addresses is assigned in order to write data different in every address, to the device 5, the data of the first assigned address is read out thereafter, and it is checked whether the actually read-out data is different from the data assigned when writing the data to the first assigned address. - 特許庁

例文

アドレス設定装置がランダムアドレス設定コマンドを発して各通信端末装置に対して任意の仮アドレスを設定させ、次にアドレス設定装置が宛先アドレスを順次変更した動作要求コマンドを発して通信端末装置による応答を確認して存在する仮アドレス及びその通信端末装置の機能を調べ、その後、アドレス設定装置がアドレス変更コマンドを前記仮アドレスの存在する各通信端末装置に対して発し、各通信端末装置に対しアドレス設定装置が指定する本アドレスに変更させる。例文帳に追加

Then the address setting device generates an operation request command in which destination addresses are successively changed, confirms responses from the communication terminals and checks existing virtual addresses and the functions of the communication terminals corresponding to the virtual addresses. - 特許庁

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日英・英日専門用語辞書での「順次アドレス指定」の英訳

順次アドレス指定

sequential addressing

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「順次アドレス指定」の部分一致の例文検索結果

該当件数 : 35件

例文

受信機１は、端末機器１２−１，１２−２，１２−３…のアドレスＡ＝１〜ｎを順次繰り返し指定し、次に送信する端末アドレスに対し２つ前の端末アドレスを持つ端末機器からの応答信号の受信終了に同期して端末アドレスをもつ呼出信号の送信を開始する。例文帳に追加

A receiver 1 successively repeatedly designates addresses A=1 to n of terminal equipment 12-1, 12-2, 12-3, etc., and then starts the transmission of call signal having a terminal address synchronously to the receiving end of response signal from terminal equipment having a terminal address preceding the terminal address to be transmitted by two. - 特許庁

非順次アドレス指定可能な記憶場所が関わるダイレクトメモリアクセス転送を実施するための方法及び装置例文帳に追加

METHOD AND DEVICE FOR IMPLEMENTING DIRECT ACCESS TRANSFER RELATED TO NONSEQUENTIAL ADDRESS DESIGNABLE STORAGE PLACE - 特許庁

表示アドレス生成器３６が表示アドレスを順番に生成すると、変換テーブル２８の作用によって、３Ｄメモリ２２上のアドレスが順次指定され、読み出された複数のエコーデータに基づき補間処理がなされた後、フレームメモリ３２上に指定断面に相当する断層画像が構築される。例文帳に追加

When a displaying address generator 36 generates displaying addresses in order, addresses on a 3D memory 22 are designated in order, interpolation processing is performed based on many pieces of read echo data and then, the tomographic image equivalent to the designated cross section is constructed on a frame memory 32. - 特許庁

そして、電源投入直後のアドレス設定時には、アドレス設定抵抗Ｒ２〜Ｒ９の抵抗値に基づいて端末制御部の列を指定し、指定された列においては、列の最後尾の端末制御部からアドレスを設定していき、コントロールライン１１を介して順次一つ前の端末制御部を指定しながらアドレス設定を行っていく。例文帳に追加

At the time of address setting immediately after turning on a power supply, a certain column of terminal control parts is specified based on the resistance values of respective address setting resistors R2 to R9, and in the specified column, addresses are successively set up from the final terminal control part of the column so that the terminal control part just before is specified to set up its address. - 特許庁

モード信号ＭＯＤで通常動作モードを設定し、ロウアドレス信号ＲＡＤＲでメモリセルブロック１の全アドレスを順次指定して“Ｈ”のデータを書き込む。例文帳に追加

Setting up a normal operation mode by using mode signals MOD, "H" data are written by sequentially specifying the whole address of a memory cell block 1 using row address signals RADR. - 特許庁

アドレス設定部５は共有されるデータバスＡ２へのデータ出力状態に基づいて、各装置１００、１０１、１０２に対して順次、データバスＡ２へのデータ出力許可として、アドレスバスＡ１へ指定アドレスを出力する。例文帳に追加

An address-setting section 5 sequentially permits each of devices 100, 101 and 102 to output data to a data bus A2, on the basis of a data output state to the data bus A2 shared in common an outputs and designated address to the data bus A1. - 特許庁

ダイレクトメモリアクセス（ＤＭＡ）コントローラ４は、アドレス管理部７がアドレス指定制御部５に対して読出すべき読出し単位ＲＵの先頭アドレスを順次供給していくことで、読出し単位ＲＵを継続的に読出していくことができる。例文帳に追加

The direct memory controller (DMA) controller 4 can continuously read out read units RU by successively supplying head addresses of the read unit RU to be read from an address management part 7 to an address designation control part 5. - 特許庁

例文

リフレッシュ制御部は、メモリセルアレイ内の一部の対象メモリセル群を設定するための対象メモリセル群設定部と、メモリセルアレイ内のすべてのメモリセルを指定可能な複数のリフレッシュアドレスを順次発生させるリフレッシュアドレス発生部と、注目リフレッシュアドレスが対象メモリセル群を指定しているか否かを判定するためのリフレッシュアドレス判定部と、を備える。例文帳に追加

The refresh control part is provided with a target memory cell group setting part for setting a portion of the target memory cell group in the memory cell array, a refresh address generating part for sequentially generating a plurality of refresh addresses that can designate all memory cells in the memory cell array, and a refresh address determining part for determining whether an attention refresh address designates the target memory cell group. - 特許庁