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circuit under testとは 意味・読み方・使い方
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意味・対訳 被試験回路
「circuit under test」の部分一致の例文検索結果
該当件数 : 80件
CONTINUOUS APPLICATION AND DECOMPRESSION OF TEST PATTERN TO TECHNOLOGICAL FIELD OF CIRCUIT UNDER TEST例文帳に追加
テスト中回路技術分野へのテストパターンの連続的な適用およびデコンプレッション - 特許庁
To provide a method and an apparatus for detecting a state of a circuit under test, capable of simply modeling the state of the circuit under test and easily evaluating the state of the circuit under test.例文帳に追加
被テスト回路の状態を簡単にモデル化することができ、被テスト回路の状態を容易に評価することができる被テスト回路の状態検出方法及び状態検出装置を提供すること。 - 特許庁
To provide a circuit test apparatus which can reduce man-hours and costs required for a test on the operation of the connection between boards under test.例文帳に追加
被検査基板間の接続の動作の試験に要する工数、コストの低減を実現することが可能な回路試験装置を提供する。 - 特許庁
To shorten the time for testing a test circuit, and to improve the reliability of the test performed for a circuit under test, by performing detection of the malfunction of the test circuit.例文帳に追加
テスト回路の故障検出をおこなうことにより、テスト回路の試験時間の短縮化および試験対象回路におこなう試験の信頼性の向上を図ること。 - 特許庁
The circuit under test outputs test resultant data synchronizing with clock signal CLK2 outputted from an OR circuit 12.例文帳に追加
被テスト回路は、OR回路12が出力するクロック信号CLK2に同期してテスト結果データを出力する。 - 特許庁
To provide an interface circuit for a device under test which can suppress increase in size of a semiconductor device.例文帳に追加
半導体装置の大型化を抑制できる被検査装置用インタフェース回路を提供する。 - 特許庁
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「circuit under test」の部分一致の例文検索結果
該当件数 : 80件
To verify a logic circuit under test by simulation at high speed.例文帳に追加
被テスト回路としての論理回路のシミュレーション検証を高速に実行する。 - 特許庁
A static power current IDDQ is measured at a plurality of strobe points with application of a test signal to a CMOS integrated circuit 50 under test.例文帳に追加
試験対象のCMOS集積回路50にテスト信号を印加して静止電源電流I_DDQ を複数のストローブ点で測定する。 - 特許庁
Accordingly, it becomes possible to test the test block A regionally under a different distribution in voltage drop of the regions inside the semiconductor integrated circuit device.例文帳に追加
よって半導体集積回路装置内部を、領域ごとに異なる電圧降下分布として試験ブロックAの試験を行う事が可能となる。 - 特許庁
To provide a bit-compressed test pattern to a scanning chain of a circuit under a test, and to handle test patterns of different scanning chain lengths when a decompressed test pattern thereof is applied to the scanning chain.例文帳に追加
テスト中回路中の走査チェーンにビットの圧縮したテストパターンを提供し、これが解凍されたテストパターンを走査チェーンに適用するに際して、異なる走査チェーンの長さのテストパターンを扱えるようにする。 - 特許庁
A BIST circuit 3 which tests the logic circuit 4 under test comprises a control circuit 11, a test pattern generation circuit 12, a first pattern generation circuit 13, a second pattern generation circuit 14, a signal compression pattern generation circuit 15 and a failure detection analysis circuit 16.例文帳に追加
被テスト回路である論理回路4をテストするBIST回路3には、制御回路11、テストパターン発生回路12、第1のパターン生成回路13、第2のパターン生成回路14、信号圧縮パターン生成回路15、及び故障検出解析回路16が設けられる。 - 特許庁
The adapter device for an IC tester, which is detachably electrically connected to a test head and electrically connected to a target under test, has an exclusive OR circuit for subjecting a plurality of digital signals from the test head to an exclusive OR operation and outputting the result to the target under test.例文帳に追加
本発明は、テストヘッドに着脱可能に電気的に接続し、被試験対象に電気的に接続するICテスタのアダプタ装置であって、テストヘッドからの複数のデジタル信号を排他的論理和して被試験対象に出力する排他的論理和回路を有することを特徴とするものである。 - 特許庁
To provide a voltage margin test circuit capable of operating an electronic device under test as a primary device function, capable of controlling it from a voltage margin test means at the time of a test, and provided with a deterioration preventing structure on the test means itself.例文帳に追加
試験される電子装置が本来の装置機能として動作できると共に、試験時には電圧マージン試験手段から制御可能とし、かつ試験手段そのものが劣化防止構造を備えた電圧マージン試験回路と劣化診断装置。 - 特許庁
The test of a lightning surge protection circuit which is built in a protection circuit 12 is executed under the instruction from a central control part 14.例文帳に追加
保護回路12に内蔵されている雷サージ保護回路の試験を中央制御部14からの指示により実行する。 - 特許庁
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