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dual accessとは 意味・読み方・使い方
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意味・対訳 デュアルアクセス
「dual access」の部分一致の例文検索結果
該当件数 : 65件
ACCESS METHOD OF AND ACCESS CONTROL DEVICE FOR DUAL PORT MEMORY例文帳に追加
デュアルポートメモリのアクセス方法及びアクセス制御装置 - 特許庁
DUAL PORT RAM ACCESS CONTROL CIRCUIT例文帳に追加
デュアルポートRAMアクセス制御回路 - 特許庁
A dual access DRAM includes first and second sets of data lines.例文帳に追加
デュアルアクセスDRAMは、第1および第2の組のデータラインを含む。 - 特許庁
To inspect a cross access function of a dual interface card.例文帳に追加
デュアルインターフェイスカードのクロスアクセス機能の検査ができる。 - 特許庁
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「dual access」の部分一致の例文検索結果
該当件数 : 65件
To provide a pseudo dual port DRAM which performs dual-port access properly while holding a clock cycle.例文帳に追加
クロックサイクルを保持しつつ、適度なデュアルポートアクセスを行える擬似的なデュアルポート型のDRAMを提供する。 - 特許庁
To perform access to a dual port memory in arbitrary timing without depending on the type of a dual port memory.例文帳に追加
デュアルポートメモリの種類に依存しないで、デュアルポートメモリに対して任意のタイミングでアクセスする。 - 特許庁
DUAL-PORT MEMORY CONTROLLER FOR ADJUSTING DATA ACCESS TIMING AND METHOD BY THE SAME例文帳に追加
データアクセスタイミングを調整するデュアルポートメモリコントローラ及びそれによる方法 - 特許庁
To mediate the access conflict occurring in a dual port memory device which permits the simultaneous access from both of a communication section and a CPU.例文帳に追加
通信部とCPUとの双方からの同時アクセスを許容するデュアルポートメモリ装置に生じるアクセス競合を調停する。 - 特許庁
The PDPRAM (partial dual port random access memory) 20 is composed of a clock synchronization SRAM (static random access memory) interface (IF) 21, a DRAM cell array 22, a dual port DRAM cell array 23, and a DRAM cell array 24.例文帳に追加
PDPRAM20は、クロック同期SRAMインタフェース(IF)21と、DRAMセルアレイ22と、デュアル・ポートDRAMセルアレイ23と、DRAMセルアレイ24とから構成されている。 - 特許庁
For the data control between each processor and the dual port RAM, the signal to access the dual port RAM by a latch circuit 60 is used for the control signal for temporarily saving or transferring data.例文帳に追加
各プロセッサとデュアルポートRAM間のデータ制御については、ラッチ回路60でデュアルポートRAMをアクセスする信号を制御信号として使用し、データの一時蓄積やデータの転送を行う。 - 特許庁
Further, dual-bank memories (31 and 32) and a circuit which are coupled with the data processing element and dual-bank memories and allows simultaneous read access to a data bank memory are included.例文帳に追加
また、データ処理素子(10)と通信するデュアル・バンク・メモリ(31,32),ならびにデータ処理素子およびデュアル・バンク・メモリに結合され、データ・バンク・メモリに対する同時リード・アクセスを与える回路も含む。 - 特許庁
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