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high order digitとは 意味・読み方・使い方
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「high order digit」の部分一致の例文検索結果
該当件数 : 22件
The high-order digit is non-zero, unless number is zero.発音を聞く 例文帳に追加
最上位の桁はnumberが 0 でなければ 0 以外である。 - JM
A high-order digit and low-order digit combining part 224 combines the scrambling code high-order digit and the scrambling code low-order digit to attain one scrambling code.例文帳に追加
上位桁と下位桁の組み合わせ部224は、スクランブリングコード上位桁と、スクランブリングコード下位桁とを組み合わせて、1つのスクランブリングコードとする。 - 特許庁
A high-order digit read part 223 reads the identification number of the present device from a scrambling code high-order digit storage part 232 and defines it as a scrambling code high-order digit.例文帳に追加
上位桁読み出し部223は、スクランブリングコード上位桁記憶部232から自装置の識別番号を読み出しスクランブリングコード上位桁とする。 - 特許庁
A clock gating control circuit 3 is interposed between a low-order digit counter 1 and a high-order digit counter 2.例文帳に追加
下位桁カウンタ1と上位桁カウンタ2との間には、クロックゲーティング制御回路3が介挿されている。 - 特許庁
The operand X of a function is divided into a high-order digit bit string U and a low-order digit bit string D, and the definition region of the operand X is divided into a plurality of sections related with the high-order digit bit string U.例文帳に追加
関数のオペランドXを上位桁ビット列Uと下位桁ビット列Dに分け、オペランドXの定義域を上位桁ビット列Uに関係付けられた複数の区分に分ける。 - 特許庁
Each ALU includes a carry output outputting a carry bit of the arithmetic result to the high order digit ALU and a carry input inputting the carry bit from the low order digit ALU and each ALU sequentially operates the input value of each digit and previous arithmetic value of the feedback digit including the digit bit from the low order digit.例文帳に追加
それぞれのALUが演算結果の桁上げビットを上位桁のALUに出力するキャリー出力と下位桁のALUからの桁上げビットを入力するキャリー入力とを含み、それぞれのALUが各桁の入力値とフィードバックしたその桁の前演算値とを下位桁からの桁ビットを含み逐次演算する。 - 特許庁
The initial value b and the inclination (a) and correction value α of the straight line are outputted from the high-order digit bit string U.例文帳に追加
上位桁ビット列Uから初期値bと直線の傾きaと補正値αを出力する。 - 特許庁
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「high order digit」の部分一致の例文検索結果
該当件数 : 22件
Based on the bit information on the digit next to the minimum digit, the second condition branch circuit 21 creates intermediate output digital signal by combining the bit information of continuous arrangement with low order or high order of the boundary bit information.例文帳に追加
最小桁の次桁のビット情報に基づき、第2の条件分岐回路21は境界ビット情報の下位又は上位に連続配列のビット情報を組み合わせて中間出力デジタル信号を生成する。 - 特許庁
A separation part 54 separately reads out the high-order digit valud D1 of (K-1)th to (K-M)th digits and the low-order digit value D2 of (K-M-1)th to (K-M-N)th digits when the value of the quantization code (x) is multiplied by 2^(K-L).例文帳に追加
分離部54は、量子化符号xの値を2^(K−L)倍したときの(K−1)桁目から(K−M)桁目までの上位桁値D1と、(K−M−1)桁目から(K−M−N)桁目までの下位桁値D2とを分離して読み出す。 - 特許庁
When the count value of the low-order digit counter 1 becomes "7" and digits should be carried, the clock gating control circuit 3 passes the next clock CLK and supplies it to the high-order digit counter 2 as a clock CLKa.例文帳に追加
クロックゲーティング制御回路3は、下位桁カウンタ1のカウント値が「7」となって桁上げを行うべきとき、次のクロックCLKを通過させ、クロックCLKaとして上位桁カウンタ2へ供給する。 - 特許庁
the comparison results "00", "01", or "10" are stored in a shift register as contents which have the high-order bits added to the least significant digit bit of the stored value obtained so far and include the low-order digit bits as the least significant bit.例文帳に追加
前記した比較結果「00」、「01」、「10」はシフトレジスタに格納するが、その上位ビットは前回までの格納値の最下位ビットに加算し、その下位ビットを最下位ビットとする内容に更新する。 - 特許庁
The high-order digit counter 2 is a synchronous counter and performs up-counting of the clock CLKa supplied in this way.例文帳に追加
上位桁カウンタ2は、同期カウンタであり、このようにして供給されるクロックCLKaのアップカウントを行う。 - 特許庁
A table reference part 56 reads out a conversion value for the high-order digit value D1 as a lower-limit value V1 by reference to a table 58 for conversion and also reads out a conversion value for the value (D1+1) obtained by adding 1 to the high-order digit value D1 as an upper-limit value.例文帳に追加
テーブル参照部56は、変換用テーブル58を参照して、上位桁値D1に対する変換値を下限値V1として読み出し、更に、上位桁値D1に1を加えた値(D1+1)に対する変換値を上限値V2として読み出す。 - 特許庁
A JPEG lossless coding is applied to the high-order bit data and a valid bit number (4 bits or below) of the low-order bit data is decided on the basis of a size (digit number) of the source data.例文帳に追加
上位側ビットデータにJPEGロスレス符号化を施すと共に、元データの大きさ(桁数)に基づいて下位側ビットデータの有効ビット数(4ビット以下)を決定する。 - 特許庁
Based on the bit information on the final digit, the third condition branch circuit 22 creates final output digital signal by combining the bit information of continuous arrangement with low order or high order of the intermediate output digital signal.例文帳に追加
最終桁のビット情報に基づき、第3の条件分岐回路22は中間出力デジタル信号の下位又は上位に連続配列のビット情報を組み合わせて最終出力デジタル信号を生成する。 - 特許庁
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