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トランジスタ寸法の英語
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「トランジスタ寸法」の部分一致の例文検索結果
該当件数 : 70件
縮小された寸法を特徴とするトランジスタに使用するハロー構造例文帳に追加
HALO STRUCTURE USED IN TRANSISTOR WITH FEATURE OF REDUCED SIZE - 特許庁
第1トランジスタと、第1トランジスタに近接し、第1トランジスタより小さい寸法の埋め込み炭素ナノチューブ電界効果トランジスタ(CNT FET)とを備える集積回路についての方法及び構造である。例文帳に追加
This invention relates to a method and a structure of an integrated circuit provided with a first transistor and an embeded carbon nanotube field effect transistor (CNT FET) which is adjacent to and smaller than the first transistor. - 特許庁
寸法的またはコスト的に有利な電圧駆動型トランジスタのゲート回路を提供する。例文帳に追加
To provide a gate circuit of voltage driving transistor advantageous in terms of dimensions and cost. - 特許庁
ロジックNch領域102に設けられたトランジスタの最小ゲート寸法は、DRAM領域104に設けられたトランジスタの最小ゲート寸法よりも小さい。例文帳に追加
The minimum gate size of transistors prepared in logic Nch region 102 is smaller than the minimum gate size of a transistor prepared in the DRAM region 104. - 特許庁
すなわち、アクセストランジスタNQ3は、最小設計寸法で設計されたドライバトランジスタNQ1よりもチャネル面積を増加させることができるためすなわちLWの面積を増加させることができるためアクセストランジスタNQ3の特性ばらつきの増加を抑制することが可能となる。例文帳に追加
That is, since a channel area is made larger than the driver transistor NQ1 designed by a minimal design size in the access transistor NQ3, the area of LW is increased, and the increase is suppressed in the characteristic variation of the access transistor NQ3. - 特許庁
寸法安定性に乏しいプラスチック基材を用いて薄膜トランジスタ基板を製造する際に加わる熱や雰囲気によっても、薄膜トランジスタを構成する電極や半導体薄膜にクラックが生じることがなく且つ剥離し難い薄膜トランジスタ基板を提供する。例文帳に追加
To provide a thin-film transistor substrate which does not cause cracking in the electrode or a semiconductor thin film constituting the thin-film transistor nor exfoliate easily even with heat or atmosphere when a thin-film transistor substrate is produced using a plastic base exhibiting poor dimensional stability. - 特許庁
ドレイン出力端子を有するMOSトランジスタを含む半導体集積回路装置において、MOSトランジスタの寸法を大きくすることなく、そのESD耐量を改善すること。例文帳に追加
To improve ESD withstand in a MOS transistor without increasing the dimensions of the MOS transistor in a semiconductor integrated circuit device including the MOS transistor having a drain output terminal. - 特許庁
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「トランジスタ寸法」の部分一致の例文検索結果
該当件数 : 70件
印刷法により、プラスチックフィルムを基板として用いて、高寸法精度の有機トランジスタを形成することができる有機トランジスタの形成方法を提供する。例文帳に追加
To provide a method of forming an organic transistor which can form an organic transistor having high dimension accuracy by using a plastic film as a substrate by a printing method. - 特許庁
半導体集積回路にはMOSトランジスタが形成される素子活性領域のゲート長方向の寸法を考慮してMOSトランジスタのレイアウト構造が決定されている。例文帳に追加
The layout structure of the MOS transistor is decided in the semiconductor integrated circuit by considering a size in a gate lengthwise direction of an element active region where the MOS transistor is formed. - 特許庁
その際、pチャネルMOSトランジスタとnチャネルMOSトランジスタのキャリア移動度が平衡するように、前記構造の寸法・形状を設定する。例文帳に追加
Size and shape of the structure are set so as to balance carrier mobilities between the p-channel MOS transistor and the n-channel MOS transistor. - 特許庁
CMOSトランジスタの動作時にゲート電極の空乏化を防ぎ、かつ、N型及びP型トランジスタでゲート電極寸法に差異が生じない半導体装置の製造方法を提供する。例文帳に追加
To provide the manufacturing method of a semiconductor device that prevents the depletion of a gate electrode at a time when CMOS transistor is operated and never causes differences in gate electrode dimensions of N-type and P-type transistors. - 特許庁
両MOSバラクタ13,14は、各々pMOSトランジスタ11及びnMOSトランジスタ12と全く同じ寸法構造ないしは2倍のチャネル面積を有する。例文帳に追加
Both the varactors 13 and 14 have entirely the same size structure as those of the transistor 11 and the transistor 12 or twice the channel area. - 特許庁
また、所望の電流容量を与えるトランジスタは、幾何学的寸法が、実質的に同一サイズである複数の単位バイポーラトランジスタを、互いに電気的に並列接続することにより構成する。例文帳に追加
In addition, transistors that give predetermined current capacitance are configured by electrically connecting a plurality of unit bipolar transistors where geometric dimensions are substantially the same mutually. - 特許庁
寸法ずれによりゲート長が「ΔL」だけ長くなった場合、クロックドライバを構成するトランジスタのゲート長は「L+α+ΔL」となり、フリップフロップ群を構成するトランジスタのゲート長は「L+ΔL」となる。例文帳に追加
When a gate becomes longer by a length ΔL due to dimensional deviation, the gate of a transistor that forms a clock driver becomes 'L+α+ΔL' in length, and the gates of transistors that form a flip-flop group become as long as 'L+ΔL'. - 特許庁
この構成により、活性領域A、素子分離領域ISの寸法を変更することなく、nチャネルトランジスタQnとpチャネルトランジスタQpの駆動電流をともに増加させることができる。例文帳に追加
In this configuration, the both driving currents in the n-channel transistor Qn and the p-channel transistor Qp can be increased without changing the sizes of the active regions A and the device isolation region IS. - 特許庁
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