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Binary counterとは 意味・読み方・使い方

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意味・対訳 二進カウンタ


コンピューター用語辞典での「Binary counter」の意味

binary counter

バイナリカウンタ; 2進計数器

用例
Binary counter can be either a synchronous counter or a ripple counter.
バイナリカウンタは,同期カウンタかリップルカウンタのいずれかである

「Binary counter」の部分一致の例文検索結果

該当件数 : 47



例文

Binary counter can be either a synchronous counter or a ripple counter.発音を聞く 例文帳に追加

バイナリカウンタは,同期カウンタかリップルカウンタのいずれかである. - コンピューター用語辞典

TIMEPIECE WITH CALENDAR USING BINARY COUNTER例文帳に追加

2進カウンタを使用したカレンダー付き時計 - 特許庁

The impedance control circuit comprises a first binary counter ((n) bits), a second binary counter (n+k bits) and a timing control circuit.例文帳に追加

第1のバイナリカウンタ(nビット)と,第2のバイナリカウンタ(n+kビット)と,タイミング制御回路とを備える。 - 特許庁

A Johnson counter frequency divider circuit and the binary counter frequency divider circuit are combined.例文帳に追加

ジョンソンカウンタ型分周回路とバイナリカウンタ型分周回路とを組み合わせる。 - 特許庁

The binary counter 7 counts up a counter value according to the reset signal D and clears the counter value when supplied with power.例文帳に追加

2進カウンタ7は、リセット信号Dに基づいてカウンタ値をカウントアップするとともに、電源が供給されるとカウンタ値をクリアする。 - 特許庁

Bits of the counter are grouped into a binary section of an m-bit counter and a unary section of an n-bit counter.例文帳に追加

このカウンタのビットは、mビットカウンタのバイナリ部分と、nビットカウンタのユナリ部分にグループ化される。 - 特許庁

例文

N1 is loaded as an initial value on a binary down-counter 12 when a count value becomes -N2.例文帳に追加

2進ダウンカウンタ12には、カウント値が−N2になると初期値としてN1がロードされる。 - 特許庁

>>例文の一覧を見る


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機械工学英和和英辞典での「Binary counter」の意味

binary counter (BC)


JST科学技術用語日英対訳辞書での「Binary counter」の意味

binary counter


日英・英日専門用語辞書での「Binary counter」の意味

binary counter

2進カウンタ2進計数回路,バイナリカウンタ,2進計数器

「Binary counter」の部分一致の例文検索結果

該当件数 : 47



例文

The counter circuit 3 counts the number of pulse signals and holds it in a binary expression.例文帳に追加

カウンタ回路3は、そのパルス信号数をカウントし2進数表現で保持する。 - 特許庁

A counter counts the number of cycles of a reference signal for generating binary output, accordingly.例文帳に追加

カウンタは、基準信号のサイクル数をカウントして対応するバイナリ出力を生成する。 - 特許庁

The binary expression of an optionally desired number which expresses the present position of the counter wheel (1) is formed by combining the binary values through the use of the number of the fixing electrodes for each counter wheel.例文帳に追加

各カウンターホイールのための固定電極の数によって、これらの2進値を組合せて、カウンターホイール(1)の現在の位置を表す任意の所望の数の2進表現を形成することができる。 - 特許庁

At a point of time when a binary counter 3 latching a value of a timer buffer 8 selected by an ON/OFF period section 13 and a 0/1 signal selection section 12 executes counting, the binary counter 3 generates an overflow signal 9 and a gate signal 6.例文帳に追加

オン/オフ区間選択部13、0/1信号選択部12で選択されたタイマバッファ8の値をラッチするバイナリカウンタ3がカウント実行した時点でオーバーフロー信号9を発生しゲート信号6が生成される。 - 特許庁

The first binary counter sequentially sends out an impedance control code of (n) bits to a replica of a matching circuit.例文帳に追加

第1のバイナリカウンタは、整合回路のレプリカにnビットのインピーダンス制御コードを順次送出する。 - 特許庁

The periods of the 'H level' and the 'L level' in the input signal 111 are counted respectively by the binary counter 120 having an up and down function.例文帳に追加

アップダウン機能を持つバイナリカウンタ120にて入力信号111の“Hレベル”、“Lレベル”期間がそれぞれ測定される。 - 特許庁

Then high or low, i.e., the binary value of zero or one is detected concerning each position of the counter wheel and each fixing electrode.例文帳に追加

これにより、カウンターホイールの各位置と各固定電極について、高又は低即ち、0又は1の2進値を検出することができる。 - 特許庁

例文

At this time, each time a detecting signal arrives from the edge detecting circuit 1, the value of the binary counter 3 is shifted to the latch 4 of the following step.例文帳に追加

その際、エッジ検出回路1から検出信号がくるたびにバイナリカウンタ3の値を後段のラッチ4にシフトする。 - 特許庁

>>例文の一覧を見る


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