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address fetchとは 意味・読み方・使い方
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「address fetch」の部分一致の例文検索結果
該当件数 : 65件
Then, while the instruction execution part 13 executes loop processing, an instruction fetch control part 18 stops the supply of the fetch address to the instruction memory 10 by the instruction fetch part 11 when the fetch address corresponds to a first address LNFA (Loop Next Fetch Address) or an address after the first address.例文帳に追加
そして、命令フェッチ制御部１８は、命令実行部１３がループ処理を実行している間において、フェッチアドレスが第１のアドレスＬＮＦＡ以降である場合に、命令フェッチ部１１による命令メモリ１０へのフェッチアドレスの供給を停止させる。 - 特許庁
The instruction fetch part 11 supplies a fetch address to an instruction memory 10.例文帳に追加
命令フェッチ部１１は、命令メモリ１０に対してフェッチアドレスを供給する。 - 特許庁
An instruction fetch unit 10 supplies a fetch address to the tag comparator 52 and the sub system 62.例文帳に追加
命令フェッチ・ユニット１０は、フェッチ番地をタグ比較器５２およびサブシステム６２に供給する。 - 特許庁
The instruction buffer 12 stores the instruction read out from the address designated by the fetch address.例文帳に追加
命令バッファ１２は、フェッチアドレスで指定されるアドレスから読み出された命令を格納する。 - 特許庁
The address translation logic is configured to pre-fetch a virtual address translation for a predicted virtual address based on a virtual address of the current block of data.例文帳に追加
アドレス変換ロジックは、現在のデータブロックの仮想アドレスに基づいて予測仮想アドレスに対する仮想アドレス変換を先取りするように構成される。 - 特許庁
To provide a method for speeding-up branch prediction-destination instruction fetch in which a fetch address stream can be precedently generated while instruction fetch stops and branch-predicted fetch data and fetch data of a branch prediction-destination instruction are successively supplied.例文帳に追加
命令フェッチが停止している間に、フェッチアドレスストリームを先行して形成することができ、分岐予測をかけたフェッチデータと、分岐予測先命令とのフェッチデータが連続で供給できるような、分岐予測先命令フェッチの高速化方法を提供する。 - 特許庁
A branch history 15 stores the address mode information of a branch destination and an instruction fetch control circuit 13 holds the address mode information corresponding to respective instruction fetch ports.例文帳に追加
ブランチ・ヒストリー１５は、分岐先のアドレスモード情報を格納し、命令フェッチ制御回路１３は、複数の命令フェッチポートの各々に対応するアドレスモード情報を保持する。 - 特許庁
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「address fetch」の部分一致の例文検索結果
該当件数 : 65件
Also, a debug interface detects a data fetch cycle, and samples the virtual address bus, and compares at least one address under consideration or address corresponding to an address range.例文帳に追加
また、デバッグ・インタフェースはデータフェッチサイクルを検出し、仮想アドレスバスをサンプルしかつ１つまたはそれ以上の注目のアドレスまたはアドレス範囲に対するアドレスを比較する。 - 特許庁
This method is characterized by that fetch addresses are successively generated by carrying out instruction fetch and instruction fetch address generation independently.例文帳に追加
本発明に係る分岐予測先命令フェッチの高速化方法は、命令フェッチと、命令フェッチアドレス生成とを独立して動作させてフェッチアドレスを連続して形成したことを特徴とする。 - 特許庁
An address buffer 8 and a command decoder 7 fetch an address and a command in synchronism with the leading edge of a clock CLK.例文帳に追加
アドレスバッファ８及びコマンドデコーダ７は、クロックＣＬＫの立ち上がりエッジに同期して、アドレス及びコマンドを取り込む。 - 特許庁
A row address holding part 122 and a column address holding part 132 fetch the row address and column address of a memory cell Cell in synchronization with external clock signals inputted successively from an external clock terminal.例文帳に追加
ロウアドレス保持部１２２及びカラムアドレス保持部１３２は、外部クロック端子から順次入力される外部クロック信号に同期して、メモリセルＣｅｌｌのロウアドレス及びカラムアドレスを取り込む。 - 特許庁
To selectively fetch and register address data suitable for communication equipment at the registration destination from groupware.例文帳に追加
登録先の通信機器に適したアドレスデータをグループウェアから選択的に取込んで登録できるようにする。 - 特許庁
To provide a cache controller that reduces memory fetch latency and guarantees the order of a fetch and a write instruction to the same address.例文帳に追加
メモリフェッチのレイテンシを短縮することができるとともに、同一アドレスに対するフェッチと書き込み命令との順序を保障するキャッシュ制御装置を提供する。 - 特許庁
A core instruction address read from the core instruction cache is compared with the fetch address of a core instruction by a core instruction address comparator 5 and is used to detect a patch object core instruction.例文帳に追加
このコア命令キャッシュから読み出されるコア命令アドレスは、コア命令アドレス比較器５にてコア命令の取り出しアドレスと比較され、パッチ対象コア命令の検出に利用される。 - 特許庁
The comparator 21 outputs an event detection signal S1 when it is in a fetch state and also, the value of the register 25 coincides with an address signal ADDRESS.例文帳に追加
比較器２１は、フェッチ状態で、かつレジスタ２５の値とアドレス信号ＡＤＤＲＥＳＳとが一致したときに、イベント検出信号Ｓ_1 を出力する。 - 特許庁
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