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bit addressとは 意味・読み方・使い方
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意味・対訳 ビットアドレス; ビット・アドレス
「bit address」の部分一致の例文検索結果
該当件数 : 571件
Namely, as the address information, the address AD0 of the first bit is bit '0', while the address AD1 of the second bit is bit '1' and the address AD2 of the third bit is bit '1'.例文帳に追加
すなわち、アドレス情報としては、１ビット目のアドレスＡＤ0がビット「０」であり、２ビット目のアドレスＡＤ1がビット「１」であり、３ビット目のアドレスＡＤ2がビット「１」を示している。 - 特許庁
A decoder 122 generates an address from the 9th bit A8 - the 15th bit A14 of the address bus 140.例文帳に追加
デコーダ１２２は、アドレスバス１４０の第９ビットＡ8 〜第１５ビットＡ14から、アドレスを生成する。 - 特許庁
To prevent an address bit width from increasing even if an address signal increases.例文帳に追加
アドレス信号が増加してもアドレスビット幅が増加しないようにする。 - 特許庁
A Read Address, generated at an Address Counter 2 to count (m+1) bit (=n/X), goes 1 bit ahead a Write Address and a data written in a storage means 3 is output after (m+1)-th bit.例文帳に追加
（ｍ＋１）ｂｉｔ（＝ｎ／Ｘ）をカウントするAddress Counter２で発生されるRead AddressはWrite Addressより１ｂｉｔ進んでおり、記憶手段３に書き込まれたデータは（ｍ＋１）ｂｉｔ後に出力される。 - 特許庁
A routing address generating part 5 exclusively ORs one bit of a routing address as one part of the memory access address and one bit except the routing address of the memory access address for very vector element as a new routing address in place of one bit of the routing address.例文帳に追加
ルーティングアドレス生成部５は、各ベクトル要素毎に、メモリアクセスアドレスの一部であるルーティングアドレスの１ビットとメモリアクセスアドレスのルーティングアドレス以外の１ビットとの排他的論理和をとり、ルーティングアドレスの１ビットと置き換えて新たなルーティングアドレスとする。 - 特許庁
The address and data are transmitted by serial communication bit by bit from the host side to the device side.例文帳に追加
ホスト側からデバイス側にアドレス及びデータを１ビットずつシリアル通信で送信する。 - 特許庁
The N-bit PON port identifier has bits smaller than the M-bit multicast address in number.例文帳に追加
ＮビットＰＯＮポート識別子はＭビットマルチキャストアドレスより少ないビットを有する。 - 特許庁
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「bit address」の部分一致の例文検索結果
該当件数 : 571件
The address areas belonging to the fixed bit length area 4a are provided with bit length (n bits) for one word, and the address areas belonging to the limited bit length areas 4b and 4c are respectively provided with different bit length (m0 bit and m1 bit) shorter than the bit length for one word.例文帳に追加
固定ビット長領域４ａに属するアドレス領域は１ワード分のビット長（ｎビット）を、また制限ビット長領域４ｂ，４ｃに属するアドレス領域は１ワード分よりも短くかつそれぞれ異なるビット長（ｍ_0ビット，ｍ_1ビット）をそれぞれ有する。 - 特許庁
A comparator 23 compares a previous line address bit previously stored in an address latch 25, with a line address bit of the present address stored in the present address latch 19.例文帳に追加
比較器２３は、以前アドレスラッチ２５に記憶された前の行アドレスビットを現在アドレスラッチ１９に記憶された現在アドレスの行アドレスビットと比較する。 - 特許庁
In the memory, an address diving circuit divides an (s+t)-bit internal address signal into an s-bit row address signal and a column address signal having (t) bits (t is smaller than s) by responding to the internal address signal.例文帳に追加
アドレス分配回路が、（ｓ＋ｔ）ビットの内部アドレス信号に応答して、内部アドレス信号を、ｓビットの行アドレス信号と、ｓよりも小さいｔビットの列アドレス信号とに分配する。 - 特許庁
in order to obtain the host's IPv4 address, and returns a value obtained by bit-twiddling the IPv4 address.発音を聞く 例文帳に追加
に渡しホストの IPv4 アドレスを取得して、その IPv4 アドレスのビット入れ替えを行った値を返す。 - JM
Class A This address type is indicated by the value 0 in the most significant bit of the (network byte ordered) address.発音を聞く 例文帳に追加
Class A(ネットワークバイトオーダの) アドレスの最上位ビットが 0 の場合、このアドレス種別となる。 - JM
When erasing the data, the bit of address k in MB0 and the bit of address k+n in MB1 are simultaneously erased.例文帳に追加
データの消去時には、ＭＢ０内のアドレスｋのビットとＭＢ１内のアドレスｋ＋ｎのビットが同時に消去される。 - 特許庁
The second decoder activates bit lines on the basis of the second address.例文帳に追加
第２デコーダは、第２アドレスに基づいてビット線を活性化する。 - 特許庁
The column decoder (10) selects four bit lines per address.例文帳に追加
カラムデコーダ(10)は一アドレス当たりビット線を4本選択する。 - 特許庁
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