「chip enable control」に関連した英語例文の一覧と使い方 - Weblio英語例文検索

An unlock signal transmitted from an external R/W terminal 10 is received by a control chip 4 built in the fit-in part 2a, and according to a control signal sent from the control chip 4, the pin 5b is drawn in and disengaged from the engagement hole 3b to enable access to the keyhole 1a.例文帳に追加

外部のＲ／Ｗ端末機10から発信された解錠信号を嵌入部２ａに内蔵された制御チップ４が受信し、該制御チップ４から送られた制御信号によりピン５ｂが引き込まれて係合穴３ｂから外れ、鍵穴１ａへのアクセスが出来るように構成したことを特徴とする。 - 特許庁

To provide a method, a device, and a program for peripheral apparatus control and a method, a device, and a program for display control, which enable a user to easily confirm contents of setting information by utilizing a tool chip.例文帳に追加

ツールチップを利用することで、ユーザが設定情報の内容を容易に確認することが可能な周辺機器制御プログラム、装置および方法、並びに表示制御プログラム、装置および方法を提供する。 - 特許庁

On a synchronizing mode, for instance, a precharge operation in a core section of a memory device 11 according to a control circuit 12 of the memory device is executed in accordance with a rise of chip enable signal/CE1.例文帳に追加

たとえば、同期モード時においては、チップイネーブル信号／ＣＥ１の立ち上がりに応じて、メモリ装置の制御回路１２による、メモリ装置１１のコア部のプリチャージ動作を実行する。 - 特許庁

When the computer is powered ON, a POST program is executed and in the setting which makes the security function effective, an RFID chip 33 holds Removal Detect Enable at high level and outputs it to the control side of an analog switch 67 and one input side of a NAND element 63.例文帳に追加

コンピュータの電源投入で、ＰＯＳＴプログラムが実行され、セキュリティ機能を有効にする設定で、ＲＦＩＤチップ３３は、Removal Detect Enableをハイレベルにしアナログスイッチ６７の制御側及びＮＡＮＤ素子６３の一方の入力側に出力する。 - 特許庁

To provide a device controller in which a CPU efficiently controls each control device in a device, which operates according to a control program from the CPU, even if an I/F signal to the CPU is minimum signal line only (for example, a set of address bus, data bus, write enable, read enable and chip-selector).例文帳に追加

共通バスＩ／Ｆに複数のデバイスが接続されている制御装置において、どのデバイスを制御するかを決定するとき、ＣＰＵから送出されるアドレス信号の上位をチップセレクタ回路でデコードすると、チップセレクト信号は共通バスＩ／Ｆに流れる信号と非同期であるので、制御不可能となる場合が生じる。 - 特許庁

To enable camera movement control system of a chip-bonding device to be very accurately and efficiently calibrated, without being affected by mechanical deformations and temperature change in an environmental atmosphere.例文帳に追加

チップボンディング装置におけるカメラ移動制御系のキャリブレーションに関し、メカ的な変形及び環境雰囲気の温度変化に影響されずに高精度に、しかも、効率的に行うことができるようにする。 - 特許庁

A pseudo SRAM is provided with an ATD circuit 3 detecting each of transition of an external chip-enable signal/CE, address signals ADx, ADy, and an external write-enable signal/WE, and a control circuit controlling access of a memory cell array based on a detected result of this ATD circuit 3.例文帳に追加

擬似ＳＲＡＭに、外部チップイネーブル信号／ＣＥ、アドレス信号ＡＤｘ，ＡＤｙ及び外部ライトイネーブル信号／ＷＥの遷移をそれぞれ検知するＡＴＤ回路３と、このＡＴＤ回路３の検知結果に基づきメモリセルアレイのアクセスを制御する制御回路とを設けている。 - 特許庁

When the RAM-BIST control circuit 101 is operated by a logical simulator 100 to check the RAM macro 102, an address, input data, chip enable and write enable generated by the RAM-BIST control circuit 101 are monitored by an RAM checking area verifying circuit 104, and the decision of an area to be checked is executed in every test sequence.例文帳に追加

論理シミュレータ１００によりＲＡＭ−ＢＩＳＴ制御回路１０１を動作させてＲＡＭマクロ１０２を検査する際に、ＲＡＭ−ＢＩＳＴ制御回路１０１が生成するアドレス、入力データ、チップイネーブル、ライトイネーブルをＲＡＭ検査領域検証回路１０４でモニタし、テストシーケンスごとに被検査領域の判定を行う。 - 特許庁

A sequence flag monitoring part 41 detects the assert of a status check signal and notifies a buffer control part 42 of the detection, and the buffer control part 42 disables a buffer, and generates a bus access by controlling chip enable, output enable and address bus, and reads a sequence flag inside a flash memory, and starts the monitor of automatic erasing operation executing circumstances.例文帳に追加

シーケンスフラグ監視部４１はステータスチェック信号のアサートを検出したことをバッファ制御部４２に通知し、バッファ制御部４２によってバッファをディセーブルし、チップイネーブル、アウトプットイネーブル、アドレスバスを制御することによってバスアクセスを生成してフラッシュメモリ内部のシーケンスフラグをリードし、自動消去動作実行状況の監視を開始する。 - 特許庁

Access to the memories MEM1-MEMn is controlled by controlling a test sequence of the memories MEM1-MEMn by a test sequence control part 1 according to the test sequence setting from the outside, and by enabling/disabling chip enable signals CE1-CEn by a memory access control part 2 according to instructions from the test sequence control part 1.例文帳に追加

テストシーケンス制御部１が、外部からのテストシーケンス設定に従ってメモリＭＥＭ１〜ＭＥＭｎのテストシーケンスを制御し、メモリアクセス制御部２が、テストシーケンス制御部１からの指示に従ってチップイネーブル信号ＣＥ１〜ＣＥｎの有効／無効を切り替え、メモリＭＥＭ１〜ＭＥＭｎへのアクセスを制御する。 - 特許庁

A selector 150 is arranged inside an LSI chip 100, and a plurality of signals S1 and S5 are monitored by time sharing by switching the selector 150 by using an existing control signal (ENABLE) for switching operation of an inside circuit (a compression comparator 130).例文帳に追加

ＬＳＩチップ１００の内部にセレクタ（１５０）を設け、内部回路（圧縮比較器１３０）の動作を切り替えるための、既存の制御信号（ＥＮＡＢＬＥ）を用いてセレクタ（１５０）を切り替え、複数の信号（Ｓ１，Ｓ５）を時分割でモニタする。 - 特許庁

In an outside address EAD<1:0> input part to which a signal is inputted through a page address input part P1, an initial stage buffer G21 of four stages series (G21 to G24) connection constitution receives the outside address EAD<1:0>, and an inversion control input receives an inside chip enable signal #ICE.例文帳に追加

ページアドレス入力部Ｐ１を介して入力される外部アドレスＥＡＤ＜１：０＞入力部において、４段直列（Ｇ２１〜Ｇ２４）接続構成の初段のバッファＧ２１は外部アドレスＥＡＤ＜１：０＞を受け、反転制御入力に内部チップイネーブル信号＃ＩＣＥを受ける。 - 特許庁

To obtain a voltage regulator and a voltage regulator control method which enhance an output current supply capacity to shorten an output delay time when an output voltage Vout rises by rise of a power supply voltage, rise of a chip enable signal, or the like at the time of power-on.例文帳に追加

電源投入時等の電源電圧の立ち上がりやチップイネーブル信号の立ち上がり等による出力電圧Ｖｏｕｔの立ち上がり時に、出力電流供給能力を大きくし出力遅延時間を短縮することができるボルテージレギュレータ及びボルテージレギュレータの制御方法を得る。 - 特許庁

A current restriction control circuit 9 is provided which cuts off an output signal from a current restriction circuit 8 which restricts an output current, to an output transistor 2 for a prescribed time Ta after input of a chip enable signal CE which activates an operational amplifier 3 for conducting operation control of the output transistor 2.例文帳に追加

出力トランジスタ２の動作制御を行う演算増幅器３を活性化状態にするチップイネーブル信号ＣＥが入力されてから所定時間Ｔａの間、出力トランジスタ２に対して出力電流の制限を行う電流制限回路８からの出力信号を遮断する電流制限制御回路９を備えるようにした。 - 特許庁

This voltage regulator is provided with a current limit control circuit 9 which cuts off the output signals transmitted from a current limit circuit 8 limiting the output current to an output transistor Tr 2 for a prescribed time Ta after a chip enable signal CE is inputted to activate an arithmetic amplifier 3 that controls the operation of the Tr 2.例文帳に追加

出力トランジスタ２の動作制御を行う演算増幅器３を活性化状態にするチップイネーブル信号ＣＥが入力されてから所定時間Ｔａの間、出力トランジスタ２に対して出力電流の制限を行う電流制限回路８からの出力信号を遮断する電流制限制御回路９を備えるようにした。 - 特許庁