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SLN-1とは 意味・読み方・使い方

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遺伝子名称シソーラスでの「SLN-1」の意味

SLN-1

mouse遺伝子名SLN-1
同義語(エイリアス)matrix metallopeptidase 3; Stromelysin-1 precursor; stromelysin 1; Transin-1; stromelysin-1; EMS-2; Matrix metalloproteinase-3; Stmy1; SL-1; Str1; SLN1; MMP-3; progelatinase; Mmp3
SWISS-PROTのIDSWISS-PROT:P28862
EntrezGeneのIDEntrezGene:17392
その他のDBのIDMGI:97010
yeast遺伝子名SLN1
同義語(エイリアス)Osmolarity two-component system protein SLN1; YPD2; YIL147C
SWISS-PROTのIDSWISS-PROT:P39928
EntrezGeneのIDEntrezGene:854659
その他のDBのIDSGD:S000001409

本文中に表示されているデータベースの説明

SWISS-PROT
スイスバイオインフォマティクス研究所欧州バイオインフォマティクス研究所によって開発運営されているタンパク質アミノ酸配列データベース
EntrezGene
NCBIによって運営されている遺伝子データベース染色体上の位置配列発現構造機能、ホモロジーデータなどが含まれている
MGI
様々なプロジェクトによる研究マウス遺伝的生物学的なデータを提供するデータベース
SGD
スタンフォード大学医学部運営されている出芽酵母の一種Saccharomyces cerevisiae生態遺伝子情報に関するデータベース

「SLN-1」の部分一致の例文検索結果

該当件数 : 4



例文

The data voltage source Vdata applies a positive voltage to data lines DL1 to DLm and the first and second scan voltage sources Vin1 to Vin2 apply a negative voltage and a positive voltage to scan lines SL1 to SLn.例文帳に追加

データ電圧源Vdataは、データラインDL1〜DLmに正極性電圧を印加し、第1および第2スキャン電圧源Vin1〜Vin2は、スキャンラインSL1〜SLnに負極性電圧および正極性電圧を印加する。 - 特許庁

In an active matrix type liquid crystal display device 1, a coupling signal S0 corresponding to the sum total of outputs of all data signal lines SL1 to SLn is detected by a detection bus line 12 crossing data signal lines SL1 to SLn.例文帳に追加

アクティブマトリクス型の液晶表示装置1において、データ信号線SL_1 〜SL_n に交差する検出用バスライン12によって、全データ信号線SL_1 〜SL_n の出力の総和に応じたカップリング信号S0が検出される。 - 特許庁

As the result, an influence which accords with the variance in potential of the common electrode Tcom due to outputs of data signal lines SL1 to SLn and is in the direction opposite to this variance is exerted by the common electrode signal Vcom to prevent a lateral shadow caused by these outputs.例文帳に追加

この結果、共通電極信号Vcomによって、データ信号線SL___1 〜SL_n の出力に起因する共通電極T_com の電位変動に応じ、かつ、当該変動とは逆方向の影響が与えられ、上記出力に起因する横シャドーを防止できる。 - 特許庁

例文

A selector 4 is controlled to select pixel data which are transmitted from the DMA controller 3 and inputted to a '0' side terminal or pixel data which are fed back from the line memory 5 and inputted to the '1' side terminal in accordance with the level of a line signal SLN inputted from the resolution conversion part 6 and to output it to the line memory 5.例文帳に追加

セレクタ4は、解像度変換部6から入力するライン信号SLNのレベルに応じて、DMAコントローラ3から伝達され「0」側端子に入力する画素データと、ライン・メモリ5から帰還して「1」側端子に入力する画素データとの何れかを選択してライン・メモリ5に出力するよう制御される。 - 特許庁

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