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bit scanとは 意味・読み方・使い方
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「bit scan」の部分一致の例文検索結果
該当件数 : 37件
This circuit is equipped with a plurality of boundary scan chains 8A-8C to which a plurality of boundary scan cells 81-92 are connected, in each bit in parallel.例文帳に追加
複数のバウンダリスキャンセル81〜92が接続されたバウンダリスキャンチェーン8A〜8Cをビットごとに複数並列的に備える。 - 特許庁
NOR FLASH MEMORY APPARATUS USING BIT SCAN SYSTEM, AND RELATED PROGRAMMING METHOD例文帳に追加
ビットスキャン方式を使用するNORフラッシュメモリ装置及びそれのプログラム方法 - 特許庁
When the scan clock signal SCK (k) is supplied, the scan clock signal SCK (k) is supplied sequentially from the scan flip-flop SFF*, and thus the scan flip-flop SFF and SFF* can be properly acted as an n-bit shift register implementing sequentially the shift action from the scan flip-flop SFF*.例文帳に追加
スキャンクロック信号SCK(k)を供給する際にスキャンフリップフロップSFF*から順にスキャンクロック信号SCK(k)を供給して、スキャンフリップフロップSFF,SFF*をスキャンフリップフロップSFF*から順にシフト動作するnビットのシフトレジスタとして機能させる。 - 特許庁
Also, the output registers 9, 18 are constituted of flip-flop with scan, and flip-flop with scan constitutes scan path for the bit of random access memories 6, 15 having the same address constitution.例文帳に追加
また、出力レジスタ9,18は、スキャン付きフリップフロップで構成され、スキャン付きフリップフロップはアドレス構成が同一のランダムアクセスメモリ6,15のビットについてスキャンパスを構成する。 - 特許庁
The inverse scan section 121 arrays a plurality of coefficients, which constitutes decoded variable-length data generated from the bit stream of encoded data, in a predetermined scan order to generate inverse scan data.例文帳に追加
逆スキャン部121は、符号化データのビットストリームから生成される復号可変長データを構成する複数の係数を所定のスキャン順に並べて逆スキャンデータを生成する。 - 特許庁
A line which reads bit map data is switched in response to a position of a scan direction so that a bending of the scan line is offset with respect to a print part 107 having the scan line having the bending.例文帳に追加
曲がりがある走査ラインを持つ印刷部107に対して、走査ラインの曲がりを相殺するようにビットマップデータを読み出すラインを走査方向の位置に応じて切り替える。 - 特許庁
The scan chain gives respective bits to a multi-bit status storage data language to store them in the memory via the system buses.例文帳に追加
スキャン・チェーンはそれぞれのビットを多ビット状態保存データ語に与え、システム・バスを介してメモリに記憶する。 - 特許庁
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「bit scan」の部分一致の例文検索結果
該当件数 : 37件
To provide a NOR flash memory apparatus using a bit scan system, and related programming method.例文帳に追加
本発明はビットスキャン方式を使用するNORフラッシュメモリ装置及びそれのプログラム方法に関する。 - 特許庁
A check board 20 is provided with a bit generating memory 21 for storing specified patters corresponding to respective combinations of scan signals.例文帳に追加
チェックボード20には、スキャン信号の組み合わせ各々に対応付けられた特定のパターンを記憶するビット発生メモリ21が設けられる。 - 特許庁
A pass/fail judging circuit 14 judges pass/fail of a pattern obtained by supplying a scan signal to the bit generating memory 21.例文帳に追加
スキャン信号をビット発生メモリ21に供給して得られるパターンのパス/フェイルをパス/フェイル判定回路14で判定する。 - 特許庁
The semiconductor storage device is provided with: a first bit cell 10T and a second bit cell 10B for storing mutual complementary data; a scan circuit for outputting a selected data signal; a bit cell selection circuit 14 for receiving the output of the scan circuit and for selecting one bit cell; and a data writing control circuit 53 for controlling the data writing.例文帳に追加
半導体記憶装置は、互いに相補的なデータを記憶するための第1のビットセル10Tおよび第2のビットセル10Bと、選択されたデータ信号を出力するスキャン回路と、スキャン回路の出力を受け、1つのビットセルを選択するビットセル選択回路14と、データの書き込みを制御するデータ書き込み制御回路53とを備えている。 - 特許庁
Additionally, in response to the scan operation instruction, a scan operation is performed on a sequence of single-bit values using a parallel processor architecture with a plurality of processing elements.例文帳に追加
さらに、スキャン演算命令に応答して、スキャン演算が、複数の処理要素を備えた並列プロセッサアーキテクチャを使用して、単一ビット値のシーケンスに対して実施される。 - 特許庁
In a step S804, the data of an EFM_BIT_CNT register is read, and the maximum scan width is added to the data of the register in order to surely ensure the length of a data frame.例文帳に追加
ステップS804において、EFM_BIT_CNTレジスタのデータを読み込み、データフレームの長さを確かに保証するために、そのレジスタのデータに最大スキャン幅を加える。 - 特許庁
In an electronic document production system, a character image layer LC is generated in which a character image in a scan image is represented with a predetermined bit value (e.g., one bit) and an edge image of the character image is produced.例文帳に追加
電子文書生成システムは、スキャン画像における文字画像を所定ビット値(例えば1ビット)で表現する文字画像レイヤLCを生成するとともに、当該文字画像のエッジ画像を生成する。 - 特許庁
The divided writing operation can be realized by making the write path for all the bit cells to store "0" be non-selected, and by performing the writing of only the bit cell units to store "1" that is selected by the scan circuit.例文帳に追加
「0」を記憶させる全ビットセルのWriteパスを非選択にし、スキャン回路で選択された「1」を記憶させるビットセル単体のみ書き込みを行うことで、分割書き込み動作が実現できる。 - 特許庁
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