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Binary clockとは 意味・読み方・使い方
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意味・対訳 左:デジタル時計右:BCD形式のバイナリークロック 時刻は左の時計と同じ12:15:45。
「Binary clock」の部分一致の例文検索結果
該当件数 : 59件
The binary decision circuits 5, 6, 7 apply binary decision to the received signal in synchronism with the produced clock and outputs its decision result.例文帳に追加
各2値判定回路5,6,7は、生成クロックに同期して受信信号の2値判定を行ないその判定結果を出力する。 - 特許庁
A clock recovery circuit 140 reproduces a clock CLK from a binary serial signal Sb generated in this way.例文帳に追加
クロックリカバリ回路140は、このようにして生成された二値シリアル信号Sbから、クロックCLKを再生する。 - 特許庁
An apparatus for freely analyzing information of a disk comprises a binary circuit 6 for generating a binary signal by receiving an HF signal from an optical disk reproducing apparatus 1, an integration circuit 9 as a decoder circuit to receive the binary signal and a read clock signal generating circuit 7 for branching the binary signal, converting it to the clock signal and then inputting the clock signal to the integration circuit 9.例文帳に追加
光ディスク再生装置1からHF信号を取り出して2値化する2値化回路6と、2値化された信号を入力するデコーダ回路である集積回路9と、2値化された信号を分岐し読み取りクロック信号に変換して集積回路9に入力する読み取りクロック信号発生回路7とを備えている。 - 特許庁
The oscillator receives the clock signal of a first frequency, which clocks the operation of the oscillator and a binary word (Nb) of several bits at one input, and supplies to one output the binary word and output signal of a frequency which is determined as the function of the binary word and the clock signal.例文帳に追加
発振器は、1つの入力に、発振器の動作をクロックする第1周波数のクロック信号といくつかのビットの2進ワード(Nb)とを受信し、1出力に、2進ワードとクロック信号の関数として決定された周波数の出力信号を提供する。 - 特許庁
The noise cancel circuit is equipped with an output buffer 20 which outputs a 1st binary signal capable of varying in synchronism with a clock signal 26 and an output buffer 21 which varies and outputs a 2nd binary signal when the 1st binary signal does not vary in the timing or outputs the 2nd binary signal without varying it when the 1st binary signal varies in the timing.例文帳に追加
クロック信号26に同期したタイミングで変化しうる第1の2値信号を出力する出力バッファ20と、このタイミングにおいて第1の2値信号が変化しない場合には第2の2値信号を変化させて出力し、このタイミングにおいて第1の2値信号が変化する場合には第2の2値信号を変化させずに出力する出力バッファ21と、を備える。 - 特許庁
With a binary switching command K corresponding to an instruction to be executed, one of those clock signals (CK-ext and CK-al) is used as a base for clock generation and an internal clock signal (CK-in) is obtained according to the one of them.例文帳に追加
実行されるべき命令に応じた2進切換指令Kによって、これらのクロック信号(CK-ext,CK-al)の何れか一方がクロック生成のベースにされ、これに対応して、内部クロック信号(CK-in)が得られる。 - 特許庁
A reproduced signal SP is converted into a binary signal of 1, 0 by a binarizing circuit 81, a clock signal PCK is reproduced by PLL circuits 82-84 referring to this binary signal.例文帳に追加
二値化回路81で再生信号SPを1,0の二値信号に変換し、この二値信号を参照して、PLL回路82〜84で、クロック信号PCKを再生する。 - 特許庁
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ウィキペディア英語版での「Binary clock」の意味 |
Binary clock
出典:『Wikipedia』 (2011/04/17 11:27 UTC 版)
「Binary clock」の部分一致の例文検索結果
該当件数 : 59件
For example, the output of the subtracter 105 is compared with a threshold Vref=0 and the comparison result (binary output) is sampled at an arbitrary clock CLK to generate a binary random number sequence of 0 and 1.例文帳に追加
例えば、差分器105の出力を、閾値Vref=0と比較し、比較結果(2値出力)を任意のクロックCLKでサンプリングして、0,1の2値の乱数列を生成する。 - 特許庁
The binary signal is latched by the clock signal PCK in a D flip-flop 85 and reproduced data are obtained.例文帳に追加
Dフリップフロップ85で、二値信号をクロック信号PCKでラッチして再生データDPを得る。 - 特許庁
Binary image data D2 are inputted as a serial signal synchronized with a pixel clock and are converted into sexadecimal data D16.例文帳に追加
2値の画像データD_2を画素クロックに同期したシリアル信号として入力し、16値データD_16に変換する。 - 特許庁
To simplify circuit structure by transmission of a binary down signal which simultaneously detects data and clock and to reduce design constraint of a sensor.例文帳に追加
データ及びクロックの同時検出を可能とする2値の下り信号の送信により回路構成を簡単にし、感知器の設計制約を低減する。 - 特許庁
An analog RF signal is converted to binary data (PDM data) by using a comparator 20 via a low-pass filter 10, a system clock is generated from the binary data by using PLL circuits 30, 40 of two-step constitution, and decoding the PDM data is performed with a PDM decoder 70 by using the system clock.例文帳に追加
アナログRF信号をローパスフィルタ10を経てコンパレータ20で2値データ(PDMデータ)に変換し、この2値データから2段構成のPLL回路30、40でシステムクロックを生成し、このシステムクロックを用いてPDMデコーダ70でPDMデータのデコードを行う。 - 特許庁
A demodulation circuit 13 uses the reproduced clock to generate demodulation data from binary data with the half period of the reproduced clock as a signal processing unit, that is, perform decoding.例文帳に追加
復調回路13は、この再生クロックを用いて、この再生クロックの半周期を信号処理単位として2値化データから復調データの生成、つまり復号化を行う。 - 特許庁
The binary equalized data signal outputted from a limiter amplifier 4 and a clock extracted by a clock extracting circuit 6 are inputted to a jitter detecting circuit 7.例文帳に追加
リミッタアンプ4から出力された2値化等化データ信号と、クロック抽出回路6で抽出されたクロックとはジッタ検出回路7に入力される。 - 特許庁
The binary data stored in the register 15 expresses a time axis-directional swinging amount of an edge of the measured clock, i.e., an amplitude amount of the jitter of the measured clock.例文帳に追加
このレジスタ15に格納される2進数データは、被測定クロックのエッジの時間軸方向のゆれの量、すなわち被測定クロックのジッタの振幅量を表す。 - 特許庁
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