FLIP-Sとは 意味・読み方・使い方
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意味・対訳 FLICE抑制タンパク質
「FLIP-S」の部分一致の例文検索結果
該当件数 : 31件
A start signal S and a clock signal CK are inputted to the D flip-flop 41.例文帳に追加
Dフリップフロップ41にはスタート信号S、クロック信号CKが入力される。 - 特許庁
An OR circuit Z1 and an AND circuit Z2 feedback the output of the flip-flop FF3 of the last stage to the flip-flop of the first stage in accordance with a control signal S and outputs of flip-flops FF3 to FF5.例文帳に追加
OR回路Z1,AND回路Z2は、制御信号S、フリップフロップFF3〜FF5の出力に応じて、最終段のフリップフロップFF3の出力を1段目のフリップフロップFF1にフィードバックする。 - 特許庁
An output signal of a comparator 16 is inputted to an SR type flip flop 17 from a set terminal S, and a reset signal is inputted to the flip flop 17 from a reset terminal R.例文帳に追加
SR型フリップフロップ17は、コンパレータ16の出力信号をセット端子Sから入力し、リセット信号をリセット端子Rから入力する。 - 特許庁
Set and reset flip flop operations are executed by the set light pulse S and the set light pulse R, in the optical SR flip flop 101, and an output light Q is obtained therein.例文帳に追加
光SRフリップフロップ101では、セット光パルスSとリセット光パルスRにより、セットリセットフリップフロップ動作が行われ、出力光Qが得られる。 - 特許庁
Input terminals of the D flip-flops 2, 5 and 11 are connected to inverted output terminals of the D flip-flops 1, 4 and 10 in the former steps respectively so that '0's are output after the occurrence of the gray code until the appearance of the periodicity.例文帳に追加
また、グレイコードが発生されてから上記の周期性が現れるまで‘0’を出力するために、Dフリップフロップ2,5,11の入力と前段のDフリップフロップ1,4,10の反転出力端とを接続する。 - 特許庁
A D flip-flop 50 latches the composite synchronizing signal CS by the pulse P3 to generate a polarity discriminating signal S.例文帳に追加
Dフリップフロップ50はコンポジット同期信号CSを第3タイミングパルスP3でラッチして極性判別信号Sを生成する。 - 特許庁
The control circuit of the power supply device includes N-pieces of RS flip-flops FF-1 to RS flip-flops FF-N which include set terminals S and reset terminals R and control the start of the power supply circuits by connecting the power supply circuits to output terminals Q.例文帳に追加
セット端子Sとリセット端子Rとを有し、出力端子Qに各々の電源回路を接続して各々の前記電源回路の動作の開始を制御するN個のアールエスフリップフロップFF−1〜アールエスフリップフロップFF−Nを備える。 - 特許庁
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該当件数 : 31件
An RF signal, passing through an integrator 102 and a signal at a slider of a potentiometer 30, is given to a double-slope comparator, its two outputs are given to an S-R flip-flop 110 via a pulse generator 10, and the output of the flip-flop 110 is outputted to an antenna via a succeeding power amplifier.例文帳に追加
積分器102を通ったRF信号と、ポテンショメータ30の信号が、二重傾斜比較器に入力されて、その2出力からパルス発生器108を経由して、S−Rフリップフロップ110に入力され、後続の電力増幅器からアンテナへ出力される。 - 特許庁
An R-S flip-flop 5 generates binarizing signals 108 which one free of the influence of hazards and glitches, on the basis of either the latching signal 106 or 107.例文帳に追加
R−Sフリップフロップ5は、ラッチ信号106又は107に基づいて、ハザード又はグリッチによる影響の無い2値化信号108を発生する。 - 特許庁
In the oscillation circuit of the Fig. 1, a high-level signal is inputted to a S terminal of a RS flip-flop circuit 108 when a voltage V1 of a first capacitor 102 is higher than a reference voltage Vst.例文帳に追加
図1の発振回路において、RSフリップフロップ回路108のS端子には、第1のコンデンサ102の電圧V1が基準電圧Vstより高くなると、ハイレベルの信号が入力される。 - 特許庁
A second arc controller 122 is provided with a retainer 123, a mono-stable circuit 124, an R-S flip-flop circuit 125, and an on-delay timer 126.例文帳に追加
第2のアーク制御器122は、保持器123、モノステーブル回路124,R−Sフリップフロップ回路125およびオンディレイタイマー126を備える。 - 特許庁
This phase comparator circuit 10 is provided with 3 S-R flip-flop circuits 1-3, each consisting of two NAND gates, NAND gates G1-G6 and inverters IV1-IV6.例文帳に追加
本発明の位相比較回路10は、それぞれ2個のNANDゲートからなる3個のS−Rフリップフロップ1〜3と、NANDゲートG1〜G6と、インバータIV1〜IV6とを備えている。 - 特許庁
In the flip-flop circuit FF2 for state holding, the output of a comparator LTC is supplied to a set terminal S.例文帳に追加
状態保持用のフリップフロップ回路FF2は、リセット端子RにコンパレータVCC_L2の出力が供給され、セット端子SにコンパレータLTCの出力が供給されている。 - 特許庁
A flip-flop 151 turns the FET 140 off when a reset signal R is input, and turns the FET 140 on when a set signal S is input.例文帳に追加
フリップフロップ151は、FET140を、リセット信号Rを入力したときにオフさせ且つセット信号Sを入力したときにオンさせる。 - 特許庁
When the rising edge of a digital signal A supplied to an input terminal A is detected, a rising edge detection circuit 101 outputs a pulse signal to the S terminal of an RS flip flop 103.例文帳に追加
立ち上がりエッジ検出回路101は、入力端子Aに供給されたデジタル信号Aの立ち上がりエッジが検出された時にパルス信号を、RSフリップフロップ103のS端子に出力する。 - 特許庁
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