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latched data
「latched data」の部分一致の例文検索結果
該当件数 : 234件
Storage data read in parallel are latched to a read data latch circuit.例文帳に追加
並列に読出された記憶データは、読出データラッチ回路にラッチされる。 - 特許庁
The latch latches a normal-data signal received and outputs the latched normal-data signal.例文帳に追加
ラッチ部は受信した正常データ信号をラッチして出力する。 - 特許庁
In this case, the output encoder pulse data are latched.例文帳に追加
この際に、出力したエンコーダパルスのデータをラッチしておく。 - 特許庁
Data of the fuse arrays are respectively transferred to and latched by data latch circuits 9a, 9b.例文帳に追加
各フューズアレイのデータは、それぞれデータラッチ回路9a,9bに転送保持される。 - 特許庁
One or more data signals received from the transmitter are latched using the clock signal.例文帳に追加
そのクロック信号を使用して送信装置から受け取った1つまたは複数のデータ信号をラッチする。 - 特許庁
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「latched data」の部分一致の例文検索結果
該当件数 : 234件
A data signal is latched by the timing of the clock signal C1 subjected to delay control.例文帳に追加
この遅延制御されたクロック信号C1のタイミングによりデータ信号をラッチする。 - 特許庁
The head temperature data latched by the latch circuit is outputted to the recorder.例文帳に追加
そして、そのラッチ回路によりラッチされたヘッド温度データを記録装置に出力する - 特許庁
Read-out data Qn outputted from the memory core 50 is latched by a latch circuit 70.例文帳に追加
メモリコア50から出力される読出データQnは、ラッチ回路70によってラッチされる。 - 特許庁
The latched specification data Dx is supplied to an amplitude control circuit 540.例文帳に追加
ラッチされた指定データDxは、振幅制御回路540に供給される。 - 特許庁
In a case except this case, the data latched in the latch circuit L1 is written into only the selection cell.例文帳に追加
これ以外の場合には、選択セルにのみラッチ回路L1にラッチされているデータを書き込む。 - 特許庁
The color data latched in the register 111 are written to an image frame memory 33.例文帳に追加
画像フレームメモリ33には、レジスタ111に格納されている色データが書き込まれる。 - 特許庁
The serial data from the signal line are sequentially latched on the basis of the clock signal SCK and the latched serial data are converted into parallel data RXD 0-7 on the basis of the load signal RXLD.例文帳に追加
前記信号線からの前記シリアルデータをクロック信号SCKに対応して順次ラッチし、ラッチした前記シリアルデータをロード信号RXLDに基づいてパラレルデータRXD0〜7に変換する。 - 特許庁
The receiving circuit 40 includes a selecting circuit S1 which selects the starting data latched at the starting leading edge of a first delay signal DQS1 and the third data latched at the second leading edge of a second delay signal DQS2.例文帳に追加
受信回路40は、第1遅延信号DQS1の先頭立ち上がりエッジでラッチした先頭データと、第2遅延信号DQS2の2番目の立ち上がりエッジでラッチした3番目のデータを選択する選択回路S1を含む。 - 特許庁
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