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準同期式回路の英語
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「準同期式回路」の部分一致の例文検索結果
該当件数 : 13件
同期式半導体メモリ装置及びその基準信号発生回路例文帳に追加
SYNCHRONOUS SEMICONDUCTOR MEMORY AND REFERENCE SIGNAL GENERATING CIRCUIT THEREFOR - 特許庁
工程条件の変化やノイズの影響を最小化する基準信号発生回路とこれを備える同期式半導体メモリ装置を提供する。例文帳に追加
To provide a reference signal generating circuit minimizing effects of the change of a processing condition and noise, and to provide the synchronous semiconductor memory having the same. - 特許庁
データの転送基準となるデータ転送基準信号と、該データ転送基準信号と対になって転送される転送データとで行う非同期データ転送方法において、論理合成ツールの使用方法を単純化し、同期式回路の様なタイミング要素を切り離した検証を可能とする。例文帳に追加
To permit verification wherein a timing element like a synchronous circuit is disconnected by simplifying a method of using a logic composing tool, as to an asynchronous data transfer method using a data transfer reference signal as transfer reference for data and transfer data transferred in a pair with the data transfer reference signal. - 特許庁
アンテナ1、2からの信号がフロントエンド回路3を通じてデマルチプレクサ4に供給され、分離された映像信号が画像デコーダ6、同期情報書き込み回路8、遅延回路9、混合器10を通じて標準方式のエンコーダ11に供給される。例文帳に追加
A signal from antennas 1 and 2 is supplied to a demultiplexer 4 through a front-end circuit 3 and a separated picture signal is supplied to a standard system encoder 11 through an image decoder 6, a synchronization information writing circuit 8, a delay circuit 9 and a mixer 10. - 特許庁
また、水晶発振器29がPAL方式に準拠したものである場合は、セレクタ15の周波数切替信号CLKSELを「0」に設定し、同期信号発生回路21の方式切替信号NPSELを「1」に設定してビデオ信号処理回路14を動作させる。例文帳に追加
In the case the crystal oscillator 29 is in compliance with the PAL system, the frequency switching signal CLKSEL of the selector 15 is set to '0' and the system switching signal NPSEL of the synchronizing signal generating circuit is set to '1' to activate the video signal processing circuit 14. - 特許庁
水晶発振器29がNTSC方式に準拠したものである場合は、セレクタ15の周波数切替信号CLKSELを「0」に設定し、同期信号発生回路21の方式切替信号NPSELを「0」に設定してビデオ信号処理回路14を動作させる。例文帳に追加
In the case a crystal oscillator 29 is in compliance with the NTSC system, a frequency switching signal CLKSEL of a selector 15 is set to '0' and a system switching signal NPSEL of a synchronizing signal generating circuit is set to '0' to activate a video signal processing circuit 14. - 特許庁
読出増幅器3からのX線画像信号を、映像信号重畳回路8でTV標準走査方式のTVフレーム同期信号に重畳させて、アナログビデオ信号として出力する。例文帳に追加
A video signal superimposing circuit 8 superimposes an X-ray image signal from a read amplifier 3 to a TV frame synchronizing signal of the TV standard scanning system and provides the output of an analog video signal. - 特許庁
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「準同期式回路」の部分一致の例文検索結果
該当件数 : 13件
基準バースト信号レベルが復調器所要のレベルであるかレベルウインドウを持って判定し、レベルウインドウ内に基準バースト信号レベル相関が入るように入力段非同期式AGC制御回路38を制御し、そのゲインで保持する。例文帳に追加
Whether a reference burst signal level is a demodulator required level or not is determined with a level window, an input stage asynchronous automatic gain control circuit 38 is controlled so that the reference burst signal level correlation falls within the level window, and is held at its gain. - 特許庁
この復調装置では、受信装置側の一般に用いられるベースバンド形準同期方式の復調動作を行う直交復調器11に対し、復調信号の歪み量に応じて適応動作により歪み補償を行う歪み補償回路を設けている。例文帳に追加
The demodulator is provided with a distortion compensation circuit for applying distortion compensating by an adaptive operation according to distortion of a demodulation signal to an orthogonal demodulator 11 conventionally used by a receiver side and conducting demodulation of the base band type quasi- synchronization system. - 特許庁
並列データチャネル毎に独立にクロックデータリカバリー回路によるタイミング抽出を行わず、同一クロック源から生成される複数の並列データ信号を、データ信号からクロックデータリカバリー回路を用いて抽出した単一のクロック信号を基準に、フレーム同期方式を用いてリタイミング処理する。例文帳に追加
A timing extraction is not carried out by a clock data recovery circuit independently in each parallel data channel, and a plurality of parallel data signals produced from the same clock source are subjected to a re-timing process by use of a frame synchronizing system on the basis of a single clock signal extracted by using the clock data recovery circuit from a data signal. - 特許庁
基準発振器と、位相周波数検出器、チャージポンプ、リング発振器および分周器を備えた位相同期ループ回路とを有し、前記基準発振器は、前記位相周波数検出器に周波数制御のために接続されている形式の高周波発振器において、前記リング発振器を、2つの遅延セル増幅器(A1,A2)を有する対称型の遅延セル発振器にすることで解決される。例文帳に追加
In the high frequency oscillator, with which a reference oscillator is connected to a phase frequency detector for frequency control, having the reference oscillator, the phase frequency detector, a charge pump, a ring oscillator and a phase-locked loop circuit provided with a frequency divider, the ring oscillator is made a symmetric delay cell oscillator having two delay cell amplifiers (A1 and A2). - 特許庁
同期整流方式の直流−直流変換(DC−DC)制御回路20において,電圧制御用の誤差増幅器21は,直流−直流変換結果の出力電圧から得られる入力信号と,複数の基準電圧の低電位側の入力信号との誤差を増幅し,この出力に基づいてパルス幅変調による電圧制御を行う。例文帳に追加
In the DC-DC conversion control circuit 20 of a synchronous rectifying system, an error amplifier 21 for voltage control amplifies an error between an input signal obtained from the output voltage of the result of the DC-DC conversion and input signals at low potential sides of a plurality of reference voltages, and performs voltage control by modulating a pulse width based on the output of the amplification. - 特許庁
フレーム形式で伝送されたラインデータからクライアントデータを取り出して一時的にデマッピングFIFO12に蓄え、このデマッピングFIFO12へのデータの書き込み頻度に対応して位相同期ループによりクライアントデータのクロックを再生して、デマッピングFIFO12からクライアントデータを読み出す構成において、ラインデータに含まれるヘッダ領域やエラー訂正領域によって書き込み周期にギャップがあるため、データの書き込み周期を位相比較の基準としてクロックを再生するのでは、回路が複雑となる。例文帳に追加
To provide phase comparison signals without variations of a phase cycle even when there is a gap in client signals on the write side and to set a phase comparison cycle by a threshold, by using cyclic signals corresponding to a client data amount estimated to be stored in a demapping FIFO as the phase comparison signals being the phase reference of a phase locked loop for reproducing a client clock. - 特許庁
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