a MOSとは 意味・読み方・使い方
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意味・対訳 エイモス、アモス、アモス書
a MOSの |
a MOSの学習レベル | レベル:29 |
「a MOS」の部分一致の例文検索結果
該当件数 : 4445件
The MOS transistor 2 is a p-channel type MOS transistor.例文帳に追加
MOSトランジスタ2はpチャネル型MOSトランジスタである。 - 特許庁
The light emitting element 1 having MOS structure includes a MOS transistor 2 and a ballistic electron source 3 arranged right under the MOS transistor 2.例文帳に追加
MOS構造の発光素子1は、MOSトランジスタ2と、MOSトランジスタ2の直下に配置された弾道電子源3とを備える。 - 特許庁
The drain of the MOS transistor MN20 and a power source line SAP are connected and the source of the MOS transistor MN20 and the drain of the MOS transistor MN21 are connected.例文帳に追加
MOSトランジスタMN20のドレインと電源線SAPとが接続されており、MOSトランジスタMN20のソースとMOSトランジスタMN21のドレインとが接続されている。 - 特許庁
The vertical signal line V1 is connected to a load MOS M51 via a common gate MOS M71 being a constant voltage means 3.例文帳に追加
垂直信号線V1は、定電圧手段3であるゲート接地MOS M71を介して負荷MOS M51に接続される。 - 特許庁
Drains of the amplification MOS M311 to M333 are connected to selection MOS M411 to M433 for supplying a power supply voltage.例文帳に追加
増幅MOS M311〜M333のドレインは、電源電圧を供給する選択MOS M411〜M433に接続される。 - 特許庁
Further, the source of an N-channel MOS transistor M5 is connected to the gate of a P-channel MOS transistor M7 in the push-pull circuit 15, and the P-channel MOS transistor M7 is driven by an output from the source of the N-channel MOS transistor M5.例文帳に追加
また、NチャネルMOSトランジスタM5のソースは、プッシュプル回路15のPチャネルMOSトランジスタM7のゲートと接続され、NチャネルMOSトランジスタM5のソース出力によって、PチャネルMOSトランジスタM7が駆動される。 - 特許庁
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遺伝子名称シソーラスでの「a MOS」の意味 |
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Amos
fly | 遺伝子名 | Amos |
同義語(エイリアス) | Rough eye protein; Tft; Rough eye; Amos protein; rolo; asolo; absent MD neurons and olfactory sensilla; Absent MD neurons and olfactory sensilla protein; amos; Roi; Reduced olfactory organs protein; CG10393; Basic helix-loop-helix transcription factor amos; Tufted | |
SWISS-PROTのID | SWISS-PROT:Q9Y0A7 | |
EntrezGeneのID | EntrezGene:35110 | |
その他のDBのID | FlyBase:FBgn0003270 |
本文中に表示されているデータベースの説明
Weblio英和対訳辞書での「a MOS」の意味 |
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AMOS (人工衛星)
AMOS (小惑星)
Amos
Amos
Amos
Amos (satellite)
「a MOS」の部分一致の例文検索結果
該当件数 : 4445件
A sense amplifier precharging circuit SPD is constituted of n type MOS transistors MN20, MN21, MN30, MN31, MN32 and Mn33 and the circuits are formed respectively in cross areas.例文帳に追加
センスアンププリチャージ回路SPDは、nチャネル型のMOSトランジスタMN20,MOSトランジスタMN21,MOSトランジスタMN30,MOSトランジスタMN31,MOSトランジスタMN32,及びMOSトランジスタMN33で構成されており、各々クロス領域に形成されている。 - 特許庁
The leak current of a MOS transistor in a memory cell is reduced by controlling the potential of a source line ssl of a driving MOS transistor within a SRAM memory cell MC.例文帳に追加
SRAMメモリセルMC内の駆動MOSトランジスタのソース線sslの電位を制御することでメモリセル内のMOSトランジスタのリーク電流を低減する。 - 特許庁
Leakage current of a MOS transistor in a memory cell is reduced by controlling the potential of a source line ssl of a driving MOS transistor in an SRAM memory cell MC.例文帳に追加
SRAMメモリセルMC内の駆動MOSトランジスタのソース線sslの電位を制御することでメモリセル内のMOSトランジスタのリーク電流を低減する。 - 特許庁
The P-type MOS 22 and the N-type MOS 32 constitute a circuit A, and the P-type MOS 42 and the N-type MOS 52 constitute a circuit B.例文帳に追加
P型MOS22及びN型MOS32は、回路Aを構成し、P型MOS42及びN型MOS52は回路Bを構成する。 - 特許庁
In the bias circuit 12, a MOS transistor NB11, a MOS transistor NB12 and a resistive load RB10 are serially connected in the order and provided.例文帳に追加
バイアス回路12は、MOSトランジスタNB11と、MOSトランジスタNB12と、抵抗性負荷RB10をこの順に直列接続して含む。 - 特許庁
The potential of a source line ssl of a driving MOS transistor in an SRAM memory cell MC is controlled so as to reduce the leakage current of MOS transistors in a memory cell.例文帳に追加
SRAMメモリセルMC内の駆動MOSトランジスタのソース線sslの電位を制御することでメモリセル内のMOSトランジスタのリーク電流を低減する。 - 特許庁
The sources of the load MOS M51 to M53 are connected to a common GND line 4 and the gates are connected to the gate of an input MOS M50 and also to a voltage input terminal 5.例文帳に追加
負荷MOS M51〜M53のソースは共通のGNDライン4に、ゲートは入力MOS M50のゲートに接続されると共に電圧入力端子5に接続される。 - 特許庁
To provide dummy pattern design for reducing the performance drift of a MOS device caused by a difference of stress applied on the MOS device.例文帳に追加
MOSデバイスに加えられる応力の違いに起因するMOSデバイスの性能のドリフトを低減するダミーパターン設計を提供する。 - 特許庁
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