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chip enable inputとは 意味・読み方・使い方
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「chip enable input」の部分一致の例文検索結果
該当件数 : 12件
To enable signals having a wide range of voltage to be input into a circuit chip through a configuration simpler than usual.例文帳に追加
より簡易な構成で広い電圧範囲の信号を回路チップに入力する。 - 特許庁
To surely latch an input signal received by an input circuit by a latch circuit in clock synchronizing semiconductor memory in which the input circuit for the input signal is controlled by a chip enable signal.例文帳に追加
入力信号の入力回路がチップイネーブル信号で制御されるクロック同期式の半導体メモリにおいて、入力回路で受信した入力信号を確実にラッチ回路でラッチする。 - 特許庁
When the computer is powered ON, a POST program is executed and in the setting which makes the security function effective, an RFID chip 33 holds Removal Detect Enable at high level and outputs it to the control side of an analog switch 67 and one input side of a NAND element 63.例文帳に追加
コンピュータの電源投入で、POSTプログラムが実行され、セキュリティ機能を有効にする設定で、RFIDチップ33は、Removal Detect Enableをハイレベルにしアナログスイッチ67の制御側及びNAND素子63の一方の入力側に出力する。 - 特許庁
In an outside address EAD<1:0> input part to which a signal is inputted through a page address input part P1, an initial stage buffer G21 of four stages series (G21 to G24) connection constitution receives the outside address EAD<1:0>, and an inversion control input receives an inside chip enable signal #ICE.例文帳に追加
ページアドレス入力部P1を介して入力される外部アドレスEAD<1:0>入力部において、4段直列(G21〜G24)接続構成の初段のバッファG21は外部アドレスEAD<1:0>を受け、反転制御入力に内部チップイネーブル信号#ICEを受ける。 - 特許庁
This eliminates the step between the PLC silicon substrate 2 and the preamplifier IC chip 3 to enable the length of a bonding wire 10 connected between output of a PD (optical receiving element) 4 and input of a preamplifier to be shortened.例文帳に追加
これによりPLCシリコン基板2とプリアンプICチップ3との間に段差がなくなり、PD4出力とプリアンプ入力間を接続するボンディングワイヤ10の長さを短くできる。 - 特許庁
Filters are attached also to the receiving terminal of a reader/writer which uses crosstalk within the chip and to the input terminal of the card IF function part to attenuate unwanted radiation to enable miniaturization of the circuit and devices without regard to the crosstalk of signals within the chip.例文帳に追加
チップ内でのクロストークによるリーダ/ライタの受信端子やカードIC機能部の入力端子にもフィルタを取り付けて、放出される不要輻射を減衰させることによって、チップ内の信号のクロストークを気にすることなく、回路や機器を小型化することができる。 - 特許庁
When the RAM-BIST control circuit 101 is operated by a logical simulator 100 to check the RAM macro 102, an address, input data, chip enable and write enable generated by the RAM-BIST control circuit 101 are monitored by an RAM checking area verifying circuit 104, and the decision of an area to be checked is executed in every test sequence.例文帳に追加
論理シミュレータ100によりRAM−BIST制御回路101を動作させてRAMマクロ102を検査する際に、RAM−BIST制御回路101が生成するアドレス、入力データ、チップイネーブル、ライトイネーブルをRAM検査領域検証回路104でモニタし、テストシーケンスごとに被検査領域の判定を行う。 - 特許庁
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「chip enable input」の部分一致の例文検索結果
該当件数 : 12件
A module managing part 60 selects the language processing module adaptive to the description language of input data ϕ1 transmitted from a host and when the selected module does not exist on a DRAM 22 built in a CPU chip 13, it is copied to the DRAM 22 so that an execution enable state can be provided.例文帳に追加
モジュール管理部60は、ホストから送信された入力データφ1の記述言語に適応した言語処理モジュールを選択し、選択したモジュールがCPUチップ13に内蔵されたDRAM22上にない場合は、DRAM22にコピーして実行可能な状態にする。 - 特許庁
By inputting a test mode signal to a test mode input terminal 6, a RAM 2 (special cell requiring the measurement of a standby current) of a semiconductor device 1 is set to a standby state through a dedicated test mode circuit 7 (such as an OR 4 inserted to a chip enable signal line 3, for example).例文帳に追加
テストモード入力端子6にテストモード信号を入力することにより、専用のテストモード回路7(例えば、チップイネーブル信号ライン3に介挿した論理和4)を介して半導体装置1のRAM2(スタンバイ電流の測定を要する特殊セル)をスタンバイ状態に設定する。 - 特許庁
Signal lines L1-L5 severally branch off to be connected to D terminals of the FFs 11-15, and a clock signal CLK, a write-enable signal WEN, a chip select signal CEN, an input data signal DI, and an address signal A are inputted into the scan FFs 11-15 via the signal lines L1 to L5, respectively.例文帳に追加
信号線L1〜L5は、それぞれ分岐してスキャンFF11〜15のD端子に接続されており、クロック信号CLK、ライトイネーブル信号WEN、チップセレクト信号CEN、入力データ信号DI、およびアドレス信号Aは、それぞれ信号線L1〜L5を介してスキャンFF11〜15に入力される。 - 特許庁
A current restriction control circuit 9 is provided which cuts off an output signal from a current restriction circuit 8 which restricts an output current, to an output transistor 2 for a prescribed time Ta after input of a chip enable signal CE which activates an operational amplifier 3 for conducting operation control of the output transistor 2.例文帳に追加
出力トランジスタ2の動作制御を行う演算増幅器3を活性化状態にするチップイネーブル信号CEが入力されてから所定時間Taの間、出力トランジスタ2に対して出力電流の制限を行う電流制限回路8からの出力信号を遮断する電流制限制御回路9を備えるようにした。 - 特許庁
The controller 3a consists of AND circuits AD1 to AD16, only an AND circuit corresponding to a memory selected by any of chip enable signals CE1 to CD4 performs input-output of a data signal, an address signal or the like, and the other memories reduce parasitic capacitance to be driven in the module 3 and accelerate a memory system by electrically disconnecting a connection path.例文帳に追加
メモリコントローラ3aは、論理積回路AD1〜AD16から構成され、チップイネーブル信号CE1〜CE4のいずれかによって選択されたメモリに対応する論理積回路だけがデータ信号、アドレス信号などの入出力を行い、その他のメモリは接続経路を電気的に切断することにより、メモリモジュール3における駆動すべき寄生容量を大幅に低減し、メモリシステムを高速化する。 - 特許庁
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