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start-stop bitとは 意味・読み方・使い方

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日英・英日専門用語辞書での「start-stop bit」の意味

start-stop bit


start/stop bit


「start-stop bit」の部分一致の例文検索結果

該当件数 : 24



例文

The Microsoft protocol uses 1 start bit, 7 data bits, no parity and one stop bit at the speed of 1200 bits/sec.発音を聞く 例文帳に追加

マイクロソフトプロトコルは、1200 bits/sec のスピードで、1 スタートビット(1 start bit)、7 データビット(7 data bits)、パリティなし、1 ストップビット(1 stop bit)である。 - JM

to learn just a bit of one thing but quickly stop and then start learning something else発音を聞く 例文帳に追加

いろいろなことを少しだけ習得してすぐやめる - EDR日英対訳辞書

The MM protocol uses 1 start bit, 8 data bits, odd parity and one stop bit at the speed of 1200 bits/sec.発音を聞く 例文帳に追加

MM プロトコルは 1200 bits/sec で 1 スタートビット、8 データビット、奇数パリティ、 1 ストップビットを使う。 - JM

A data transmission unit 59 adds a start bit, a stop bit, and the parity bit to the data input to the register 56 for data input and outputs the resulting data.例文帳に追加

データ送信部59は、データ取込み用レジスタ56で取込んだデータにスタートビット、ストップビット、パリティビットを付加して出力する。 - 特許庁

The framing error detecting circuit 5 when inputting a count value '9' outputs a framing error detection signal and the start/stop bit detecting circuit 3 redetects the bit position detected as the stop bit t2 again as a start bit t1.例文帳に追加

フレーミングエラー検出回路5は、カウント値「9」が入力されると、スタート/ストップビット検出回路3にフレーミングエラー検出信号を出力し、スタート/ストップビット検出回路3は、ストップビットt2として検出したビット位置をスタートビットt1として検出し直す。 - 特許庁

When retightening the screw, the contact valve is turned off after the start to stop a driver bit 15 at the bottom dead center, and the contact nose is pressed in by matching the driver bit with a recessed part of the screw to restart the driver bit and retighten the screw.例文帳に追加

増し締めする際は、起動後にコンタクト弁をオフさせるとドライバビット15が下死点で停止し、ドライバビットをネジのリセスに合わせてコンタクトノーズを押込めば、ドライバビットが再起動して増し締めされる。 - 特許庁

例文

The Mousesystems protocol uses 1 start bit, 8 data bits, no parity and two stop bits at the speed of 1200 bits/sec.発音を聞く 例文帳に追加

マウスシステムズプロトコルは、1200 bits/secで、1 スタートビット、8 データビット、パリティなし、2 ストップビットである。 - JM

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「start-stop bit」の部分一致の例文検索結果

該当件数 : 24



例文

To provide a receiving circuit for start-stop synchronous communication capable of receiving high speed bit data and accurately reproducing the received data.例文帳に追加

高速のビットデータを受信することができ、かつ、受信データを正確に再現することができる調歩同期受信回路を提供する。 - 特許庁

A start/stop bit detecting circuit 3 detects the bit position right after character data t3 as a stop bit t2 and outputs it to a serial-parallel converting circuit 4 successively to the character data t3 when the data are '0'.例文帳に追加

スタート/ストップビット検出回路3は、ストップビットt2として、キャラクタデータt3直後のビット位置を検出し、そのデータが“0”である場合には、キャラクタデータt3に続けてシリアル/パラレル変換回路4に出力する。 - 特許庁

Then, an operation schedule 9, where the bit corresponding to the operation time zone of the apparatus 1 is set to 1 and the bit corresponding to the stop time zone of the apparatus 1 is set to 0, is made, and the control means 6 transmits a start command and a stop command, based on the set value of the bit geared to the present time.例文帳に追加

そして、機器1の運転時間帯に対応するビットを1に且つ機器1の停止時間帯に対応するビットを0に設定した運転スケジュール8を作成し、現在時刻に応じたビットの設定値に基づき、コントロール手段6から各機器1へ、起動指令、及び停止指令を送信する。 - 特許庁

An overhead bit for preventing confusion with an error control sequence 113 and a flag sequence is eliminated from a transmission bit row 110 based on predetermined data transmission procedures, a start bit row 122 and a stop bit row 123 are added, and the data are transmitted between modulating and demodulating apparatuses.例文帳に追加

所定のデータ伝送手順に基づく伝送ビット列110から誤り制御シーケンス113やフラグシーケンスとの混同を防ぐための付加ビットを除去し、開始ビット列122、終了ビット列123を付加して変復調装置間を伝送する。 - 特許庁

When a start bit, FSK data and stop bit are impressed from a shift register 10 to a selector 13, the selector 13 selects any one of mark signal and space signal.例文帳に追加

シフトレジスタ10からスタートビット、FSKデータ及びストップビットがセレクタ13に印加されると、セレクタ13はマーク信号及びスペース信号の一方を選択する。 - 特許庁

A transmitter 10 transmits measuring data D1 of one frame for measuring a communication speed at a receiving side, which includes a start bit to be attached to the front of data and a stop bit to be attached to the end of the data.例文帳に追加

送信装置10は、データの先頭に付加されるスタートビット及びデータの最後に付加されるストップビットを含み、受信側で通信速度を測定するための1フレームの測定用データD1を送信する。 - 特許庁

The bus control circuit 9 waits until the bus B comes to an idle state when data and a start generation bit are set to the register 5, and outputs a first control signal, and outputs a second control signal when a stop generation bit is set to the register 5.例文帳に追加

制御回路9は、データ及びスタート生成ビットがレジスタ5にセットされた場合に、バスBがアイドル状態となるまでウェイトし、第1の制御信号を出力し、ストップ生成ビットがレジスタ5にセットされた場合に、第2の制御信号を出力する。 - 特許庁

例文

The first digital interface transmits a digital imaging signal by means of serial data comprising a start bit, data related to an imaging signal, and a stop bit in this order, and the second digital interface transmits a basic clock signal.例文帳に追加

第1のディジタルインターフェースでは、ディジタル撮像信号を、スタートビット、撮像信号に係るデータ、ストップビットの順で構成されるシリアルデータで伝送し、第2のディジタルインターフェースでは、基本クロック信号を伝送している。 - 特許庁

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