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かいがもり1ちょうめの英語
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「かいがもり1ちょうめ」の部分一致の例文検索結果
該当件数 : 131件
複数のメモリ回路1〜4が、冗長救済のためのヒューズを共有する場合には、複数のメモリ回路1〜4をその総容量に等しい容量を有する1つのメモリ回路5と置換して、歩留まり算出を行う。例文帳に追加
When a plurality of memory circuits 1 to 4 share a fuse for redundancy relief, the memory circuits 1 to 4 are substituted with one memory circuit 5 having an equivalent capacity to their total capacity, so as to calculate yield. - 特許庁
不良メモリセルを救済するために置き換えた冗長メモリセルが不良の場合に、冗長プログラム回路1の冗長メモリセル選択回路3への対応を新しい冗長メモリセル選択回路3へ切り替え、先に対応していた冗長メモリセル選択回路3の機能を不活性にする切り替え回路2を設ける。例文帳に追加
This memory is provided with a circuit 2 in which correspondence to a redundant memory cell selecting circuit 3 of a redundancy program circuit 1 is switched to a new redundant memory cell selecting circuit 3, a function of the redundant memory cell selecting circuit 3 previously corresponding is made inactive, in the case a redundant memory cell replaced for relieving a defective memory cell is defective. - 特許庁
イメージセンサ1によって撮像された画像をCPU2の階調変換手段により階調変換を施して内部メモリ20に保持し、内部メモリ20からメモリ3に転送している。例文帳に追加
A gradation converting mean of a CPU 2 performs gradation conversion of an image picked up by an image sensor 1, stores the image in an internal memory 20, and transfers the image from the internal memory 20 to a memory 3. - 特許庁
RAM3に対してアクセス元1、2からのメモリアクセスが競合した場合、メモリアクセス調停回路10によって、アクセス元2からのメモリアクセスを、そのアクセスサイクル内で遅延させて、次のメモリアクセスまでにRAM3に対してメモリアクセスが行われるように調停する。例文帳に追加
When memory accesses from access sources 1 and 2 compete with respect to the RAM 3, a memory access from the access source 2 is delayed by the memory access arbitration circuit 10 within the access cycle, and arbitration is performed so that the memory access to the RAM 3 is made before the next memory access. - 特許庁
メモリブロック1〜5に対応してそれぞれ冗長回路11〜15が設けられており、メモリブロックにはビット線BL0〜15が規定され、冗長回路11〜15にはスペアビット線SBL1及び2が規定されている。例文帳に追加
Redundant circuits 11 to 15 are provided corresponding to memory blocks 1 to 5, bit lines BL0 to 15 are prescribed to the memory blocks, and spare bit lines SBL1 and 2 are prescribed to the redundant circuits 11 to 15. - 特許庁
変調器3bが、メモリ3aに蓄えられた映像信号から画素1の各々に表示すべき階調データを取り出し、画素1の各々に固有の周波数をもつ搬送波に乗せて変調する。例文帳に追加
A modulator 3b takes out gradation data, which are to be displayed on each of pixels 1, from the video signals stored in the memory 3a and modulates the data with the carriers having the frequencies intrinsic to each of the pixels 1. - 特許庁
この置換を行なうための冗長判定回路1は、各メモリブロックごとに設けられており、その冗長判定回路1内にはヒューズボックス2が複数列配置されている。例文帳に追加
A redundancy discriminating circuit 1 for performing this replacement is provided in each memory block, two fuse boxes are arranged in the redundancy discriminating circuit 1. - 特許庁
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「かいがもり1ちょうめ」の部分一致の例文検索結果
該当件数 : 131件
画素アレイ部1は、複数の1ビットメモリで各画素を構成した面積階調画素構造になっている。例文帳に追加
The pixel array part 1 has an area gradation pixel structure where each pixel is constituted of a plurality of one-bit memories. - 特許庁
1×1ディザ処理部1と、m×nディザ処理部2と、適応ディザ処理部3と誤差拡散処理部4は共用メモリM1、共用FIFOメモリM2,M3を共用し、また、メモリ使用が競合した場合、競合が発生しない階調処理回路を選択する。例文帳に追加
A 1×1 dither processing section 1, an m×n dither processing section 2, an adaptive dither processing section 3, and an error diffusion processing section 4 use a common memory M1 and common FIFO memories M2, M3 in common and when the use of the memories is in contention, a gradation processing circuit not causing the contention is selected. - 特許庁
カメラモジュール1が調整モードである場合には、メモリカードI/F回路19を用いて画像データを出力し、メモリカードに画像データを記録する。例文帳に追加
When the camera module 1 is set to an adjustment mode, the camera module 1 uses the memory card I/F circuit 19 to output image data and records the image data to a memory card. - 特許庁
仮想配線長見積もり装置1はユーザ入力部2から回路の情報が入力されると、データベース3に格納された各ブロックの端子毎の仮想配線長見積もりパラメタ及びデータベース4に格納された配線長見積もり値を基に計算対象の回路に対して仮想配線長見積もりを行い、その計算結果をレポートファイル5に出力する。例文帳に追加
When information of the circuit is inputted from a user input part 2, an imaginary wiring length estimate device 1 estimates imaginary wiring lengths of the circuit as the calculation object on the basis of imaginary wiring length estimate parameters for individual terminals of each block stored in the data base 3 and wiring length estimate values stored in the data base 4, and outputs the calculation result to a report file 5. - 特許庁
LSIが複数のメモリと接続されていて、メモリがハンドシェイクアクセス方式でデータ転送を実行する場合に、アドレスバスが長時間1のメモリに対するアクセス信号を出力し続けることを回避する。例文帳に追加
To avoid keeping outputting an access signal to a memory in which an address bus is a long time 1 when the memory executes data transfer in a handshake accessing method with an LSI connected to a plurality of memories. - 特許庁
半導体処理装置1は、多階調表示が可能なメモリ性液晶パネル2と、メモリ性液晶パネル2を駆動するための書込電圧を多段階で変化させるLCD駆動回路11とを備える。例文帳に追加
A semiconductor processor 1 comprises: a memory property liquid crystal panel 2 capable of multi-gradation display; and an LCD drive circuit 11 for varying, in multiple steps, write voltage for driving the memory property liquid crystal panel 2. - 特許庁
Bモード表示において撮影された複数の超音波画像を表示画像制御回路4の各フレームメモリ15にそれぞれ記憶する。例文帳に追加
A plurality of ultrasonic images in the B mode display are respectively stored in the frame memories 1 of a display image control circuit 4. - 特許庁
イメージ取込部1から取込まれた複数ビットのモノクロ階調イメージデータImが、モノクロ階調イメージデータ格納メモリ2に格納される。例文帳に追加
In this image data encoding method, monochrome gradation image data Im of plural bits fetched from an image fetching part 1 are stored to a monochrome gradation image data storage memory 2. - 特許庁
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