意味 | 例文 (32件) |
CK3とは 意味・読み方・使い方
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遺伝子名称シソーラスでの「CK3」の意味 |
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CK3
human | 遺伝子名 | CK3 |
同義語(エイリアス) | K3; 65 kDa cytokeratin; keratin 3; CK-3; KRT3; Keratin, type II cytoskeletal 3; Cytokeratin-3; Keratin-3 | |
SWISS-PROTのID | SWISS-PROT:P12035 | |
EntrezGeneのID | EntrezGene:3850 | |
その他のDBのID | HGNC:6440 |
mouse | 遺伝子名 | Ck-3 |
同義語(エイリアス) | creatine kinase, brain; B-CK; Ckbb; Creatine kinase B-type; Ckb; Creatine kinase B chain | |
SWISS-PROTのID | SWISS-PROT:Q04447 | |
EntrezGeneのID | EntrezGene:12709 | |
その他のDBのID | MGI:88407 |
本文中に表示されているデータベースの説明
「CK3」を含む例文一覧
該当件数 : 32件
A buffer 104 delays arrival of the clock signal clk to the clock terminal CK3.例文帳に追加
バッファ104は、クロック信号clkのクロック端子CK3への到達を遅延させる。 - 特許庁
The clock CK3 whose duty cycle is finally corrected to about 50% is then obtained.例文帳に追加
そして、最終的にデューティ比がほぼ50%にされたクロックCK3が得られる。 - 特許庁
In a second counter 12, a signal CK3 is counted with a reset value as the count number of the signal CK3 in a frame term, and count data S11 is generated.例文帳に追加
第2のカウンタ12はCK3をフレーム期間においてカウントしたカウント数をリセット値として同CK3をカウントし、カウントデータS11を出力する。 - 特許庁
A register 23 samples an address signal A at the timing of a clock signal CK3 and outputs the address signal A.例文帳に追加
レジスタ23は、アドレス信号Aをクロック信号CK3のタイミンングで取り込み、アドレス信号Aを出力する。 - 特許庁
The functional blocks 1, 2 and 3 have clock buffers CK1, CK2 and CK3, respectively.例文帳に追加
機能ブロック1、機能ブロック2および機能ブロック3は、それぞれクロックバッファCK1、CK2およびCK3を有する。 - 特許庁
The PLL circuit 26 generates a clock CK3 based on a wobbling signal indicative of the address information of the DVD and a land prepit signal.例文帳に追加
PLL回路26は、DVDのアドレス情報を示すウォブル信号とランドプリピット信号とに基づいてクロックCK3を生成する。 - 特許庁
A system clock signal CK1 is divided by a first counter 11 and a sampling clock signal CK3 at a prescribed frequency is generated.例文帳に追加
第1のカウンタ11はシステムクロック信号CK1を分周し所定周波数のサンプリングクロック信号CK3を出力する。 - 特許庁
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「CK3」を含む例文一覧
該当件数 : 32件
The FF 103 has a clock terminal CK3, and fetches the clock signal in parallel to the clock terminal CK2 of the FF 102.例文帳に追加
また、FF103は、クロック端子CK3を有しており、FF102のクロック端子CK2と並列にクロック信号を取り込む。 - 特許庁
A horizontal synchronizing signal HD1 provided from a TS signal is applied to a multiplication circuit 20 and a multiplied clock CK3 is provided.例文帳に追加
TS信号から得た水平同期信号HD1は逓倍回路20に与えて、逓倍したクロックCK3を得る。 - 特許庁
A transmission controller 28 fetches D4 using CK3, and transmits the above ST with added stop mark thereafter.例文帳に追加
送信制御部28でCK3によりD4を取り込んで、この前に上記STを、後にストップマーク部を付加して送信する。 - 特許庁
When SP is set at the Lo level, CK3 is set at the Lo level, and CK1 is set at the H level, the potential of the signal output portion Out comes to be at the L level again.例文帳に追加
SPがLo、CK3がLo、CK1がHレベルになると、信号出力部Outの電位は再びLレベルとなる。 - 特許庁
An input selection circuit 1 makes a selection as to whcih of input clocks CK1, CK2, CK3 received from an external device is to be given to an input frequency counter circuit 5 and a 1/N counter 2 on the basis of a selection signal G.例文帳に追加
入力選択回路1は、図示しない外部装置から入力される入力クロックCK1,入力クロックCK2及び入力クロックCK3のいずれを、入力周波数計数回路5及び1/Nカウンタ2へ出力するかの選択を選択信号Gに基づいて行う。 - 特許庁
The skew control circuit 10 includes a delay circuit 30 which outputs a clock delaying the clock CK1 as the clock CK2, and a delay control circuit 20 which receives a clock CK3, corresponding to any one of the multi-phase clocks and controls the delay time of the clock CK2, with respect to the clock CK1 so as to phase match those of the clocks CK1 and CK3.例文帳に追加
スキュー調整回路10は、クロックCK1を遅延させたクロックをクロックCK2として出力する遅延回路30と、多相クロックのいずれかに対応するクロックCK3を受け、クロックCK1とCK3の位相が一致するように、クロックCK1に対するクロックCK2の遅延時間を調整する遅延調整回路20を含む。 - 特許庁
At the timing of a succeeding clock CK3, the data RD3 stored in the work register are read out first and supplied to the data bus DX.例文帳に追加
そして次クロックCK3のタイミングでは、先にX側読出用ワークレジスタに格納されたデータRD3を読み出してデータバスDXに供給する。 - 特許庁
The multiplexer 32 supplies the clock CK1 to the 8-16 modulation circuit immediately before additional writing, and supplies the clock CK3 after the start of the additional writing.例文帳に追加
マルチプレクサ32は、追記を行う直前まではクロックCK1を8−16変調回路36に供給し、追記の開始後はクロックCK3を供給する。 - 特許庁
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