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B-CKとは

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遺伝子名称シソーラスでの「B-CK」の意味

B-CK

human遺伝子名B-CK
同義語(エイリアス)CKB; creatine kinase, brain; Creatine kinase B-type; CKBB; Creatine kinase B chain
SWISS-PROTのIDSWISS-PROT:P12277
EntrezGeneのIDEntrezGene:1152
その他のDBのIDHGNC:1991
mouse遺伝子名B-CK
同義語(エイリアス)creatine kinase, brain; Ckbb; Creatine kinase B-type; Ckb; Creatine kinase B chain; Ck-3
SWISS-PROTのIDSWISS-PROT:Q04447
EntrezGeneのIDEntrezGene:12709
その他のDBのIDMGI:88407
rat遺伝子名B-CK
同義語(エイリアス)10361; Creatine kinase B-type; 10360; Ckbr; Ckb; Creatine kinase B chain; 10362; RATCKBR; creatine kinase, brain; Ckbb; 10363
SWISS-PROTのIDSWISS-PROT:P07335
EntrezGeneのIDEntrezGene:24264
その他のDBのIDRGD:2357
zfish遺伝子名bck
同義語(エイリアス)wu:fj36f10; wu:fj37d11; cb594; fj37d11; fj36f10; creatine kinase, brain; ckb
SWISS-PROTのID---
EntrezGeneのIDEntrezGene:140744
その他のDBのIDZFIN:ZDB-GENE-020103-2

本文中に表示されているデータベースの説明

SWISS-PROT
スイスバイオインフォマティクス研究所欧州バイオインフォマティクス研究所によって開発運営されているタンパク質アミノ酸配列データベース
EntrezGene
NCBIによって運営されている遺伝子データベース染色体上の位置配列発現構造機能、ホモロジーデータなどが含まれている
HGNC
HUGO遺伝子命名法委員会により運営されるヒト遺伝子に関するデータベース
MGI
様々なプロジェクトによる研究マウス遺伝的生物学的なデータを提供するデータベース
RGD
ウィスコンシン医科大学により運営されるラット遺伝子ゲノム情報データベース
ZFIN
ゼブラフィッシュ遺伝子命名法委員会により運営されている研究用の淡水魚ゼブラフィッシュ遺伝子ゲノム情報データベース


「B-CK」の部分一致の例文検索結果

該当件数 : 17



例文

(b) By removing the external capacitor (COSC) 31 from an input terminal 32 and applying an external clock (CK) 36 to the input of the hysteresis inverter (INV1) 33, the signal (VOSC) 35 synchronous with the external clock (CK) 36 is obtained.例文帳に追加

(b)上記の外付けコンデンサ(COSC)31を入力端子32から外し、上記のヒステリシスインバータ(INV1)33の入力に外部クロック(CK)36を印加することで外部クロック(CK)36に同期した信号(VOSC)35を得る。 - 特許庁

The OFDM modulation parts A2, B2 respectively generate OFDM modulation signals to which IFFT is applied on the basis of IFFT sampling clocks CK-A, CK-B outputted from respective clock generation parts A3, B3.例文帳に追加

OFDM変調部A2,B2はクロック生成部A3,B3からのIFFTサンプリングクロックCK−A,CK−Bに基づいてIFFTを施してOFDM変調信号を生成する。 - 特許庁

A clock signal ck, picture signals V40 for every R, G, B and an adding circuit control signal Ca are outputted from a control circuit 40.例文帳に追加

制御回路40から、クロック信号ck、R,G,B毎の画像信号V40、及び加算回路制御信号Caが出力される。 - 特許庁

The clock generation parts A3, B3 respectively detect the frame leads of respective delayed TS signals independently of the delay quantity of the TS delay parts A1, B1 and decide the phases of the IFFT sampling clocks CK-A, CK-B on the basis of respective frame lead positions.例文帳に追加

クロック生成部A3,B3は、TS遅延部A1,B1の遅延量にかかわらず、遅延されたTS信号のフレーム先頭を検出し、このフレーム先頭位置を基準にIFFTサンプリングクロックCK−A,CK−Bの位相を確定する。 - 特許庁

The display part 1A of a display panel 1 is driven by the driving signals of clock signals CK and display signals R, G and B, etc., supplied from a driving LSI 40.例文帳に追加

表示パネル1の表示部1Aは、駆動LSI40から供給されるクロック信号CK及び表示信号R,G,B等の駆動信号によって駆動される。 - 特許庁

A detection circuit 24 detects signals CK, ICK supplied from the control device 1 to the nodes A, B respectively and outputs a voltage signal Vsig.例文帳に追加

また、コントロール装置1から接点A,Bにそれぞれ供給された信号CK,ICKを検波し、電圧信号Vsigを出力する検波回路24を設ける。 - 特許庁

例文

The driving LSI 40 is provided with a signal processing part SP for executing signals processing to the driving signals transferred from the outside of the display panel 1, that are the clock signals CK and the display signals R, G and B.例文帳に追加

駆動LSI40には、表示パネル1の外部から転送される駆動信号、即ちクロック信号CK及び表示信号R,G,Bに対して信号処理を施す信号処理部SPが設けられている。 - 特許庁

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Wiktionary英語版での「B-CK」の意味

Bck.

固有名詞

Bck.

  1. Abbreviation of Buckinghamshire.

「B-CK」の部分一致の例文検索結果

該当件数 : 17



例文

Clock signals CK, video data signals R/G/B and source driver start pulse signals SPI are cascade-connected between first to eighth source dirvers in which eight source drivers LSI1 are cascade-connected.例文帳に追加

クロック信号CK、映像データ信号R・G・B、及びソースドライバ用スタートパルス信号SPIが、8個のソースドライバLSI1が縦続接続された第1〜第8ソースドライバ間でカスケード接続されている。 - 特許庁

In the device 2, the impedance between contacts A and B is made lower and amplitudes of signals CK and ICK are made shorter when a transmission signal TS2 is 'L', but the amplitudes are made wider when the transmission signal TS2 is 'H'.例文帳に追加

また、装置2において、送信信号TS2が“L”のときは接点A,B間のインピーダンスが小さくなり、信号CK,ICKの振幅は小さくなる一方、“H”のときは振幅は大きくなる。 - 特許庁

Then, a prescribed point when smaller color difference is not obtained any more is determined as an output point (point specified by CMYK value) in the CK space corresponding to the input point in an L*a*b* space.例文帳に追加

そして、より小さな色差が得られなくなった時点における所定点を、L*a*b*空間上の入力点に対応するCK空間上の出力点(CMYK値で規定される点)と決定する。 - 特許庁

When the amount X of the received data is not larger than the reference value B, the select or 40 alternately gives the reference clock CK0 and a low-speed clock CK2 for a prescribed period each as a clock CK to the D/A converter 50.例文帳に追加

受信データ量Xが基準値B以下のときセレクタ40は、基準クロックCK0と低速クロックCK2とを所定期間ずつ交互にクロックCKとしてD/A変換器50に与える。 - 特許庁

An input inverting buffer circuit 12 and a clock half period delay circuit 13 that delay each input signal such as the start pulse signal SP, the video data signals R, G, B and the clock signal CK propagated through the LSI chips 1,..., by a half period of the clock signal CK and provide the output of them are provided to each source driver LSI chip 1.例文帳に追加

ソースドライバLSIチップ1…に縦続して伝搬されるスタートパルス信号SP、映像データ信号R・G・B、クロック信号CKを、これら各入力信号に対してクロック信号CKの半周期分を遅延させて出力させる入力反転バッファ回路12及びクロック半周期遅延回路13が各ソースドライバLSIチップ1…に設けられている。 - 特許庁

However, since the node B and the power source of positive voltage Vdd are connected via a transistor T20, the potential Vb of the node B is stabilized at a High side, erroneous operation by noise superposed on a clock signal ck is prevented when a power is supplied.例文帳に追加

しかし、ノードBと正の電圧Vddの電源とがトランジスタT20を介してに接続されるため、ノードBの電位Vbは、High側で安定し、電源投入時、クロック信号ckに重畳したノイズによる誤動作は防止される。 - 特許庁

A start pulse signal SP, video data signals R, G, B and a clock signal CK are cascaded and propagated through source driver LSI chips 1 connected in cascade and delayed and the delay time differs between a leading signal and a trailing signal of the signals.例文帳に追加

縦続接続されるソースドライバLSIチップ1に、縦続して伝搬されるスタートパルス信号SP、映像データ信号R・G・B、クロック信号CKが、各ソースドライバLSIチップ1…において遅延を生じ、かつその遅延時間が信号の立ち上がり時と立ち下がり時とで異なる。 - 特許庁

例文

To provide a method for transmitting data between two devices (D1, D2) which can restrain a clock line to an electric potential representing a logic value B opposite to a logic value A respectively using a clock line (CK) maintained at the default value of the logic value A and at least one data line (DT).例文帳に追加

論理値Aのデフォルト値に維持されているクロック線(CK)と少なくとも一本のデータ線(DT)により、それぞれAと反対の論理値Bを表す電位にクロック線を拘束することができる二つの装置(D1、D2)間でデータを送信するための方法を提供する。 - 特許庁

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