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Weblio 辞書 > 英和辞典・和英辞典 > gate array methodに関連した英語例文

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gate array methodの部分一致の例文一覧と使い方

該当件数 : 112



例文

To provide a method for controlling a non-volatile semiconductor memory having a floating gate by which the dispersion of the threshold values of each cell in a memory cell array can be suppressed, the controllability of threshold distribution can be improved, and program speed can be improved.例文帳に追加

浮遊ゲートを有する不揮発性半導体メモリにおいて、メモリセルアレイ内の各セルの閾値のばらつきの抑制と、閾値分布の制御性の向上と、プログラム速度の向上を図れる不揮発性半導体メモリの制御方法を提供する。 - 特許庁

The manufacturing method of the display apparatus includes a step of electrically interconnecting the metallic board 100, the gate short wires 105 and the source short wires 104 via contact holes 102, 103 at least in the manufacturing step of the matrix array board.例文帳に追加

この表示装置の製造方法は、少なくともマトリクスアレイ基板の製造工程において、金属基板100とゲートショート配線105およびソースショート配線104とをコンタクトホール102,103を介して電気的に接続する工程を有している。 - 特許庁

By varying the potential of the extraction gate electrode in accordance with Vgs of the driving transistor, the active matrix driving method is performed by connecting a driving transistor Tr1 to the emitter array in series and voltage which is applied to the driving transistor Tr1 can be reduced.例文帳に追加

引き出しゲート電極の電位を駆動トランジスタのVgsに従って変化させることで、エミッタアレイに駆動トランジスタTr1を直列に接続してアクティブマトリクス駆動を行ないつつ、駆動トランジスタTr1にかかる電圧を低くすることができる。 - 特許庁

A self-aligning method is provided for forming a semiconductor memory array of floating gate memory cells in a semiconductor substrate having a plurality of spaced apart insulating regions and active regions on the substrate substantially parallel to one another in the column direction, and an apparatus is formed thereby.例文帳に追加

縦方向に互いに概ね平行している基板上に離間した複数の絶縁領域及び活性領域を有する半導体基板にフローティングゲートメモリセルの半導体メモリアレイを形成する自己整合方法、及びそれにより形成される装置。 - 特許庁

例文

To provide a layout design method for a gate array semiconductor integrated circuit that can prevent the occurrence of noise and malfunctions due to current flow between plural circuit blocks in a well in which each power supply need be separated, and a semiconductor integrated circuit based on the layout design method.例文帳に追加

ゲートアレイ方式の半導体集積回路装置において、電源分離が必要な複数の回路ブロック間にウェルを伝って電流が流れてしまうことによるノイズや誤動作の発生を防止するためのレイアウト設計方法および当該レイアウト設計方法によって配置された半導体集積回路装置を提供すること。 - 特許庁


例文

To provide a manufacturing method of a non-volatile memory device capable of effectively embodying an NOR flash cell array composed using a 2-beat sidewall floating gate element having self-convergence characteristics, where a threshold voltage converges to a fixed value in erasing.例文帳に追加

本発明はイレイズの時しきい電圧が決まった値打ちに収斂する特性を枝は自体に収斂する2ビートサイドワル・フローティングゲート素子を使って構成したNORフラッシュセルアレイを効果的に具現することができる不揮発性メモリー素子の製造方法に関するのである。 - 特許庁

To provide an optical reconfiguration type gate array by which an electrically reconfiguration time can be reduced remarkably without reducing the number of gates open to a user to be a merit of a FPGA and further the FPGA device of a huge size including failures can be used, and to provide its reconfiguration method.例文帳に追加

FPGAのメリットであるユーザに開放するゲートの数を減らすことなく、電気的な再構成の時間を著しく減少させることができ、さらに、不良を含む巨大なサイズのFPGAデバイスを使用可能な光再構成型ゲートアレイおよびその再構成方法を提供する。 - 特許庁

To provide a liquid crystal display device array substrate and a method of manufacturing the same for improving haze defects which occur when gas used in a gate insulating film vapor deposition process and a transparent conductive material react when formed of a transparent conductive material of a storage capacitor electrode.例文帳に追加

ストレージキャパシタの電極の透明導電性物質で形成する場合に、ゲート絶縁膜蒸着工程の時使用されるガスと、前記透明導電性物質が反応して発生されるヘイズの不良を改善するための液晶表示装置アレイ基板、及び製造方法を提供する。 - 特許庁

To provide a data processor and its processing method capable of efficiently accelerating initial rise and improving the performance of a system by downloading only necessary configuration data to a configuration memory built in a field programmable gate array in accordance with required data processing to be executed.例文帳に追加

所望のデータ処理を実行する際に、そのデータ処理に応じて、必要なコンフィグレーション・データのみをフィールド・プログラマブル・ゲートアレイ内のコンフィグレーション用メモリにダウンロードすることにより、効率良く、初期の立ち上がりを高速化し、システム性能を向上させたデータ処理装置及びその処理方法を提供する。 - 特許庁

例文

In the electrostatic carriage recording method and the apparatus therefor, charged toner for forming an image is carried by an electrostatic carriage electrode array 2, in the way thereof, with a large number of gate electrodes 2-1, 2-2,..., 2-n which are applied with an image signal selectively such that the toner is carried over the gate electrodes and applied to a recording material 6 at the end thereof.例文帳に追加

本発明の静電搬送記録方法及び装置においては、帯電した画像形成用のトナーを静電搬送電極列2で搬送すると共に、トナーを静電搬送電極列2で搬送する途中にお互いに独立した多数のゲート電極2-1,2-2,・・・2-nを設け、該ゲート電極に、画像信号に応じて選択的に画像信号を加えて、その部分のみ、トナーをゲート電極を越えて搬送させ、その先で記録材6に付着させることを特徴とする。 - 特許庁

例文

The method for manufacturing a semiconductor device comprises a step for preparing a firm macrochip 11, a step for preparing an IC chip 10 having an area 13 for mounting the firm macrochip and an area 15 where a gate array is formed, and a step for mounting the firm macrochip 11 in the mounting area 13 of the IC chip 10.例文帳に追加

本発明に係る半導体装置の製造方法は、ファームマクロが作り込まれたファームマクロチップ11を準備する工程と、前記ファームマクロチップを搭載するための搭載領域13及びゲートアレイが形成された領域15を有するICチップ10を準備する工程と、前記ICチップ10における搭載領域13に前記ファームマクロチップ11を実装する工程と、を具備するものである。 - 特許庁

例文

The method for manufacturing an imaging array (10) includes formation of a first dielectric barrier (66), formation of a gate (50) and a light shielding element (68) with at least the same expansion on the first dielectric barrier, and formation of a second dielectric barrier (70) over the first dielectric barrier and the light shielding element so as to enclose the light shielding element with the first dielectric barrier.例文帳に追加

イメージング・アレイ(10)を製作するための方法は、第1の誘電バリア(66)を形成させること、この第1の誘電バリア上にゲート(50)と少なくとも同じ広がりをもつ光遮断素子(68)を形成させること、並び第1の誘電バリア及び光遮断素子の上に、第1の誘電バリアとの間で光遮断素子を包封するように第2の誘電バリア(70)を形成すること、を含む。 - 特許庁




  
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