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直並列変換の部分一致の例文一覧と使い方

該当件数 : 276



例文

並列変換回路例文帳に追加

SERIAL/PARALLEL CONVERSION CIRCUIT - 特許庁

並列変換回路例文帳に追加

PARALLEL/SERIES CONVERSION CIRCUIT - 特許庁

並列型A/D変換装置例文帳に追加

SERIES/PARALLEL-TYPE A/D CONVERSION DEVICE - 特許庁

並列変換回路例文帳に追加

PARALLEL/SERIAL CONVERTING CIRCUIT - 特許庁

例文

並列型A/D変換器のA/D変換方法、及び並列型A/D変換例文帳に追加

A/D CONVERSION METHOD FOR SERIAL/PARALLEL TYPE A/D CONVERTER, AND SERIAL/PARALLEL TYPE A/D CONVERTER - 特許庁


例文

並列変換器は、外部に出力される並列データを列に変換する。例文帳に追加

The parallel/serial converter converts parallel data to be outputted to the outside to serial data. - 特許庁

並列変換回路13は、多値の識別信号を多値の並列信号に変換する。例文帳に追加

A series parallel conversion circuit 13 converts the multi-value discrimination signals into multi- value parallel signals. - 特許庁

並列型アナログ/デジタル変換器及びアナログ/デジタル変換方法例文帳に追加

SERIES-PARALLEL ANALOG-DIGITAL CONVERTER AND ANALOG-DIGITAL CONVERSION METHOD - 特許庁

ビット並列(パラレル)からビット列(シリアル)への変換例文帳に追加

conversion from bit parallel to bit serial  - コンピューター用語辞典

例文

変換回路16は、シフト並列データを列データに変換する。例文帳に追加

A parallel/series conversion circuit 16 converts the shift parallel data into series data. - 特許庁

例文

基地局の送信機において、データ直並列変換器2は、送信データをM個の系列に直並列変換する。例文帳に追加

In a transmitter of a base station, a data series-parallel converter 2 makes a series-parallel conversion of transmission data into M series. - 特許庁

直並列変換器11は、入力される第1の制御信号を第1のパラレル信号に直並列変換して出力する。例文帳に追加

The serial-to-parallel converter 11 performs serial-to-parallel conversion for converting an inputted first control signal into a first parallel signal, and outputs the first parallel signal. - 特許庁

並列アナログデジタル変換回路及び移動体通信端末例文帳に追加

SERIAL-PARALLEL ANALOG-DIGITAL CONVERSION CIRCUIT AND MOBILE OBJECT COMMUNICATION TERMINAL - 特許庁

分周回路及び直並列変換回路並びに通信用LSI例文帳に追加

FREQUENCY DIVIDING CIRCUIT, SERIAL/PARALLEL CONVERTING CIRCUIT AND COMMUNICATION LSI - 特許庁

光伝送用並列変換器、光伝送システム、及び電子機器例文帳に追加

PARALLEL/SERIAL CONVERTER FOR OPTICAL TRANSMISSION, OPTICAL TRANSMISSION SYSTEM, AND ELECTRONIC EQUIPMENT - 特許庁

なお、上記変換係数の逆量子化は、並列処理(例えば、2並列処理又は4並列処理)される。例文帳に追加

The inverse quantization of orthogonal conversion factors is processed in parallel (for example, by double parallel processing or quadruple parallel processing). - 特許庁

直並列変換回路10は入力された8並列展開後のデータ信号をさらに6並列展開する。例文帳に追加

A serial parallel conversion circuit 10 receiving a received data signal expanded in 8 parallel format expands further into 6 parallel format. - 特許庁

メモリセルから読み出される並列データを列データに変換する並列変換器と、制御信号を受け、並列変換器を制御するスイッチ制御回路とを備えている。例文帳に追加

This device is provided with a parallel/series converter converting parallel data read out from a memory cell into series data, and a switch control circuit receiving a controlling signal and controlling the parallel/series converter. - 特許庁

出力データ変換部2は並列信号を列信号に変換して出力する。例文帳に追加

The output data conversion section 2 coverts the parallel signal into a serial signal and outputs. - 特許庁

列/並列変換器は、外部から連続的に入力される2N個のデータをN個ずつの並列データに変換する。例文帳に追加

The serial/parallel converter converts data of 2N pieces inputted continuously from the outside to parallel data of N pieces. - 特許庁

直並列変換器1により、1系列の送信シンボル列をL(サブキャリア数)本の系列の並列送信シンボル列に変換する。例文帳に追加

In this transmitter, a serial/parallel converter 1 converts a transmission symbol string of one sequence into a parallel transmission symbol string of L (the number of subcarriers) sequences. - 特許庁

メモリバンク内の並列データ変換器は、いずれか半分からの並列データを列データ経路コアに伝送する。例文帳に追加

A serial parallel data converter within the memory bank transmits the parallel data from either half to the serial data path core. - 特許庁

列・並列変換されたフレーム差分信号をアダマール変換回路106により周波数成分に変換する。例文帳に追加

A Hadamard conversion circuit 106 converts the frame difference signal subjected to serial/parallel conversion into a frequency component. - 特許庁

信号切替装置121は、フラグのついた信号のみを列信号として並列変換器87に送信し、並列変換器87は、クロック信号および垂同期信号に基づいて並列信号に変換し、出力する。例文帳に追加

A signal changeover device transmits only the serial signal with a flag added thereto to a serial parallel converter 87, which converts the serial signal into a parallel signal on the basis of the clock signal and the vertical synchronizing signal and outputs the resultant signal. - 特許庁

D/A変換器の固有非線歪、経時変化などによる非線歪を軽減する並列型AD変換器を提供する。例文帳に追加

To provide a serial-parallel A/D converter for reducing nonlinear distortion due to intrinsic nonlinear distortion and a change over time of the D/A converters. - 特許庁

並列変換・FFT部101、102は、それぞれ受信複素数信号および参照信号に対して並列変換および離散フーリエ逆変換を行う。例文帳に追加

In the filtering method, serial/parallel conversion and FFT units 101 and 102 perform serial/parallel conversion and discrete inverse Fourier transformation upon a reception complex signal and a reference signal, respectively. - 特許庁

列/並列変換回路101は順次走査の入力映像信号S1に対して2ライン単位で並列化する。例文帳に追加

A serial/parallel conversion circuit 101 converts an input video signal S1 adopting the progressive scanning system into a parallel signal in the unit of two lines. - 特許庁

ベースバンド信号処理部11は直並列変換器12bでパラレル化されたデータの処理を行う。例文帳に追加

A baseband signal processor 11 processes data paralleled by the serial-parallel converter 12b. - 特許庁

分周回路およびこれを用いた直並列変換回路並びにシリアルデータ送受信回路例文帳に追加

DIVIDER CIRCUIT, SERIAL-PARALLEL CONVERSION CIRCUIT USING THE DIVIDER CIRCUIT AND SERIAL DATA TRANSMITTING AND RECEIVING CIRCUIT - 特許庁

並列変換器は、所定の順序で接続する複数のスイッチを有している。例文帳に追加

The parallel/series converter has plural switches connected in the prescribed order. - 特許庁

高速化を図ることができる並列型アナログ/デジタル(AD)変換器を提供する。例文帳に追加

To provide a series-parallel analog-digital (AD) converter which can achieve a high speed. - 特許庁

変換回路60は、MUX58からの組み替え並列データをクロックCLKに従って列データに変換する。例文帳に追加

A parallel serial conversion circuit 60 converts rearranged parallel data from the MUX 58 into serial data according to the clock CLK. - 特許庁

変換回路12は、DCLKをより高速な基準クロックRCLKに従って第2並列データを列データに変換する。例文帳に追加

A parallel-series conversion circuit 12 converts the second parallel data into a series data following a reference clock RCLK higher than DCLK. - 特許庁

復号後のビット系列は並変換部407で並列変換され、検出した送信ビット系列が出力される。例文帳に追加

A bit sequence after decoded is parallel-serial converted by a parallel/serial converting portion 407 and a detected transmission bit sequence is output. - 特許庁

誤り訂正復号後のビット系列は、並変換部207で並列変換され送信ビット系列が出力される。例文帳に追加

Parallel/serial conversion is performed on the bit sequence after the error correction decoding by a parallel/serial conversion part 207, and a transmission bit sequence is output. - 特許庁

ハイブリッド回路1000は、差動符号の出力から信号変換、離散フーリエ逆変換まで並列信号のまま処理するので、直並列変換に伴う時間遅延が生じない。例文帳に追加

Since the hybrid circuit 1000 conducts processing with parallel signals from an output of a differential code, signal conversion and inverse discrete Fourier transform, a time delay attended with serial parallel conversion is not caused. - 特許庁

複数の熱電変換素子の列接続あるいは並列接続への切替えを可能とすると共に、並列接続時の各熱電変換素子を独立に能力調整可能とする熱電変換素子回路を提供する。例文帳に追加

To provide a thermoelectric conversion element circuit which allows switching among serial connection and parallel connection of a plurality of thermoelectric conversion elements, and allows independent capability adjustment for the thermoelectric conversion elements in parallel connection. - 特許庁

変換回路112は、遅延並列データ・クロック(DP_CLK)に応じて8ビットの並列データをメモリ100から読出し、列データ・クロック(S_CLK)に従って列データに変換する。例文帳に追加

A parallel-serial conversion circuit 112 reads a 8-bit parallel data out of a memory 100 according to the delay parallel data clock (DP_CLK), and converts it into a serial data according to the serial data clock (S_CLK). - 特許庁

無線基地局1において、光モジュール13のO/E部13bは光ファイバ100bからの光信号を逆光電変換させ、並列/並変換器12の直並列変換器12bはO/E部13bで電気変換された信号をパラレル化させる。例文帳に追加

In a radio base station 1, an O/E 13b in an optical module 13 inversely and photoelectrically converts a light signal from an optical fiber 100b, and serial-parallel converter 12b of a serial-parallel/parallel-serial converter 12 parallels a signal electrically converted by the O/E 13b. - 特許庁

並列変換装置が並列信号を読出して記憶した後、制御装置は、クロック信号を使用して並列信号を列に読出すことが可能となる。例文帳に追加

After the parallel/serial converter reads and stores the parallel signal, the controller can read the parallel signal as a serial one using a clock signal. - 特許庁

P/S変換部201は、ホスト210からの並列アクセスアドレスを列アクセスアドレスへ変換する。例文帳に追加

A P/S converting part 201 converts a parallel access address from the host 210 into a serial access address. - 特許庁

信号の配線遅延と簡易な論理回路を用いて、パラレル・シリアル変換を実現する並列変換回路を提供することを課題とする。例文帳に追加

To provide a parallel/series conversion circuit capable of realizing a parallel/series conversion using the signal wiring delays and a simple logic circuit. - 特許庁

信号の配線遅延と簡易な論理回路を用いて、シリアル・パラレル変換を実現する並列変換回路を提供することを課題とする。例文帳に追加

To provide a serial/ parallel conversion circuit for enabling serial/parallel conversion by using a wiring delay of a signal and a simple logic circuit. - 特許庁

S/P変換部202は、シリアルメモリ220が読み出した列データを並列データへ変換し、ホスト210へ伝送する。例文帳に追加

The S/P converting part 202 converts the serial data read out by the serial memory 220 into the parallel data, and transfers the same to the host 210. - 特許庁

本発明は、アナログ信号を一旦並列処理でデジタルに変換し、その後列に変換して出力する。例文帳に追加

Analog signals are digitally converted tentatively by parallel processings and serially converted and outputted thereafter. - 特許庁

ハイブリッド回路1000は、直並列変換器110、単位差動符号化回路120−1、…、120−N、並列型信号変換回路200、離散フーリエ逆変換回路(IDFT)300、並びに並変換器301及び302を有する。例文帳に追加

This hybrid circuit 1000 has a serial parallel converter 110, a parallel type signal conversion circuit 200, an inverse discrete Fourier transform circuit (IDFT) 300 and parallel serial converters 301, 302. - 特許庁

並列変換装置と、キーパッドモジュールと、並列変換装置およびキーパッドモジュールに結合した制御装置とを含むキーパッド装置。例文帳に追加

The kaypad device includes a parallel/serial converter, a keypad module and a controller which is connected with the parallel/serial converter and the keypad module. - 特許庁

マスターノード1は、スレーブノード3b〜3dからの列データ信号を並列データ信号に変換する並列変換部11aを有する。例文帳に追加

The master node 1 has a series-parallel conversion part 11a for converting series data signals from the slave nodes 3b to 3d into parallel data signals. - 特許庁

N(Nは2以上の自然数)ビットプリフェッチ方式を使用する半導体メモリ装置は、列/並列変換器、並列変換器及びカラムデコーダを具備する。例文帳に追加

A semiconductor memory device using a N (N: natural number ≥2) bit prefetch scheme is provided with a serial/parallel converter, parallel/ serial converter, and a column decoder. - 特許庁

例文

符号同期及び列/並列変換回路1は符号同期をとり、受信系列Yを情報系列I1〜IKと検査系列Pとに列/並列変換し、第1段復号回路2に出力する。例文帳に追加

A code synchronous and serial/parallel conversion circuit 1 synchronizes codes and converts a receiving system Y into information systems I1 to IK and a testing system P in serial and parallel, and outputs them to a first stage decoding circuit 2. - 特許庁

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