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do a flipとは 意味・読み方・使い方
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意味・対訳 とんぼ返りをする
「do a flip」の部分一致の例文検索結果
該当件数 : 14件
do a flip発音を聞く 例文帳に追加
とんぼ返りをする. - 研究社 新英和中辞典
I don't know what to do--I may as well flip a coin!発音を聞く 例文帳に追加
何をしていいか分からない…コインを投げた方がましだ - 日本語WordNet
In "Kyudo-shaho hassetsu" the reinfarcement by hikae works like a spring and promotes the flip-up of a thumb and do not prevent the movement of a string.発音を聞く 例文帳に追加
“弓道射法八節”に於いて控えの固めがバネのように働き、親指の跳ね上げが促され弦の運行を妨げないとされる。 - Wikipedia日英京都関連文書対訳コーパス
The position differences of the laser diode do not occur during movements in steps, and the steps are simplified, and reliability of a flip-chip mounting structure is improved.例文帳に追加
工程移動中のレーザーダイオード位置ズレの発生はなく、工程が簡素化され、フリップチップ実装構造の信頼性が向上する。 - 特許庁
To provide a flip-up spectacle frame which has mechanisms capable of well maintaining the turning angle of a turning front frame and having excellent durability and is constituted to make a pair of front frame do not overlap each other forward and backward like the conventional flip-up type.例文帳に追加
回動するフロントフレームの回動角度を良好に維持でき、かつ耐久性に優れた機構を備え、しかも、前記従来の跳ね上げ式のように一対のフロントフレームが前後に重ならないようにすることができるようにした跳ね上げ式眼鏡フレームを提供する。 - 特許庁
Each of scan flip flops 11, 12, 17 and 18 on a scan chain 42, and each of scan flip flops 13, 14, 15 and 16 on the other scan chain 43 do not have a connection relations via combined circuit parts 40 and 41.例文帳に追加
スキャンチェーン42上の各スキャンフリップフロップ11,12,17,18と、他のスキャンチェーン43上の各スキャンフリップフロップ13,14,15,16とは、互いに組み合わせ回路部40,41を介した接続関係を持たない。 - 特許庁
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「do a flip」の部分一致の例文検索結果
該当件数 : 14件
The first logic gate G1i of the number i (i is a natural number) generates an internal up signal UP which is asserted when the output of the flip-flop FF of the number (2×i-1) and the output of the flip-flop FF of the number (2×i) do not coincide.例文帳に追加
i(iは自然数)番目の第1論理ゲートG1iは、(2×i−1)番目のフリップフロップFFの出力と(2×i)番目のフリップフロップFFの出力とが不一致のときアサートされる内部アップ信号UPを生成する。 - 特許庁
The second logic gate G2j of the number j (j is a natural number) generates an internal down signal dn which is asserted when the output of the flip-flop FF of the number (2×j) and the output of the flip-flop FF of the number (2×j+1) do not coincide.例文帳に追加
j(jは自然数)番目の第2論理ゲートG2jは、(2×j)番目のフリップフロップFFの出力と(2×j+1)番目のフリップフロップFFの出力とが不一致のときアサートされる内部ダウン信号dnを生成する。 - 特許庁
According to the number of gradations, the number of drivings of flip-flops in an amplifier enable circuit 25 and a latch part in the data latch circuit 2 are switched, so unnecessary flip-flops, etc., do not consume electric power, so that the power consumption is reduced.例文帳に追加
階調数に応じて、アンプイネーブル回路25内のフリップフロップとデータラッチ回路2におけるラッチ部の駆動数を切り替えるため、不要なフリップフロップ等で電力を消費しなくなり、消費電力の低減が図れる。 - 特許庁
A joining defect of a flip-chip bump and a shape defect of fine wiring, which do not cause a disconnection, can be detected, so stress during secondary mounting and a disconnection resulting from long-period use can be detected in advance.例文帳に追加
断線には至らないが、フリップチップバンプの接合不良や微細配線の形成不良を検出することができるので、2次実装時のストレスや長期使用で発生する断線を事前に検出することができる。 - 特許庁
To largely shorten a delay optimization processing time regarding a delay optimizing method of a semiconductor integrated circuit optimizing delay of passes among flip-flops so that passes among flip-flops in the semiconductor integrated circuit designed with a scan pass method do not violate hold in both of a normal motion mode and a test operation mode.例文帳に追加
スキャンパス方式で設計した半導体集積回路内のフリップフロップ間のパスが通常動作モードおよびテスト動作モードの両モードにおいてホールド違反とならないようにフリップフロップ間のパスの遅延を最適化する半導体集積回路の遅延最適化方法に関し、遅延最適化処理時間の大幅な短縮化を図ることができるようにする。 - 特許庁
Then a 2nd flip-flop 13 latches Manchester code data which include hazards selected and outputted by a selector circuit 12 with a 2nd clock with a phase different from that of the 1st clock and with a frequency twice that of the 1st clock to output Manchester code data which do not include hazards.例文帳に追加
次に、第2フリップフロップ13において、セレクタ回路12で選択出力されたハザードを含むマンチェスタ符号データを、第1クロックとは位相が異なり、2倍の周波数である第2クロックでラッチすることによりハザードを含まないマンチェスタ符号データを出力する。 - 特許庁
For a semiconductor device having semiconductor elements 11 flip-chip bonded onto a circuit board 13 with conductive bumps 15 formed on their terminal electrodes 12, even together with a plurality of insulating bumps 17 which do not take part in electric connections of the semiconductor elements 11 are bonded to the circuit board 13.例文帳に追加
半導体素子11の端子電極12に導電性バンプ15を形成して半導体素子11を回路基板13上にフリップチップ接続する半導体装置において、電気的な接続には関与しない複数個の絶縁性バンプ17でも半導体素子11と回路基板13とが接合されている半導体装置である。 - 特許庁
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