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Weblio 辞書 > 英和辞典・和英辞典 > memory connectedに関連した英語例文

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memory connectedの部分一致の例文一覧と使い方

該当件数 : 3602件



例文

A memory module 15M connected to an address bus 63 is controlled by a memory controller 80 provided with an SDRAM control part 82.例文帳に追加

アドレスバス63に接続されたメモリモジュール15Mは、SDRAM制御部82を備えるメモリコントローラ80によって制御される。 - 特許庁

In a typical computer system, a processor and an input-output element are connected to a main memory sub-system including a basic memory.例文帳に追加

典型的なコンピュータ・システムでは、プロセッサおよび入出力素子は、基本メモリを含む主メモリ・サブシステムに接続されている。 - 特許庁

In a method for adjusting memory operation, formation of a wave pipeline is executed on an address bus connected to a plurality of memory components.例文帳に追加

本発明の実施形態によれば、複数のメモリ・コンポーネントに結合されたアドレス・バスについて、ウェーブパイプライン化が実施される。 - 特許庁

A plurality of the memory elements and a plurality of the transistors of a plurality of adjacent memory cells are alternately connected in series.例文帳に追加

互いに隣接する複数のメモリセルの複数の前記記憶素子および複数のセルトランジスタは、交互に直列に接続される。 - 特許庁

例文

Each of a plurality of memory subblocks includes a plurality of memory transistors that are connected in parallel between a first node and a second node.例文帳に追加

複数のメモリサブブロックの各々は、第1ノードと第2ノードとの間に並列接続された複数のメモリトランジスタを含む。 - 特許庁


例文

This data transfer device comprises: a processor 11; a main memory 13; and a DMAC 22 connected through a plurality of buses to the main memory 13.例文帳に追加

データ転送装置1は、プロセッサ11と、主メモリ13と、主メモリ13と複数のバスを介して接続されたDMAC22とを含む。 - 特許庁

In this case, each of plural N memory modules is radially connected to the central switch by a correspondent memory modules bus.例文帳に追加

この場合、複数のN個のメモリモジュールのそれぞれは、対応するメモリモジュールバスにより中央スイッチに放射状に接続される。 - 特許庁

One side electrodes of the resistor memory elements 1 of the adjacent two memory cells MC are connected to the bit lines BLA, BLB respectively.例文帳に追加

隣接する2つのメモリセルMCの抵抗体記憶素子1の一方電極をそれぞれビット線BLA,BLBに接続する。 - 特許庁

A memory cell connected to a word line WL2 is in a lock mode state, all correspondent memory cells MC are in a conduction state.例文帳に追加

ワード線WL2に接続されるメモリセルはロックモード状態にあり、対応のメモリセルMCは、すべて導通状態にある。 - 特許庁

例文

A developing electrode 57 and a memory terminal 55 electrically connected to a memory chip 53 are arranged in a developing cartridge housing 24.例文帳に追加

現像カートリッジ筐体24に、現像電極57とメモリチップ53と電気的に接続されるメモリ端子55とを配置する。 - 特許庁

例文

The device for managing memory in the diary type electronic wrist watch includes a non-volatile memory 15 connected to a microprocessor unit 14.例文帳に追加

ダイアリ・タイプの電子腕時計のメモリを管理するデバイスに、マイクロプロセッサ・ユニット(14)に接続された不揮発性メモリ(15)が含まれる。 - 特許庁

A memory cell group which has a plurality of memory cells MC including a floating gate and a control gate and in which current paths of a plurality of memory cells MC are connected in series is formed.例文帳に追加

浮遊ゲートと制御ゲートとを含むメモリセルMCを複数有し、複数のメモリセルMCの電流通路が直列に接続されたメモリセル群が形成されている。 - 特許庁

Each memory is connected through a common bit line in which two cells are a drain or a source, and a memory array is constituted by arranging a plurality of unit memory arrays of this two cells.例文帳に追加

各メモリは2セルがドレイン又はソースとなる共通ビット線を介しして接続されており、この2セルの単位メモリアレイを複数並べることによりメモリアレイを構成する。 - 特許庁

A memory cell current is made to flow in a memory cell when reading out data is compared with a reference current set in accordance with wiring width of word lines connected to this memory cell.例文帳に追加

データの読み出し時にメモリセルに流れるメモリセル電流が、このメモリセルに接続されたワード線の配線幅に応じて設定される基準電流と比較される。 - 特許庁

The memory managing device comprises a data memory 3 composed of a RAM or the like, a link list memory 5, and an address control part 4 arranged and connected to between both the memories 3 and 5.例文帳に追加

メモリ管理装置1は、RAM等より成るデータメモリ3、リンクリストメモリ5及びこれら両メモリ3、5間に配置接続されたアドレス制御部4で構成される。 - 特許庁

A control circuit of a memory array device that has one or two related memory cells includes a true bitline connected to one or two memory cells and a complementary bitline.例文帳に追加

関連した1つまたは複数のメモリ・セルを有するメモリ・アレイ・デバイスの制御回路は、1つまたは複数のメモリ・セルに結合された真ビットラインおよび相補ビットラインを含む。 - 特許庁

The non-volatile semiconductor memory device 10 has a plurality of memory strings 100, to which a plurality of memory transistors MTr1-4 which can be electrically rewritten is connected in series.例文帳に追加

不揮発性半導体記憶装置10は、電気的に書き換え可能な複数のメモリトランジスタMTr1〜4が直列に接続された複数のメモリストリングス100を有する。 - 特許庁

To use only a specific external memory even when the external memory is connected with an information processing device in which external memory is prohibited from its use.例文帳に追加

外部メモリの使用が禁止された状態にある情報処理装置に外部メモリが接続された場合であっても特定の外部メモリについてだけその使用を可能とする。 - 特許庁

All the bits of the Mth data stream are connected to the target memory device 14 having the M pieces of memory resistors with bit width of X of, and occupy uniformly disposed non-adjacent memory elements.例文帳に追加

M番目のデータストリームのすべてのビットは、ビット幅XのメモリレジスタM個を有するターゲットメモリ装置14と相互接続され、均等に配された非隣接メモリ要素を占有する。 - 特許庁

The non-volatile semiconductor memory device 100 includes a memory string MS which is electrically rewritable and includes a plurality of memory transistors MTr connected in series.例文帳に追加

不揮発性半導体記憶装置100は、電気的に書き換え可能であり且つ直列接続された複数のメモリトランジスタMTrを含むメモリストリングスMS備える。 - 特許庁

To improve the reliability of a magnetic memory by ensuring a breakdown voltage between a bit line of the memory and wiring connected to the lower layer of magnetic memory elements.例文帳に追加

磁気記憶装置のビット線と磁気記憶素子の下層に接続する配線との間の耐圧を確保することで、磁気記憶装置の信頼性の向上を可能とする。 - 特許庁

A mobile telephone terminal is provided with a loading aperture 26 of an external memory and the external memory is loaded in this loading aperture, whereby the external memory is connected to a mobile telephone terminal.例文帳に追加

携帯電話端末には、外部メモリの装填口26が設けられ、この装填口に外部メモリを装填することにより、外部メモリを携帯電話端末に接続する。 - 特許庁

Each memory is connected through a common bit line in which two cells are a drain or a source, and the memory array is constituted by arranging a plurality of unit memory arrays of the two cells.例文帳に追加

各メモリは2セルがドレイン又はソースとなる共通ビット線を介しして接続されており、この2セルの単位メモリアレイを複数並べることによりメモリアレイを構成する。 - 特許庁

This device has a memory transistor group 10 including a plurality of memory transistors connected in series, and a data read line 16 from which data of the memory transistors is outputted.例文帳に追加

直列接続された複数のメモリトランジスタ11を含むメモリトランジスタ群10、メモリトランジスタ11のデータが出力されるデータ読み出し線16を有している。 - 特許庁

The non-volatile semiconductor memory device 100 includes a plurality of memory strings MS and a plurality of drain side selection transistors SDTr connected to one end of the memory string MS.例文帳に追加

不揮発性半導体記憶装置100は、複数のメモリストリングMS、及びメモリストリングMSの一端に接続された複数のドレイン側選択トランジスタSDTrを有する。 - 特許庁

A microprocessor 1 with a built-in mask ROM(read only memory) and a flash memory 4 are composed of individual chips and both of the microprocessor 1 and the memory 4 are connected oppositely via bumped electrodes 5.例文帳に追加

マスクROM内蔵マイコン1とフラッシュメモリ4が別々のチップで構成され、両者はバンプ電極5を介して対面するように接続されている。 - 特許庁

To easily recognize a connection port of an external memory device, such as a USB memory and to prevent a connected external memory device from being left unremoved.例文帳に追加

USBメモリ等の外部記憶装置の接続ポートを容易に認識できるようにすると共に、接続した外部記憶装置の取り外し忘れを防止することができるようにする。 - 特許庁

The memory core also includes a core cell electrically connected with the word line and the bit line.例文帳に追加

メモリコアは、また、ワード線およびビット線に電気的に接続されたコアセルを備えている。 - 特許庁

The processing unit includes a microprocessor, a memory and an I/O interface connected by busses.例文帳に追加

処理装置は、バスによって接続されたマイクロプロセッサ、メモリ、およびI/Oインタフェースを備える。 - 特許庁

The memory device further includes a row decoder connected to a plurality of the word lines.例文帳に追加

前記メモリ素子は、さらに、前記複数のワードラインに接続された行デコーダを具備する。 - 特許庁

A virtual sharing memory 4 is provided on the network 2 to which terminals 1 are communicably connected.例文帳に追加

各端末1が通信接続されるネットワーク2上に仮想共有メモリ4を設ける。 - 特許庁

Respective bit lines are connected electrically to drains of the prescribed number of memory cells arranged.例文帳に追加

それぞれのビットラインは、所定の数設けられたメモリセルのドレインと電気的に接続する。 - 特許庁

An image processing part 3 and an image memory access control part 11 are connected to each other through the PCI Express serial bus.例文帳に追加

画像処理部3と画像メモリアクセス制御部11とが、PCI Expressシリアルバスで結ばれている。 - 特許庁

The backup battery is connected to the volatile memory via a wiring pattern on the substrate.例文帳に追加

バックアップ電池と揮発性メモリとは、基板の配線パターンを介して接続されている。 - 特許庁

A lurality of memory cards MC1, MC2 are connected with a 2nd input/output terminal group 6.例文帳に追加

第2の入出力端子群6に複数のメモリカードMC1、MC2を接続する。 - 特許庁

A timer control device is connected with a data processing device and a memory.例文帳に追加

本発明のタイマ制御装置は、バスを介してデータ処理装置およびメモリと接続される。 - 特許庁

A host computer 20 is connected to a PBX 10 having a caller number storage memory 12.例文帳に追加

発信者番号記憶メモリ12を有するPBX10にホストコンピュータ20を接続する。 - 特許庁

PHASE CHANGE MEMORY ELEMENT CONNECTED TO EDGE PART OF THIN FILM ELECTRODE, AND METHOD OF MANUFACTURING SAME例文帳に追加

薄膜電極に周囲で接続した相変化メモリ素子およびその製造方法 - 特許庁

The selection transistor SGD is connected between the end of the memory cell group and a bit line BL.例文帳に追加

選択トランジスタSGDはメモリセル群の一端とビット線BL間に接続される。 - 特許庁

Word lines, plate lines, and bit lines are connected respectively to the memory cell.例文帳に追加

本発明において、ワード線、プレート線及びビット線は、それぞれ前記メモリセルと結合する。 - 特許庁

The memory cells MC1-MC3 are connected with a common electric line WLk.例文帳に追加

メモリセルMC1〜MC3はそれぞれ共通の電気線路WLkと接続されている。 - 特許庁

This automatic steering system is provided with a close/open loop control device 1 connected to a memory 2.例文帳に追加

自動操舵システムは,メモリ2に接続された閉/開ループ制御装置1を有する。 - 特許庁

STORAGE DEVICE IN WHICH MEMORY NODES HAVING TRANSFER FUNCTION ARE ALTERNATELY CONNECTED AND DATA PROCESSING METHOD例文帳に追加

転送機能を有するメモリノードを相互に接続したストレージ装置及びデータ処理方法 - 特許庁

The memory card has a connection terminal, etc., for being electrically connected to external electronic equipment.例文帳に追加

メモリカードは外部の電子機器と電気的に接続するための接続端子等を有する。 - 特許庁

The word line WL is connected to gates of a plurality of nonvolatile memory cell transistors 30.例文帳に追加

ワード線WLは、複数の不揮発性メモリセルトランジスタ30のゲートに接続されている。 - 特許庁

The condition determination logic circuit 3 and the condition storage memory 9 are bidirectionally connected with each other.例文帳に追加

条件判断論理回路3と条件記憶メモリ9とは双方向に接続される。 - 特許庁

A memory cell has two anti-fuses connected in series together with at least a diode.例文帳に追加

メモリセルは、少なくともダイオードとともに直列に接続した2つのアンチフューズを備える。 - 特許庁

The global word line is generally directed toward the second direction and is magnetically connected to the memory cell.例文帳に追加

グローバルワード線は概ね、第2の方向に向けられ、メモリセルに磁気的に接続される。 - 特許庁

Each memory cell (114, 414) is connected across the controlled current path of a corresponding shunt element.例文帳に追加

各メモリセル(114,414)は、対応するシャント素子(120,420)の被制御電流経路の両端に接続される。 - 特許庁

例文

Also, the transistor 1-0, the memory cells 1-1, 1-2 are connected to a bit line BL.例文帳に追加

また、トランジスタ1−0,メモリセル1−1,1−2はビット線BLに接続されている。 - 特許庁




  
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