| 例文 |
stack dataの部分一致の例文一覧と使い方
該当件数 : 215件
A communication abnormality generation device 14 includes: a communication control part 14A; and a storage part 14D for storing information necessary to perform communication between communication software 15 and a device 2 to be tested, and an abnormality generation operation condition for application data generated by the communication software 15, and is arranged between the communication software 15 and a protocol stack 13, wherein the application data is exchanged.例文帳に追加
通信異常発生装置１４は、通信制御部１４Ａと、通信ソフトウェア１５と被試験装置２との間で通信を行うため必要な情報と通信ソフトウェア１５が生成するアプリケーションデータに対する異常発生動作条件とが記憶された記憶部１４Ｄとを有し、通信ソフトウェア１５とプロトコルスタック１３におけるアプリケーションデータのやり取りが行われる間に配置される。 - 特許庁
When the Z height is determined for a plurality of ROIs in the visual field, the memory of image data from a specific image of global image stack can efficiently controlled based on determining at an early stage of the treatment whether the specific image is "near peak" focus image which is sufficiently focused.例文帳に追加
視野における複数のＲＯＩ用にＺ高さが決定されると、グローバル画像スタックの特定の画像からの画像データの記憶は、特定の画像が、十分に合焦された「近ピーク」焦点画像であるかどうかを、処理の初期に決定することに基づいて、効率的に制御することが可能である。 - 特許庁
Then, when a certain thread executes garbage collection independently, the data structure which cannot be traced from a route set (stack at the time of execution) intrinsic to the thread and can be referred to only by the thread is derived and turned to a free area, thereby enabling the thread to garbage-collect a memory space for allocation of itself independently.例文帳に追加
そして、あるスレッドが単独でごみ集めの実行するときに、スレッド固有のルート集合（実行時スタック）からトレースできず、かつ、該スレッドのみが参照しうるデータ構造を求め、これを空き領域にすることで、スレッドが単独で自身の割付用メモリ空間をごみ集めすることを可能にする。 - 特許庁
The identical substrate flash memory/DRAM hybrid semiconductor device obtain a DRAM by (1) floating a gate near a substrate and (2) connecting the flash memory to the drain of a write/read pass transistor in a two-layer stack gate structure MOS transistor, storing charges corresponding to data '0', '1', and then turning off the pass transistor.例文帳に追加
２層スタックゲート構造ＭＯＳトランジスタにおいて、基板に近いゲートを（１）フローテングにする事によりフラッシュメモリを、（２）書き込み・読み出し用パストランジスタのドレインに接続して０，１のデータに対応した電荷を蓄積した後、パストランジスタをオフにする事によりＤＲＡＭを実現した同一基板フラッシュ・ＤＲＡＭ混載半導体装置。 - 特許庁
An RTIPSIG protocol stack 310 to be operated on a transmitting node 101 and routers 1 and 3 prepares a connection managing table similar to conventional technology and executes the reservation of resources required for transferring the continuous medium data at the fixed rate between the transmitting node 101 and the router 1 and between the router 3 and a receiving node 105.例文帳に追加
送信ノード１０１、ルータ１、ルータ３の上で動作するRTIPSIGプロトコルスタック３１０は、従来技術と同様なコネクション管理テーブルを作成し、送信ノード１０１とルータ１との間、及び、ルータ３と受信ノード１０５との間で連続メディアデータを一定のレートにより転送するために必要な資源の予約を実行する。 - 特許庁
From measured weight data by a weighing machine 7 mounted on a charger 5, a controller 34 predicts an amount (stack height) of grain with which each container is charged, and shortens a transfer time for a container K with a smaller charge of grain, so that the grain in a container with a small grain amount is prevented from being overdried.例文帳に追加
投入装置５に備えた計量機７による測定重量データを基に制御装置３４は各コンテナ内に投入される穀物の穀物量（堆積高さ）を推測するとともに、投入される穀物量が少ないコンテナＫほど移し替え時間を短くすることにより、穀物量が少ないコンテナにおいて穀物の過乾燥が防止できる。 - 特許庁
A CPU 41a performs initialization 1, when shifting to a setting change mode is performed with only a setting key switch 37 being ON in starting, to initialize, among storage areas of a RAM 41c, all areas except a stack area in use and a stop phase work storing data showing stop phases of reel motors 32L, 32C and 32R.例文帳に追加
ＣＰＵ４１ａは、起動時において設定キースイッチ３７のみがＯＮの状態であり、設定変更モードへ移行する場合において、ＲＡＭ４１ｃの格納領域のうち、使用中スタック領域及びリールモータ３２Ｌ、３２Ｃ、３２Ｒの停止相を示すデータが格納される停止相ワークを除く全ての領域を初期化する初期化１を行う。 - 特許庁
In this information processor having a byte code accelerator BCA which converts an intermediate language (byte code) of stack base into an instruction of a register base, the BCA and a selector SEL for switching instructions are arranged between an instruction fetching part FET and a decoding part DEC and data transfer paths (P4, P5) are provided between the BCA and a register file REG_FILE.例文帳に追加
スタックベースの中間言語(バイトコード）をレジスタベースの命令に変換するバイトコードアクセラレータＢＣＡを備える情報処理装置において、命令フェッチ部ＦＥＴとデコード部ＤＥＣの間にＢＣＡと命令切換のためのセレクタＳＥＬを配置し、ＢＣＡとレジスタファイルＲＥＧ＿ＦＩＬＥとの間にデータ転送経路（Ｐ４、Ｐ５）を設ける。 - 特許庁
The method includes receiving at least one first packet containing voice data, processing the at least one first packet using a real-time packet-enabled stack to form at least one second packet, and providing the at least one second packet to a synchronous controller for transmission over the network.例文帳に追加
本方法は、音声データを含む少なくとも１つの第１のパケットを受信すること、実時間のパケット対応スタックを用いて、少なくとも１つの第２のパケットを形成するようにその少なくとも１つの第１のパケットを処理すること、およびネットワークを介して送信するために、その少なくとも１つの第２のパケットを同期コントローラに送ることを含む。 - 特許庁
When shifting to a setting change mode in the state that only a setting key switch 37 is ON upon activation, a CPU 41a executes the initialization 1 of initializing all areas excluding an in-use stack area and a stop phase work storing data indicating the stop phase of reel motors 32L, 32C and 32R among the storage areas of a RAM 41c.例文帳に追加
ＣＰＵ４１ａは、起動時において設定キースイッチ３７のみがＯＮの状態であり、設定変更モードへ移行する場合において、ＲＡＭ４１ｃの格納領域のうち、使用中スタック領域及びリールモータ３２Ｌ、３２Ｃ、３２Ｒの停止相を示すデータが格納される停止相ワークを除く全ての領域を初期化する初期化１を行う。 - 特許庁
In an information processor having a byte code accelerator BCA for converting a stack base intermediate language (byte code) into a register base instruction, between an instruction fetch part FET and a decoding part DEC, a selector SEL for the BCA and an instruction switch is disposed, and between the BCA and a register file REG_FILE, data transfer channels (P4, P5) are provided.例文帳に追加
スタックベースの中間言語（バイトコード）をレジスタベースの命令に変換するバイトコードアクセラレータＢＣＡを備える情報処理装置において、命令フェッチ部ＦＥＴとデコード部ＤＥＣの間にＢＣＡと命令切換のためのセレクタＳＥＬを配置し、ＢＣＡとレジスタファイルＲＥＧ＿ＦＩＬＥとの間にデータ転送経路（Ｐ４、Ｐ５）を設ける。 - 特許庁
To provide an optical recording medium for accurately obtaining address information and suppressing error increase of data obtained from a reproduction signal of a recording pit by suppressing error increase of a pre-pit signal in both of an unrecorded state and a recorded state, for a deeper side information layer viewed from a light incident side of the optical recording medium manufactured by an IS (Inverted stack) method.例文帳に追加
ＩＳ法により作製された光記録媒体の光入射側からみて奥側の情報層について、未記録状態及び記録後の何れにおいてもプリピット信号のエラー増加を抑えて、アドレス情報を正確に得ることができると共に、記録ピットの再生信号から得られるデータのエラー増加も抑えられる光記録媒体の提供。 - 特許庁
When a rendering sequencer 104 plots the object over a boundary of adjacent band memories, information on a final plotting line of a previous band is held on a stack memory 103, and a DRAM controller 108 sets on the basis of the held information, to offset a plotting start address which shows from which line of the object is required by data of a next band.例文帳に追加
レンダリングシーケンサ１０４が隣接する各バンドメモリの境界に跨ってオブジェクトを描画する際に、先バンドの最終描画ラインの情報をスタックメモリ１０３上に保持して、該保持される情報に基づいて、ＤＲＡＭコントローラ１０８が次バンドのデータがオブジェクトのどのラインから必要なのかを示す描画開始アドレスをオフセット設定する構成を特徴とする。 - 特許庁
The auto-tuner includes a first tuning element configured to cause a control entity to force the process loop to undergo an auto-tuning procedure and a tuning data stack operating within one of the process devices to receive/store a tuning signal associated with the control entity along with a time stamp indicating the time when the tuning signal was acted on by the device.例文帳に追加
オートチューナは、オートチューニング手順をプロセスループに受けさせるために制御エンティティに作用するように構成された第一のチューニングエレメントと、プロセスデバイスのうちの一つのデバイス内で動作し、制御エンティティに関連するチューニング信号とともにその信号に前記デバイスが追従し始めた時間を示すタイムスタンプを受信・格納するチューニングデータスタックとを備えている。 - 特許庁
A device includes a connection migrator that is configured to migrate connections away from the device, the connection migrator is capable of precipitating a compilation of protocol state for a connection across a protocol stack, is adapted to aggregate the compiled protocol state with data for the connection into an aggregated connection state and is further capable of causing the aggregated connection state to be sent toward a target device.例文帳に追加
装置は、装置から離れるように接続を移行するように構成された接続マイグレータであって、プロトコルスタックにまたがる接続に関するプロトコル状態のコンパイルを促進することができ、前記接続に関するデータと共に前記コンパイルされたプロトコル状態を、集約された接続状態に集約するように適合され、さらに、前記集約された接続状態をターゲット装置に向かって送信させることができる接続マイグレータを含む。 - 特許庁
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