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VIL isとは 意味・読み方・使い方
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Wiktionary英語版での「VIL is」の意味 |
vilis
語源
From Proto-Italic *weslis, from Proto-Indo-European *weslis, a deverbal adjective with passive meaning ("which can be bought"), from the root of venus (“sale”).
語形変化
Third-declension two-termination adjective.
| Number | Singular | Plural | |||
|---|---|---|---|---|---|
| Case / Gender | Masc./Fem. | Neuter | Masc./Fem. | Neuter | |
| Nominative | vīlis | vīle | vīlēs | vīlia | |
| Genitive | vīlis | vīlium | |||
| Dative | vīlī | vīlibus | |||
| Accusative | vīlem | vīle | vīlēs vīlīs |
vīlia | |
| Ablative | vīlī | vīlibus | |||
| Vocative | vīlis | vīle | vīlēs | vīlia | |
派生した語
参照
- “vilis”, in Charlton T. Lewis and Charles Short (1879) A Latin Dictionary, Oxford: Clarendon Press
- “vilis”, in Charlton T. Lewis (1891) An Elementary Latin Dictionary, New York: Harper & Brothers
- vilis in Gaffiot, Félix (1934) Dictionnaire illustré latin-français, Hachette
- Carl Meißner; Henry William Auden (1894) Latin Phrase-Book[1], London: Macmillan and Co.
「VIL is」の部分一致の例文検索結果
該当件数 : 10件
By determination of occurrence of the offset abnormality, each signal voltage value of linear voltage Vil is replaced with a signal voltage value obtained by reversing the positive/negative of each signal voltage value of half waveform voltage Viw before 1/2 period of each signal voltage value, and the half waveform voltage Viw and the replaced linear voltage Vil are offset by a value corresponding to offset value Vof.例文帳に追加
このオフセット異常が生じているとの判定により、直線状電圧Ｖｉｌの各信号電圧値が当該各信号電圧値よりも１／２周期前の半波波形状電圧Ｖｉｗの各信号電圧値の正負を反転した信号電圧値で置換されるとともに、半波波形状電圧Ｖｉｗと上記置換した直線状電圧Ｖｉｌとがオフセット電圧Ｖｏｆに相当する値だけオフセットされる。 - 特許庁
When the drive voltage Vi is smaller than the reference voltage ViL, a PMOS 61 is turned on to raise the drive voltage Vi of the node N6, and the constant current circuit 20N is inactivated.例文帳に追加
駆動電圧Ｖｉ＜基準電圧ＶｉＬのときは、ＰＭＯＳ６１がオンとなってノードＮ６の駆動電圧Ｖｉを引き上げると共に、定電流回路２０Ｎの動作が停止する。 - 特許庁
The driver DR1 outputs a signal set in a VIL of voltage level when an input signal is a high level, and set in a VIH of voltage level when it is low level.例文帳に追加
ドライバＤＲ１は、入力信号がハイレベルのときに電圧レベルをＶＩＬに、ローレベルのときに電圧レベルをＶＩＨに設定した信号を出力する。 - 特許庁
Consequently, a user easily adjusts the threshold values VIH, VIL to arbitrary values between the power source potential VDD and reference potential VSS, and versatility of the Schmitt trigger circuit is expanded.例文帳に追加
したがって、ユーザがスレッシュホールド値ＶＩＨ，ＶＩＬを電源電位ＶＤＤと基準電位ＶＳＳの間の任意の値に容易に調整することができ、シュミットトリガ回路の汎用性が広がる。 - 特許庁
When the voltage value of the output voltage signal VIL is decreased to the lower limit value setting voltage V2 (a region E2), the output of the voltage comparator COMP2 transits from a low level to a high one.例文帳に追加
出力電圧信号ＶＩＬの電圧値が、下限値設定電圧Ｖ２まで減少すると（領域Ｅ２）、電圧比較器ＣＯＭＰ２の出力がローレベルからハイレベルへ遷移する。 - 特許庁
When the voltage value of the output voltage signal VIL reaches the error amplification signal V1 (a region E1), the main transistor FET1 is turned off.例文帳に追加
一方、出力電圧信号ＶＩＬの電圧値が、誤差増幅信号Ｖ１に到達すると（領域Ｅ１）、メイントランジスタＦＥＴ１が非導通状態とされる。 - 特許庁
When a detection signal Vil of a primary electric current of a booster transformer 2 reaches to a cutoff value set signal Vis obtained from a resistance voltage dividing circuit 4b, a switch 3 for chopper is turned off to cut off the primary electric current of the booster transformer.例文帳に追加
昇圧トランス２の一次電流の検出信号Ｖi1が、抵抗分圧回路４ｂから得られる遮断値設定信号Ｖisに達したときにチョッパ用スイッチ３をオフにして昇圧トランスの一次電流を遮断する。 - 特許庁
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「VIL is」の部分一致の例文検索結果
該当件数 : 10件
A logic circuit is structured by a 74HCT type CMOS gate element 10 of Hi level input voltage VIH=2 V(min) and Lo level input voltage VIL=0.8 V(max) in correspondence to a TTL level input (0 to 5 V).例文帳に追加
TTLレベル入力（0〜5V）に対応しHiレベル入力電圧V_IH＝2V(min)、Loレベル入力電圧V_IL ＝0.8V(max)の74HCTタイプCMOSゲート素子10によってロジック回路を構成する。 - 特許庁
When the drive voltage Vi is greater than the reference voltage ViL and smaller than the reference voltage ViH, the signals S4P, S4N are respectively set to "H", "L", and the PMOS 61 and the NMOS 62 are turned off while the control signals CP, CN are set to "H" and monitoring is performed by a comparator circuit.例文帳に追加
一方、基準電圧ＶｉＬ＜駆動電圧Ｖｉ＜基準電圧ＶｉＨのときは、信号Ｓ４Ｐ，Ｓ４Ｎはそれぞれ“Ｈ”，“Ｌ”となってＰＭＯＳ６１とＮＭＯＳ６２はオフとなるが、制御信号ＣＰ，ＣＮは“Ｈ”となって、比較回路により監視が行われる。 - 特許庁
When an input signal IN is transferred from an Hi level to an Lo level, a transistor MP3 is turned OFF until the input signal IN reaches a logic threshold value or less, and a Low-level input voltage ViL reaches a reference voltage VREF level by comparing a reference voltage VREF and the input signal IN.例文帳に追加
入力信号ＩＮがＨｉレベルからＬｏレベルに遷移した際、トランジスタＭＰ３は入力信号ＩＮが論理しきい値以下になるまではＯＦＦしており、基準電圧ＶＲＥＦと入力信号ＩＮとを比較することによって、Ｌｏｗレベル入力電圧ＶｉＬは基準電圧ＶＲＥＦレベルとなる。 - 特許庁
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