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Weblio 辞書 > 英和辞典・和英辞典 > マトリクス記憶装置に関連した英語例文

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マトリクス記憶装置の部分一致の例文一覧と使い方

該当件数 : 37



例文

複数のディザマトリクスを使用する場合でも記憶装置記憶領域が小さくて済むようにする。例文帳に追加

To make a required storage area of a storage device small even when using plural dither matrices. - 特許庁

閾値マトリクスを用いて画像処理を行う画像処理装置において、閾値マトリクス記憶するためのメモリ容量を低減する。例文帳に追加

To reduce memory capacity for storing a threshold matrix in an image processing apparatus which performs image processing using the threshold matrix. - 特許庁

単純マトリクス型強誘電体記憶装置並びにその設計方法及び検査方法例文帳に追加

SIMPLE MATRIX TYPE FERROELECTRIC STORAGE DEVICE, AND METHOD FOR DESIGNING AND INSPECTING SAME - 特許庁

半導体記憶装置は、マトリクス状に配置されたメモリセルと複数のワード線16とを有する。例文帳に追加

The semiconductor storage device comprises memory cells 13 arranged in a matrix, and a plurality of word lines 16. - 特許庁

例文

コンピュータが実現するプルーフ画像生成装置の固定ディスク104には、元画像のデータ7および閾値マトリクス81が記憶され、プルーフ用マトリクス生成部21においてプルーフ用の解像度に合わせて閾値マトリクス81が低解像度化され、プルーフ用マトリクスが生成される。例文帳に追加

A hard disk 104 of a proof image generating apparatus realized by a computer stores data 7 and a threshold matrix 81 of an original image, a proof matrix generating section 21 converts elements of a threshold matrix 81 into those for a low resolution matrix in matching with the proof purpose resolution to produce a proof matrix. - 特許庁


例文

各監視装置1は、自装置を含む複数の監視装置の位置と権限とを定義した連携マトリクスを生成する連携マトリクス生成手段と、生成された連携マトリクス記憶する記憶手段と、この記憶手段に格納された連携マトリクスで定義された自装置の権限に応じて設備管理を行う制御手段とを有する。例文帳に追加

Each supervisory apparatus 1 includes: a coordination matrix generating means for generating a coordination matrix for defining positions and rights of a plurality of the supervisory apparatuses including its own supervisory apparatus; a storage means for storing the generated coordination matrix; and a control means for conducting facility management depending on the right of its own apparatus defined by the coordination matrix and stored in the storage means. - 特許庁

半導体記憶装置は、複数のSRAMセルMCがマトリクス状に配置されたメモリセルアレイを有する。例文帳に追加

The semiconductor memory device has a memory cell array in which a plurality of SRAM cells MCs are arranged in matrix. - 特許庁

画素内蔵記憶回路を有しながら低消費電力を実現するアクティブマトリクス型ディスプレイ装置等を提供する。例文帳に追加

To provide an active matrix type display device or the like which obtains low power consumption, while having a pixel built-in storage circuit. - 特許庁

酸化物半導体層を有する薄膜トランジスタが少なくとも一つ設けられた記憶素子を、マトリクス状に配置した記憶装置を提供する。例文帳に追加

The memory device is provided in which memory elements each being equipped with at least one thin film transistor having an oxide semiconductor layer are arranged in a matrix. - 特許庁

例文

画面記憶部2は分析装置を構成する各ユニットについて機能ごとに独立した画面を、機能とユニットのマトリクス構造として記憶しており、表示部4は画面記憶部2に記憶されている画面のうちの1つを表示する。例文帳に追加

An image storing part 2 stores images independent a function by a function, relating to respective units for constituting an analyzer, as matrix structure of the functions and the units, and a display part 4 displays one out of the images stored in the storing part 2. - 特許庁

例文

従って、従来、画像の濃度補正に必要であった各ディザマトリクスに対応して作成されていた濃度パッチを不要とすることができるので、その濃度パッチを記憶する記憶装置の容量が不要となり、記憶装置の容量を低減させることができる。例文帳に追加

Since density patches prepared according to respective dither matrixes which are required for image density correction in a conventional method can be made unnecessary, the capacity of the storage device for storing the density patches can be made unnecessary and the capacity of the storage device can be reduced. - 特許庁

カラー画像処理装置10は、ディザマトリクスの各画素に対応付けられた閾値群を格納する記憶部192と、記憶部192に格納された閾値群を読み出し、入力画像中の画素の濃度値とその画素に対応するディザマトリクス中の画素の閾値群との比較結果に基づいて、入力画像の濃度値を量子化してディザ画像を作成する量子化部191とを備えている。例文帳に追加

A color image processing apparatus 10 includes: a storage part 192 for storing a group of thresholds each associated with each of pixels of a dither matrix; and a quantizing part 191 for reading the group of thresholds stored in the storage part 192, quantizing the density value of an input image on the basis of results of comparison between the density value of pixels in the input image and a group of thresholds of pixels in the dither matrix and creating a dither image. - 特許庁

表示制御装置10のメモリ部100には、情報画像54の情報画素領域540と背景画素領域541とについての第一階調と第二階調とを定義するマトリクスデータが予め記憶される。例文帳に追加

In a memory section 100 of the display control apparatus 10, matrix data which defines first gradation and second gradation for an information pixel region 540 and a background pixel region 541 of the information image 54 is stored in advance. - 特許庁

メモリセルのデータの読み出しまたは消去・書き込みにおけるデータの破壊およびディスターブを皆無とし、かつ少ない素子からなるメモリセルでマトリクスアレイを構成した半導体記憶装置を提供することを目的とする。例文帳に追加

To provide a semiconductor storage device wherein, with a matrix array comprising a memory cell of less elements, the destruction or disturbance of data is eliminated at reading or erasing/writing of the data of memory cell. - 特許庁

本発明に係る半導体記憶装置は、SOI基板1上に縦型トランジスタからなるFBC2をマトリクス状に配置したものであり、SOI基板1の埋め込み酸化膜3とFBC2との間に金属層4を形成する。例文帳に追加

This semiconductor memory device includes an FBC 2 made of the vertical transistor disposed in a matrix form on an SOI substrate 1, and a metal layer 4 formed between a buried oxide film 3 of the SOI substrate 1 and the FBC 2. - 特許庁

印刷管理装置3はこの主要色成分濃度差から、予め記憶されているマトリクスに基づいて印刷機2のインキ壺50の開閉キーの開度調整値を求め印刷機2に出力する。例文帳に追加

Based on this main color component density difference, the printing control device 3 determines an opening regulation value of an opening-closing key of an ink fountain 50 of a printing press 2 on the basis of a matrix stored beforehand and outputs it to the printing press 2. - 特許庁

記憶素子と薄膜トランジスタで構成されたパッシブマトリクス型素子において、クロストークを解決する半導体装置およびその作製方法を提供する。例文帳に追加

To provide a semiconductor device which solves cross talk problems and to provide its manufacturing method, in relation to a passive matrix element constituted of a memory element and a thin film transistor. - 特許庁

端末間通信パターン監視装置はトラヒックデータ取得部とハッシュマトリクス生成/記憶部と端末間通信パターン類似度計算部を備える。例文帳に追加

An inter-terminal communication pattern monitoring apparatus is provided with a traffic data acquiring section, a hash matrix generating/storage section and a section for calculating the degree of similarity pattern between terminals. - 特許庁

周期的なノイズと網点の周期構造との干渉が小さく、ザラツキの回避や網点形状の乱れ防止も実現される網点化装置、網点化プログラム、網点マトリクス記憶媒体を提供する。例文帳に追加

To provide a halftone dot conversion apparatus, a halftone dot conversion program, and a dot matrix storage medium small in interference between periodic noises and a periodic structure of halftone dots for contributing to avoiding graininess and prevention of the disorder in geometry on halftone dots. - 特許庁

ノイズが印加されたとしても各メモリセルに記憶されているデータ値を的確に読み出して出力することができるマトリクス状に配列されたメモリセルアレイに対するセンスアンプ回路及びそれを有する半導体記憶装置を提供すること。例文帳に追加

To provide a sense amplifier circuit for a memory cell array arranged in a matrix, capable of accurately reading a data value stored in each memory cell even when noise is applied, and to provide a semiconductor memory device including the sense amplifier. - 特許庁

プルーフ画像生成装置の固定ディスク104には、元画像のデータ7および閾値マトリクス81が記憶され、3次元LUT生成部21において閾値マトリクス81を用いてプルーフ用の解像度に変換された元画像が取り得る階調レベルにそれぞれ対応する複数の2値の平網画像が生成される。例文帳に追加

A hard disk 104 of a proof image generating apparatus realized by a computer stores data 7 and a threshold matrix 81 of an original image, and a three-dimensional LUT generating section 21 uses the threshold matrix 81 to produce a plurality of binary screen tint images respectively corresponding to gradation levels which the original image converted to have a proof purpose resolution can take. - 特許庁

有機発光素子33を利用する画素37がもつ駆動トランジスタ32の特性に応じて画素37に電圧を印加するための補償データを記憶するための記憶手段761と、記憶手段761によって記憶されている補償データに基づいて画素37に電圧を印加するためのドライバ・コントローラ部と、を備えた、アクティブマトリクス型表示装置である。例文帳に追加

An active matrix display device includes a storing means 761 to store compensation data for applying voltage to a pixel 37 according to characteristics of a driving transistor 32 that a pixel 37 using the organic light emitting element 33 has; and a driver controller to apply voltage to the pixel 37 according to the compensation data stored in the storing means 761. - 特許庁

制御装置20が、光クロスコネクト装置10内のマトリクススイッチの障害情報を障害テーブル22に記憶し、光クロスコネクト装置10の使用経路の情報を使用中経路テーブル24に格納し、障害時に新たな経路を設定する。例文帳に追加

A controller 20 stores trouble information of the matrix switch in the optical crossconnect system 10 in a trouble table 22, stores the information of a route under use in the optical crossconnect system 10 in a route table 24 under use and sets a new route upon occurrence of a trouble. - 特許庁

中間調処理に必要な閾値マトリクス記憶容量を削減し、高画質な画像データを出力する画像処理装置、画像形成装置、画像処理方法、画像処理プログラムおよび画像処理プログラムを記録したコンピュータ読み取り可能な記録媒体を提供する。例文帳に追加

To provide an image processor, image forming apparatus, image processing method, image processing program and computer readable recording medium with image processing program recorded thereon in which storage capacity of a threshold matrix required for half-tone processing is reduced and high-quality image data are outputted. - 特許庁

本発明の液晶表示装置は、データ記憶機能付き液晶表示装置であって、画素回路基板の表示領域に、画素表示回路251と、当該画素表示回路251とは電気的に分離したメモリ回路2521,2522が、それぞれマトリクス形成されてなることを特徴とする。例文帳に追加

The liquid crystal display device in this invention is the one with the data storage function, and is characterized by that pixel display circuits 251 and memory circuits 2521 2522 electrically separated from the pixel display circuits 251 are formed in a matrix, respectively. - 特許庁

その際、エラーを含む検出素子の位置情報およびエラーの程度の情報を記憶装置に格納し、画像再構成ソフトウェアの内部において参照することによって、前記システムマトリクスをエラーに合わせて修正することができる。例文帳に追加

Then, positional information on the detection element including the error and information on the error degree are stored in a storage device and are referred to inside image reconstruction software, so that the system matrix can be modified in accordance with the error. - 特許庁

本アクティブマトリクス型表示装置の表示制御回路200に備えられるアドレス信号出力部24は、タイミング制御部23からのタイミング制御信号TSに応じて、所定のルックアップテーブルに予め記憶された所定の順番でアドレス信号A0,A1,A2を出力する。例文帳に追加

An address signal output part 24 equipped to a display control circuit 200 of the active matrix-type display outputs address signals A0, A1, and A2, in a predetermined order stored in a predetermined look-up table beforehand, according to the timing control signal TS from a timing control part 23. - 特許庁

不揮発性半導体記憶装置1において、シリコン基板上に絶縁膜と導電膜13とを交互に積層させて積層体14を形成し、この積層体14に、積層方向に延びる複数の貫通ホールをマトリクス状に形成する。例文帳に追加

The nonvolatile semiconductor memory device 1 comprises a laminate 14 formed with an insulating film and a conductive film 13, laminated alternately on a silicon substrate, and a plurality of through-holes extending in the laminated direction are formed in matrix state on the laminate 14. - 特許庁

記憶保持機能を有するアクティブマトリクス型の液晶表示パネルを用いた液晶表示装置における、主電源OFF時に液晶表示パネルに残る残像を速やかに消去し、表示品位の向上を図ると共に、残像に伴う異常な電圧の印加による液晶の劣化を防止する。例文帳に追加

To speedily eliminate a residual image remaining on a liquid crystal display panel when switching off the main power to improve the display quality, and also to prevent the liquid crystal from being deteriorated by applying abnormal voltage thereto accompanying the residual image, in a liquid crystal display device using the active matrix type liquid crystal display panel having a storage function. - 特許庁

半導体記憶装置に、複数のメモリセルがマトリクス状に配設されたメモリセルアレイと、制御信号に応じて、複数のメモリセルの中から動作を行うメモリセルを選択するデコーダと、デコーダに対して制御信号を出力するか否かを選択する制御回路と、を設ける。例文帳に追加

A semiconductor memory device comprises: a memory cell array in which a plurality of memory cells are arranged in a matrix shape; a decoder selecting a memory cell to perform operation from among the plurality of memory cells depending on a control signal; and a control circuit selecting whether to output the control signal to the decoder. - 特許庁

取込画像サイズと、その取込画像がプリントされる出力サイズとに応じて、記憶部129に記憶されているマトリクス表を参照して、スキャナI/F部156を介して、入力解像度設定部124は、最適な読取解像度をスキャナ装置190に設定し、また取込画像品質設定部127は、最適なシャープネス値をスキャナ装置190に設定する。例文帳に追加

An input resolution setting part 124 sets optimum reading resolution in the scanner device 190 through a scanner I/F part 156 and a captured image quality setting part 127 sets an optimum sharpness value in the scanner device 190 with reference to a matrix table stored in a storing part 129 in accordance with the captured image size and an output size in which the captured image is printed. - 特許庁

マトリクス状に配置された複数の表示画素PXと、複数の表示画素PXを駆動する駆動手段GD、SDと、複数の表示画素PX毎の表示特性データを記憶する記憶手段44Aと、表示特性データに基づいて複数の表示画素PXの夫々に供給する信号を補正する補正演算手段44Bと、を備える表示装置例文帳に追加

The display device includes: a plurality of display pixels PX arranged in a matrix; driving means GD and SD for driving the plurality of display pixels PX; a storage means 44A for storing display characteristic data for each of the plurality of display pixels PX; and a correction calculation means 44B for correcting signals supplied to the respective plurality of display pixels PX based on the display characteristic data. - 特許庁

製氷タイマーはあらかじめ記憶装置記憶させたマトリクスに従って設定された設定時間が経過したら終了(ステップS15)して冷却ユニットの運転を停止させ、ブライン温度を再び氷結点近辺に上昇させて(ステップS16)、ユーザーに知らせて(ステップS17)製氷を完了させる。例文帳に追加

The ice making timer is ended upon elapsing a time set according to a matrix prestored in a memory (step S15) to stop operation of the cooling unit and then the brine temperature is raised again to the vicinity of freezing point (step S16) and the fact is informed to a user (step S17) before completing ice making. - 特許庁

本発明のGUIの部品画像生成装置1は、直交する縦横の二方向においてそれぞれ一端部、中央部、他端部の3つにマトリクス状に区分された9つの要素画像を記憶する要素画像データ記憶手段10と、該要素画像を前記二方向に配設することによりGUIの部品画像を生成する部品画像生成手段15とを備えている。例文帳に追加

A device for generating a part image of GUI 1 has an element image data storage means 10 for storing nine element images which are divided, as a matrix, into three parts of end, central part and another end in two orthogonal vertical and horizontal directions, respectively; and a part image generating means 15 which generates the part images of the GUI by disposing the element images in the two directions. - 特許庁

基準電圧選択型D/A変換回路を用いたアクティブマトリクス型有機EL表示装置において、表示パネル20の画素行ごとの輝度レベルを、例えば標準輝度レベル、標準よりも明るいおよび暗いの3段階に評価して、その評価結果を画素行ごとにメモリ装置55に記憶しておく。例文帳に追加

In an active-matrix organic EL display device using a reference voltage selection type D/A conversion circuit, the luminance level for each pixel row of a display panel 20 is evaluated into three levels of a standard luminance level, a level brighter than the standard, and a level darker than the standard, and the evaluation result for each pixel row is stored in a memory device 55. - 特許庁

マトリクス状に配置されたワード線およびビット線と、前記ワード線とビット線との交差点に配置された複数のメモリセル110とを有する半導体記憶装置において、同一のビット線上に配置されたメモリセル110に供給されるローデータ保持電源の電位を制御するビット線プリチャージ回路120を設ける。例文帳に追加

In the semiconductor memory including word lines and bit lines arranged in a matrix and a plurality of memory cells 110 provided at intersections of the word lines and the bit lines, bit line precharge circuits 120 are provided for controlling potential of a low-data holding power supply to be supplied to memory cells 110 provided on the same bit lines. - 特許庁

例文

半導体記憶装置100は、マトリクス状に配置されたメモリセルMCを含むメモリセルアレイMCAと、メモリセルアレイMCAの各行のメモリセルMCに接続された複数のワード線WLと、ワード線WLの各々に対応して設けられたカウンタセルCCを含み、メモリセルMCのデータを読み出すためにワード線WLを活性化させた回数を記憶するカウンタセルアレイCCAとを備えている。例文帳に追加

The semiconductor storage device 100 comprises a memory cell array MCA including memory cells MC arranged in a matrix form, a plurality of word lines WL connected to the memory cells MC of each row in the memory cell array MCA, and a counter cell array CCA which includes counter cells prepared correspondingly to each word line, and stores the frequency of activating the word lines WL for reading the data of the memory cells MC. - 特許庁

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