INTERCONNECTを含む例文一覧と使い方
該当件数 : 1154件
As a result, the width of the interconnect 64 where the conductors are divided between the layers 36 and 52, can be substantially reduced.例文帳に追加
その結果、導体が層36,52間で分割される相互接続64の幅が実質的に減少される。 - 特許庁
Furthermore, a fine-pitch interconnect line pattern board which is comparatively expensive can be reduced in size to an irreducible minimum.例文帳に追加
さらに、比較的高コストとなる狭ピッチ配線パターンの基板を必要最小限の大きさにすることができる。 - 特許庁
To provide a semiconductor integrated circuit in which the number of vias being inserted into an interconnect line can be decreased.例文帳に追加
配線経路に挿入されるビヤの数を低減することができる半導体集積回路を提供する。 - 特許庁
A plurality of interconnect lines 12a-12f with different pitches P1-P3 are formed on an underlying insulating layer 10.例文帳に追加
下地絶縁層10上に、配線間のピッチP1〜P3が異なる複数の配線12a〜12fを形成する。 - 特許庁
To provide a wiring connection structure capable of restraining voids from concentrating on an interconnect line under a via due to stress migration.例文帳に追加
ストレスマイグレーションによるビア下配線中のボイドの集中を抑制する配線接続構造を提供する。 - 特許庁
To provide an interconnect and method for interconnecting a tightly packed electrical device array with a flex circuit.例文帳に追加
密集した電気デバイスアレイをフレックス回路と相互接続するための相互接続部及び方法を提供する。 - 特許庁
The legs of the joints 12a and 12b are connected with the interconnect lines 21a and 21b by solders 14a and 14b.例文帳に追加
接続部12a,12bは、脚部が半田14a,14bによって配線21a,21bに接続されている。 - 特許庁
An interconnect structure is disclosed comprising a collection of input ports, a collection of output ports, and a switching element.例文帳に追加
入力ポートの集まり、出力ポートの集まり、およびスイッチング素子を含む相互接続構造が開示された。 - 特許庁
A NUMA computer system 50 has at least two nodes 52 coupled by a node interconnect switch 55.例文帳に追加
NUMコンピュータシステム50は、ノード相互接続スイッチ55により結合されノード52を2つ以上有している。 - 特許庁
To interconnect a plurality of film-enclosed batteries easily while maintaining airtightness on the inside and outside of the battery.例文帳に追加
複数のフィルム外装電池同士を容易に接続可能とし、かつ、電池内外の気密性を保持すること。 - 特許庁
Tubular outer and inner cylinders 2 and 6 are disposed in a ventilation hole 30 to interconnect the inside and the outside of a house wall.例文帳に追加
屋壁の内外をつなぐ換気孔30内に筒状の外筒2及び内筒6が配設されている。 - 特許庁
To suppress high resistance in gate electrodeinterconnect line which is caused by a disconnection of silicide layer on the gate electrode interconnect line.例文帳に追加
ゲート電極配線上のシリサイド層の断線に起因するゲート電極配線の高抵抗化を抑制する。 - 特許庁
To form an interconnect or plug made of metal which is free from the occurrence of erosion and production of polishing residues.例文帳に追加
エロージョンの発生及び研磨残渣の発生がない金属からなる配線又はプラグを形成できるようにする。 - 特許庁
Two types of standard cells 101 and 151 having all the same layout pattern excepting the interconnect width are prepared.例文帳に追加
配線幅以外は全て同一のレイアウトパターンを備えた2種類のスタンダードセル101、151が用意される。 - 特許庁
METHOD AND SYSTEM FOR DIAGNOSTIC APPROACH TO FAULT ISOLATION AT DEVICE LEVEL ON PERIPHERAL COMPONENT INTERCONNECT (PCI) BUS例文帳に追加
周辺装置相互接続(PCI)バス上のデバイス・レベルの故障分離の診断手法のための方法およびシステム - 特許庁
To provide a method of polishing a patterned semiconductor wafer containing a copper interconnect metal with a polishing pad.例文帳に追加
局面は、銅配線金属を含有するパターン付き半導体ウエーハを、研磨パッドで研磨する方法を提供する。 - 特許庁
For example, an anticorrosive 2 on the surface of a lower layer interconnect line 11 is removed through irradiation only with the hydrogen active species 3.例文帳に追加
例えば、下層配線11表面の防錆剤2は水素活性種3の照射のみにより除去する。 - 特許庁
A data transfer section 111 contained in a process 110 performs interconnect data transfer when the process is executed.例文帳に追加
プロセス110に含まれるデータ転送部111が、そのプロセスが実行されるときインターコネクトデータ転送を行なう。 - 特許庁
To provide a structure and method for a chip-scale package stacked on an interconnect film for a vertical assembly on a substrate.例文帳に追加
基板上の垂直組立体用の相互接続フィルム上にスタックするチップスケールパッケージの構造と方法。 - 特許庁
The written data are transferred to the shared memory 39 of the waiting system server device 13 via the interconnect 14.例文帳に追加
書き込まれたデータは、インターコネクト14を通じて、待機系サーバ装置13の共有メモリ39に転送される。 - 特許庁
To certainly and electrically interconnect a plurality of conductive films formed on mutually different layers, for example.例文帳に追加
例えば、相互に異なる層に形成され複数の導電膜の夫々を相互に電気的に確実に接続する。 - 特許庁
This invention discloses an assembly, device and method related to the interconnect of solid oxide fuel cell.例文帳に追加
本発明は、固体酸化物燃料電池インターコネクトに関する組立体、装置及び方法を開示するものである。 - 特許庁
To provide a semiconductor device capable of micromachining re-interconnect line precisely and easily, and to provide its fabricating process.例文帳に追加
再配線を微細で精密に加工することが容易な半導体装置及びその製造方法を提供する。 - 特許庁
A NUMA computer system 50 has at least two nodes 52 coupled by a node interconnect switch 55.例文帳に追加
NUMAコンピュータ・システム50は、ノード相互接続スイッチ55により結合され、ノード52を2つ以上有している。 - 特許庁
The interconnect structure is prepared inside a detector (26) module used for an imaging system (10).例文帳に追加
上記の相互接続構造は、イメージング・システム(10)に使用するための検出器(26)モジュール内に設けられる。 - 特許庁
A NUMA computer system 50 has at least two nodes 52 coupled by a node interconnect switch 55.例文帳に追加
NUMAコンピュータ・システム50は、ノード相互接続スイッチ55により結合される2つ以上のノード52を含む。 - 特許庁
A protrusion 32 reaching the interior of the upper layer Cu interconnect line 41 is provided at the upper end of the Al plug 31.例文帳に追加
Alプラグ31の上端には、上層Cu配線41の内部に到達する突出部32を設ける。 - 特許庁
The aqueous polishing composition includes a corrosion inhibitor for limiting the removal of an interconnect metal with an acidic pH.例文帳に追加
水性研磨組成物は、酸性pHで、配線金属の除去を制限するための腐食インヒビターを含む。 - 特許庁
COPPER ALLOY SPUTTERING TARGET FOR FORMING SEMICONDUCTOR DEVICE INTERCONNECT LINE SEED LAYER AND SEED LAYER FORMED USING THAT TARGET例文帳に追加
半導体装置配線シード層形成用銅合金スパッタリングターゲットおよびこのターゲットを用いて形成したシード層 - 特許庁
METHOD OF FORMING SOLID BLIND VIAS THROUGH DIELECTRIC COATING ON HIGH DENSITY INTERCONNECT (HDI) SUBSTRATE MATERIALS例文帳に追加
高密度相互接続(HDI)基材材料上の誘電コーティングを貫く固体ブラインドビアを形成する方法 - 特許庁
Interconnection in the logical cells and interconnection between the logical cells are constituted only of upper n interconnect layer (n<m).例文帳に追加
論理セル内の配線および論理セル間の配線を、上位n層の配線層(n<m)のみを用いて構成する。 - 特許庁
PROCESS FOR FORMING COPPER PATTERN INTERCONNECT LINE, SEMICONDUCTOR DEVICE FABRICATED USING THAT METHOD, AND NANO COPPER METAL PARTICLE例文帳に追加
銅パターン配線形成方法及び該方法を用いて作成された半導体装置、並びにナノ銅金属粒子 - 特許庁
Source and drain regions 9 in the top surface of the semiconductor substrate 1 are electrically connected to copper interconnect lines 29.例文帳に追加
半導体基板1の上面内のソース・ドレイン領域9は銅配線29に電気的に接続されている。 - 特許庁
METHOD AND SYSTEM FOR SUPPORTING PLURAL PERIPHERAL COMPONENTS INTERCONNECT BUSES SUPPORTING VARIOUS FREQUENCY OPERATIONS例文帳に追加
様々な周波数動作をサポ—トする複数の周辺構成要素相互接続バスをサポ—トする方法およびシステム - 特許庁
The semiconductor chip includes an interconnect which is electrically independent of the internal circuit, and connected between the pair of pads.例文帳に追加
半導体チップは、内部回路から電気的に独立し、かつ一対のパッド間に接続された配線を含む。 - 特許庁
The connection interconnect 13 has a thickness larger than the first thickness and smaller than the second thickness.例文帳に追加
接続配線13の厚さは、第1の厚さより大きく且つ第2の厚さより小さいことを特徴とする。 - 特許庁
INTEGRATED CIRCUIT DEVICE HAVING DUAL DAMASCENE INTERCONNECT STRUCTURE AND METAL ELECTRODE CAPACITOR AND METHOD OF MANUFACTURING SAME例文帳に追加
デュアル・ダマーシン相互接続構造および金属電極コンデンサを有する集積回路デバイスとその製造方法 - 特許庁
IMPROVED NONVOLATILE REWRITABLE INTERCONNECT CELL HAVING WRITABLE EMBEDDED SOURCE/DRAIN IN SENSE TRANSISTOR例文帳に追加
センストランジスタ中の書き込み可能埋込ソ—ス/ドレインを有する改善された不揮発性再書き込み可能インタ—コネクトセル - 特許庁
The method is disclosed for forming the copper interconnection conductor in order to interconnect and couple active and passive elements.例文帳に追加
能動及び受動素子を配線連結するために、銅配線導電体を形成する方法が開示される。 - 特許庁
These additional instructions extends conventional JTAG operation and enables the test of the high speed interconnect circuit.例文帳に追加
これらの追加された命令は従来型JTAG動作を拡張し、高速接続回路のテストを可能とする。 - 特許庁
In one example of the invention, an interconnect assembly comprises a substrate, a resilient contact element and a stop structure.例文帳に追加
本発明の一つの実施例では、相互接続アセンブリは基板と、弾性接触要素と、ストップ構造とからなる。 - 特許庁
To provide an apparatus and a method for controlling transaction reordering by slave logic units coupled to the interconnect logic.例文帳に追加
相互接続論理に結合されたスレーブ論理ユニットによりトランザクションのリオーダを制御する装置と方法。 - 特許庁
Interconnect widths Ws1 and Wd1 of metal interconnects 108 and 110 in a cell are set thick in one standard cell 101, and interconnect widths Ws2 and Wd2 of metal interconnects 158 and 160 in a cell are set thinner than the interconnect widths Ws1 and Wd1 of one standard cell 101 (Ws2<Ws1, Wd2<Wd1).例文帳に追加
一方のスタンダードセル101は、セル内部のメタル配線108、110の配線幅Ws1、Wd1は太く、他方のスタンダードセル151では、セル内部のメタル配線158、160の配線幅Ws2、Wd2は、前記一方のスタンダードセル101の配線幅Ws1、Wd1よりも細く設定される(Ws2<Ws1、Wd2<Wd1)。 - 特許庁
When the transparent conductive film is formed on a transparent board equipped with Al interconnect lines using the above material, the Al interconnect lines are hardly eluted in a developing process carried out by the use of TMAH even when barrier metal etc are not used.例文帳に追加
この材料を用いてAl配線を備えた透明基板上に透明導電膜を成膜すれば、バリヤーメタル等を用いなくても、TMAHを用いた現像処理を行っている最中にAl配線が溶出することがない。 - 特許庁
After forming an insulating side wall 105 to each side face of the gate electrode 104a and the gate interconnect line 104b, the insulating side wall 105, formed in a side face of at least one portion of the gate interconnect line 104b, is removed.例文帳に追加
ゲート電極104a及びゲート配線104bのそれぞれの側面に絶縁性サイドウォール105を形成した後、ゲート配線104bの少なくとも一部分の側面に形成された絶縁性サイドウォール105を除去する。 - 特許庁
To provide a process for fabricating a semiconductor device in which low cost is realized, an interconnect line can be formed with good coverage in a contact hole of high aspect ratio, capacity of the interconnect line can be reduced, and multilevel metallization can be formed.例文帳に追加
本発明は、低コストを実現し、アスペクト比が高いコンタクトホールにカバレッジが良好な配線の形成や配線容量の低減、多層配線の形成が可能な半導体装置の作製方法の提供を課題とする。 - 特許庁
Electric charges in an FIB electronic scanning utilized to specify a processing portion and electric charges in circuit correction processing using an FIB device are allowed to flow into a substrate, via the charge removing interconnect line 45 and the power interconnect line 43.例文帳に追加
加工部分を特定するために利用されるFIB電子走査における電荷、FIB装置を用いた回路修正加工における電荷は、電荷除去用配線45と電源配線43を介して基板に流れる。 - 特許庁
A dummy interconnect line 13 and non-dummy interconnect lines 12a and 12b are then formed simultaneously on the first interlayer insulating film 10 and a second interlayer insulating film 11 is formed on the first interlayer insulating film 10 by plasma process.例文帳に追加
次に、第1層間絶縁膜10に、ダミー配線13と、非ダミー配線12a及び12bとを同時に形成し、更に、第1層間絶縁膜10の上に、プラズマプロセスによって、第2層間絶縁膜11を形成する。 - 特許庁
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